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標簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級集成電路、軟件設(shè)計工具以及作為預(yù)定義系統(tǒng)級功能的IP(Intellectual Property)核。
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基于FPGA的自適應(yīng)計算創(chuàng)建高性能計算機
當(dāng)您將 FPGA 的自適應(yīng)計算加速與低延遲連接相結(jié)合時,您可以在可組合數(shù)據(jù)中心更進一步。您可以將計算繁重的工作負載分配給通過適應(yīng)性強的智能結(jié)構(gòu)互連的...
RapidStream:FPGA HLS設(shè)計的并行物理實現(xiàn)
FPGA的布局布線軟件向來跑得很慢。事實上,F(xiàn)PGA供應(yīng)商已經(jīng)花了很大的精力使其設(shè)計軟件在多核處理器上運行得更快。
Xylon 的 logiRECORDER 汽車視頻數(shù)據(jù)記錄器連接到各種車輛網(wǎng)絡(luò)數(shù)據(jù)總線,并插入任何類型的車載攝像頭裝置和電子控制單元之間,以低延遲記...
使用plotly_express和pandas dataframe實現(xiàn)可視化操作,能夠自由對繪圖進行zoomin/pan around/zoom bac...
AES即高級加密標準,是一種區(qū)塊加密,當(dāng)然也是對稱加密。區(qū)塊固定為128bit,秘鑰為128,192或256bit。AES有5種加密模式,xliinx采...
電子發(fā)燒友網(wǎng)報道(文/吳子鵬)2015年12月29日,當(dāng)英特爾正式宣布以167億美元完成對Altera收購時,大部分半導(dǎo)體從業(yè)者都有一個疑問,那就是英特...
Xilinx Vitis 2020.1里面MicroBlaze軟核的sleep函數(shù)卡死的問題
在Vitis里面創(chuàng)建了一個LwIP工程,調(diào)試的時候發(fā)現(xiàn),在BRAM里面運行正常,但如果改到DDR3內(nèi)存里面運行,啟動時就會卡死在sleep函數(shù)上。于是建...
2022-02-16 標簽:XilinxMicroBlaze 4.4k 0
Xilinx FPGA里面的AXI DMA IP核的簡單用法
本文以浮點數(shù)Floating-point IP核將定點數(shù)轉(zhuǎn)換為浮點數(shù)為例,詳細講解AXI DMA IP核的使用方法。
從官網(wǎng)能夠很輕松的下載到vitis的安裝包,可以下載Installer進行自動下載安裝,也可以下載整個文件的壓縮包,通過其中的setup進行安裝。
Xilinx FPGA平臺DDR3設(shè)計保姆式教程(一)
DDR3全稱double-data-rate 3 synchronous dynamic RAM,即第三代雙倍速率同步動態(tài)隨機存儲器。所謂同步,是指DD...
Xilinx SystemVerilog中的基本聯(lián)合體
在 SystemVerilog 中,聯(lián)合體只是信號,可通過不同名稱和縱橫比來加以引用。 其工作方式為通過 typedef 來聲明聯(lián)合,并提供不同標識符用...
Xilinx平臺Aurora IP介紹(一)Aurora基礎(chǔ)知識
Aurora 是一個用于在點對點串行鏈路間移動數(shù)據(jù)的可擴展輕量級鏈路層協(xié)議。這為物理層提供透明接口,讓專有協(xié)議或業(yè)界標準協(xié)議上層能方便地使用高速收發(fā)器。...
Xilinx平臺Aurora IP介紹(二)時鐘與復(fù)位
對于我們使用Xilinx或其他的成熟IP而言,IP相當(dāng)于一個黑匣子,內(nèi)部實現(xiàn)的邏輯功能我們知道,但是控制不了,只能默認OK;一般而言,成熟IP都是經(jīng)過反...
Xilinx平臺Aurora IP介紹(三)Aurora配置及接口
開門見山的說,跟DDR/PCIE/GTX這種復(fù)雜的IP相比,Aurora配置那是相當(dāng)?shù)暮唵?。走著?/p>
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