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• 數(shù)字芯片設(shè)計流程分析之模擬IC

  假如我們想要錄制一段聲音，模擬信號的做法是把所有的聲音信息用一段連續(xù)變化的電磁波或電壓信號原原本本地記錄下來。而按照一定的規(guī)則將其轉(zhuǎn)換為一串二進制數(shù)0和1，然后用兩種狀態(tài)的信號來表示它們，這叫數(shù)字信號。...

  3063次閱讀 · 0評論 模擬IC芯片設(shè)計模擬信號數(shù)字信號

• 芯片設(shè)計五部曲之算法仿真

  算法是對芯片系統(tǒng)進行的整體戰(zhàn)略規(guī)劃，決定了芯片各個模塊功能定義及實現(xiàn)方式，指引著整個芯片設(shè)計的目標和方向。可謂，牽一發(fā)而動全身。...

  1495次閱讀 · 0評論 IC設(shè)計算法無線通信芯片設(shè)計eda

• EDA技術(shù)探索之窄溝道效應與反窄溝道效應

  其中柵極方向與有源區(qū)方向呈垂直交錯，中間白色的區(qū)域就是隔離區(qū)，或稱為場區(qū)。我們最常見的照片是沿著有源區(qū)方向做截面的，如果沿著柵極方向做截面，則可以看到完整的溝道和場氧化層的截面。...

  5514次閱讀 · 0評論 電路設(shè)計eda

• 淺談EDA貫穿芯片設(shè)計與制造

  整個 EDA 的市場規(guī)模在整個集成電路產(chǎn)業(yè)中占比很小，和以互聯(lián)網(wǎng)為代表的信息技術(shù)服務產(chǎn)業(yè)相比更是九牛一毛。但是EDA產(chǎn)業(yè)是電子設(shè)計產(chǎn)業(yè)的最上游，也是整個電子信息產(chǎn)業(yè)的基石之一。...

  2575次閱讀 · 0評論 集成電路eda

• EDA和IP市場出現(xiàn)的三大技術(shù)趨勢分析

  在云端部署云原生EDA工具和預先針對IC設(shè)計而優(yōu)化的硬件平臺，以及靈活的EDA使用授權(quán)模式，讓云端EDA成為很有吸引力的選擇。云計算部署模式有三種形式：公有云、私有云和混合云。...

  1379次閱讀 · 0評論 soceda

• 智能汽車領(lǐng)域IC設(shè)計面臨著什么挑戰(zhàn)？

  可靠的汽車技術(shù)和傳感器的進步，包括外部雷達、攝像頭和傳感器融合，有助于推動ADAS、車輛連接和移動服務的發(fā)展。...

  714次閱讀 · 0評論 IC設(shè)計人工智能adas近紅外光譜

• 芯片設(shè)計五部曲之數(shù)字IC設(shè)計

  這一階段可分為邏輯綜合、形式驗證、門級仿真、ATPG驗證等業(yè)務場景。 數(shù)字中端呈現(xiàn)單、多任務混合的特點，因為計算的輸入數(shù)據(jù)中包含門延遲信息，輸入數(shù)據(jù)變多，對內(nèi)存的需求相比前端有一定增長。...

  2240次閱讀 · 0評論 cpuIC設(shè)計gpu芯片設(shè)計數(shù)字信號

• EDA探索之新型垂直互補場效應晶體管（CFET）結(jié)構(gòu)設(shè)計

  集成電路密度的提升是一個業(yè)界持續(xù)追求的方向，也是“集成”的含義所在。提升集成電路器件密度有多種方式，其中降低器件的單位面積是最根本也是最有效的途徑。...

  1939次閱讀 · 0評論 集成電路振蕩器場效應晶體管

• 芯片設(shè)計之模擬IC設(shè)計設(shè)計全流程分析圖

  射頻芯片作為模擬電路王冠上的明珠，一直被認為是芯片設(shè)計中的“華山之巔”。 一方面因為射頻電路的物理形狀和周圍介質(zhì)分布會對射頻信號的傳輸造成很大影響。...

  3267次閱讀 · 1評論 模擬電路模擬ICeda射頻電路射頻芯片

• 淺談IC設(shè)計/驗證中ChatGPT的應用

  寫一個perl腳本，文件名叫test.pl，查找當前目錄下包含“abc”字符串的文件，將這些文件備份，備份名稱為在原名稱后加“_bak”。...

  1696次閱讀 · 0評論 IC設(shè)計OpenAIChatGPT

• EDA探索之控制閾值電壓

  精確控制集成電路中MOSFET的閾值電壓對電路的可靠性至關(guān)重要。通常情況下，閾值電壓是通過向溝道區(qū)的離子注入來調(diào)整的。...

  2580次閱讀 · 0評論 MOSFETeda晶體管

• EDA技術(shù)探索之源漏穿通解析

  以NMOS為例在源漏穿通發(fā)生之后，對于載流子而言存在一個N-D-N的通道。源極的部分電子進入耗盡區(qū)后，有一定可能被電場直接掃進漏極，進而被漏極收集，從而實現(xiàn)電流從源極到漏極的導通。...

  2839次閱讀 · 0評論 集成電路eda

• 如何管理IC芯片研發(fā)過程產(chǎn)生的bug呢？

  一款芯片的研發(fā)過程中總是伴隨著bug、bug和bug，研發(fā)線上各端的IC工程師也是全程在debug、debug和debug，直到最終的GDSII文件交給Founry工廠加工，全程都是為了保證芯片最終能夠安全保質(zhì)的tape-out成功。...

  1041次閱讀 · 0評論 ICSMySQLGDSIIIC芯片

• 判斷集成電路中IC好壞的六種方法

  一般情況下可用直流電阻法測量各引腳對應于接地腳間的正反向電阻值，并和完好集成電路進行比較，也可以采用替換法把可疑的集成電路插到正常設(shè)備同型號集成電路的位置上來確定其好壞。...

  9378次閱讀 · 0評論 集成電路萬用表直流電阻晶體管電壓測量

• EDA探索之GIDL技術(shù)分析

  一般來講，我們認為器件在線性區(qū)漏極電壓很小，沒有GIDL現(xiàn)象 。從上圖明顯可以看到在0V時Idsat曲線比Idlin曲線的電流高了兩個數(shù)量級。在反方向繼續(xù)掃描Idsat曲線，Ioff反而會進一步升高。...

  11905次閱讀 · 0評論 LDDeda漏極電壓

• 高可靠芯片的設(shè)計、評估、驗證介紹

  可靠性工程是提高元器件在整個生命周期內(nèi)可靠性的一門工程技術(shù)學科，涉及設(shè)計、分析、試驗等各個產(chǎn)品開發(fā)過程。...

  4645次閱讀 · 0評論 射頻芯片5G

• 芯片設(shè)計之模擬IC設(shè)計全流程分析

  　射頻芯片作為模擬電路王冠上的明珠，一直被認為是芯片設(shè)計中的“華山之巔”。一方面因為射頻電路的物理形狀和周圍介質(zhì)分布會對射頻信號的傳輸造成很大影響。...

  8164次閱讀 · 0評論 模擬ICIC設(shè)計芯片設(shè)計eda射頻芯片

• EDA技術(shù)探索之DIBL應用分析

  DIBL不僅只發(fā)生在亞閾值區(qū)，引起閾值電壓的下降。在飽和區(qū)晶體管導通后，由于勢壘的降低，同樣會引入更多的載流子注入，從而降低晶體管的導通電阻。...

  6083次閱讀 · 0評論 導通電阻eda

• 樹莓派使用KiCad設(shè)計方案

  樹莓派官方使用KiCad、資助KiCad，而KiCad開發(fā)團隊也支持樹莓派，具體行動是KiCad也推出Raspberry Pi OS適用的版本，只要是基于代號Bulleye的Debian Linux之后的Raspberry Pi OS都可以使用KiCad（注1）。...

  2901次閱讀 · 0評論 pcb樹莓派

• 如何突破EDA封鎖 卷起來的閾值電壓

  Vt roll-off核心是（同一個工藝節(jié)點下面）閾值電壓與柵長之間的關(guān)系。當溝道長度比較長的時候，Vt值是比較穩(wěn)定的。隨著溝道長度的減小，閾值電壓會下降（對于PMOS而言是絕對值的下降）。...

  2826次閱讀 · 0評論 集成電路edaPMOS
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