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可編程邏輯

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Quartus16.0破解器

2017-09-06 標簽：CPLD QUARTUS NIOSII

Qsys系統(tǒng)生成之后，沒有reset輸入引腳是怎么回事？

2017-09-06 標簽：Qsys NIOSII

各位大神，幫忙看一下這是什么情況，謝謝。

2017-09-06

小弟想學(xué)習(xí)FPGA芯片的最小系統(tǒng)搭建，求大神指教！

2017-09-06

請問FPGA如何對1M個點做FFT的方法

2017-09-05 標簽：FFT

tse license

2017-09-05

關(guān)于黑金的資料中串口接收程序的一個問題希望得到解答

2017-09-04

大神們，怎么用89C51設(shè)計一個交通控制器？

2017-09-04

vivado固化flash失敗

2017-09-03 標簽：Flash

求大神指教：研究生小白一枚，導(dǎo)師是做圖像處理方向的，開學(xué)后導(dǎo)師是要分方向，關(guān)于方向的選擇有些疑惑

2017-09-03 標簽：數(shù)字圖像處理 DSP

vivado中如何對edif封裝后的文件進行modelsim下的時序仿真，求教

2017-09-03 標簽：vivado Flash

FPGA vs ASIC 你看好誰？

2017-09-02 標簽：Multisim ASIC

跪求利用quartus ii FFT IP核實現(xiàn)FFT算法的視頻教程！

2017-09-02 標簽：FFT IP核

按照書上的分頻電路，綜合后仿真出來是未知值？

2017-09-02

一個verilogHDL語言的音樂產(chǎn)生模塊，賦值總是有問題，求大家?guī)兔聪聠栴}出在哪……

2017-09-02 標簽：Verilog

339

【下載】《FPGA設(shè)計指南：器件、工具和流程》

2017-09-01

【AC620 FPGA試用體驗】紅外遙控解碼研究

2017-09-01 標簽：微處理器模數(shù)轉(zhuǎn)換器

MangoTree搞了一圈相機，到底要搞什么Freestyle？！

2017-09-01

FPGA設(shè)計總結(jié)十五條

2017-09-01

xilinx dds核的正弦輸出和相位輸出是什么編碼，感覺數(shù)字不太對啊

2017-08-31 標簽：chirp DDS Verilog

求助vivado中如何調(diào)用封裝好的*.edif和*_stub.v文件，直接添加到工程中一直報錯，謝謝幫助

2017-08-31 標簽：vivado Flash

ad7791BRM的Verilog準備程序如何編寫

2017-08-31

請懂fpga的小伙伴們指點一下如何學(xué)習(xí)fpga

2017-08-30

麻煩大家推薦一塊FPGA開發(fā)板

2017-08-30

有償求助：RTL8365MB/RTL8363SB 寄存器問題

2017-08-30 標簽：RGMII

我想問一下在Verilong中,a <= 8'b0;和a <= 8'd0;有什么不同，順便求推薦Veriog語法書。

2017-08-29 標簽：Verilog Verilog語言

基于FPGA的Sobel邊緣檢測的實現(xiàn)

2017-08-29 標簽：圖像處理

AD采集，UDP傳輸

2017-08-29 標簽：labview AD采集漏包

用ISE關(guān)聯(lián)Modelsim關(guān)聯(lián)仿真后，對源文件修改怎樣快速仿真？

2017-08-28 標簽：modelsim

基于FPGA的fir濾波器實現(xiàn)

2017-08-28 標簽：fir數(shù)字濾波器

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