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時(shí)序約束實(shí)操

XL FPGA技術(shù)交流 ? 來(lái)源:XL FPGA技術(shù)交流 ? 作者:XL FPGA技術(shù)交流 ? 2024-04-28 18:36 ? 次閱讀
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易靈思提供了相關(guān)時(shí)序約束的PPT,內(nèi)容非常全面,但是我們還是發(fā)現(xiàn)很多客戶在使用Efinity時(shí),時(shí)序約束存在很多問(wèn)題。

添加約束

添加約束的目的是為了告訴FPGA你的設(shè)計(jì)指標(biāo)及運(yùn)行情況。在上面的生成約束之后,在Resultàxx.sdc中提供約束參考(請(qǐng)注意該文件不能直接添加到工程中,需要熱復(fù)制到別的指定目錄或者新建自己的SDC文件添加到工程)。

c5883582-0365-11ef-b759-92fbcf53809c.png

編譯完成之后可以查看時(shí)序報(bào)告,也可以通過(guò)routingàxx.timing.rpt來(lái)查看路徑詳細(xì)延時(shí)信息,如果想查看更可以通過(guò)指令來(lái)打印或者通過(guò)print_critical_path來(lái)控制打印的路徑數(shù)量 。

時(shí)鐘約束

(1)通過(guò)IO輸入的gclk。

如下圖,因?yàn)闀r(shí)鐘是通過(guò)外部IO輸入的,所以FPGA并不知道這個(gè)時(shí)鐘頻率是多少。打開(kāi).pt.sdc可以看到提供相關(guān)約束參考。

c5a60440-0365-11ef-b759-92fbcf53809c.png

我們只需要補(bǔ)充相關(guān)的時(shí)鐘周期即可以使用。

c5dc2ec6-0365-11ef-b759-92fbcf53809c.png

比如,我們要約束adc_clk_in為100M:

create_clock-period10.000[get_ports{adc_clk_in}]

(2)PLL的輸出的時(shí)鐘約束。

因?yàn)镻LL的輸入輸出頻率都是設(shè)置好的,所以軟件可以檢測(cè)到。如下圖,輸入輸出時(shí)鐘頻率都是30MHz.

c5ef31ec-0365-11ef-b759-92fbcf53809c.png

在pt.sdc文件中會(huì)提供相應(yīng)的約束 。

create_clock -period 33.3333 pll_inst1_CLKOUT0

在時(shí)鐘約束完成之后,可以查看Routing -->.timing.rpt文件中所有的時(shí)鐘是否都進(jìn)行了完整的約束 。

c6117f9a-0365-11ef-b759-92fbcf53809c.png

IO約束

首先我們要了解易靈思的架構(gòu)是core和interface分開(kāi)的,相對(duì)于core,interface內(nèi)部的GPIO,LVDS,JTAG及其它都是外設(shè)。所以所有針對(duì)于input_delay和outpu_delay的約束都是針對(duì)于interface的。至于FPGA對(duì)于我們平時(shí)理解的外設(shè),比如FPGA外部連接一片AD/DA,這種是沒(méi)有辦法約束的。

c63cd6e0-0365-11ef-b759-92fbcf53809c.png

在pt.sdc文件中可以看到關(guān)于set_input_delay和set_output_delay的約束??梢钥吹接行┘s束是已經(jīng)屏蔽,那是因?yàn)樘砑拥腎O沒(méi)有打開(kāi)寄存器。

c6646bba-0365-11ef-b759-92fbcf53809c.png

如下圖,易靈思建議把所有IO都添加上IO寄存器。

c6823da2-0365-11ef-b759-92fbcf53809c.png

有的客戶會(huì)有疑問(wèn),clock的PIN Name是什么?其實(shí)就是與core內(nèi)連接的寄存器用什么時(shí)鐘,interface中就用什么時(shí)鐘。

c699bf86-0365-11ef-b759-92fbcf53809c.png

(3)跨時(shí)鐘域約束

在保證程序上對(duì)跨時(shí)鐘域做了處理之后,約束上要對(duì)跨時(shí)鐘進(jìn)行約束 ??鐣r(shí)鐘約束的語(yǔ)法是set_clock_groups或者set_false_path,關(guān)于用于網(wǎng)上很多,可以自行查找。

set_clock_groups -asynchronous -group {jtag_inst1_TCK jtag_inst1_DRCK}

在所有時(shí)鐘約束完成之后要保證時(shí)序報(bào)告的slack都為正值。

c6b776c0-0365-11ef-b759-92fbcf53809c.png

編譯完成之后可以查看時(shí)序報(bào)告,也可以通過(guò)routingàxx.timing.rpt來(lái)查看路徑詳細(xì)延時(shí)信息

如果時(shí)序上還有違例,在result--> Routing-->timing.rpt文件中查看具體的路徑。根據(jù)路徑來(lái)解決具體的時(shí)序問(wèn)題。

c6d31506-0365-11ef-b759-92fbcf53809c.png

如果想查看更可以通過(guò)指令來(lái)打印或者通過(guò)print_critical_path來(lái)控制打印的路徑數(shù)量 。

c6f496cc-0365-11ef-b759-92fbcf53809c.png

也可以通過(guò)report_timing來(lái)報(bào)告具體的時(shí)序路徑及數(shù)量。

c71631ba-0365-11ef-b759-92fbcf53809c.png

先打開(kāi)Tcl CommandConsole,如果Show/Hide Tcl commandConsole是灰色的,要先點(diǎn)擊Load Place and Route Data加載布局和布線的數(shù)據(jù)。

c7318776-0365-11ef-b759-92fbcf53809c.png

打開(kāi)Tcl commandconsolel,使用report_timing命令來(lái)查看需要的路徑。

c7515286-0365-11ef-b759-92fbcf53809c.png

具體report_timing的用法,請(qǐng)參考EfinityTiming Closure UserGuide.pdf。

聲明:本文內(nèi)容及配圖由入駐作者撰寫(xiě)或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問(wèn)題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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