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FPGA/ASIC技術(shù)

電子發(fā)燒友本欄目為FPGA/ASIC技術(shù)專欄，內(nèi)容有fpga培圳資料、FPGA開發(fā)板、FPGA CPLD知識(shí)以及FPGA/ASIC技術(shù)的其它應(yīng)用等；是您學(xué)習(xí)FPGA/ASIC技術(shù)的好欄目。

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【紫光同創(chuàng)國(guó)產(chǎn)FPGA教程】【第六章】PDS下按鍵消抖實(shí)驗(yàn)

按鍵做為基本的人機(jī)輸入接口，在很多電子設(shè)計(jì)中都能見到，由于機(jī)械特性，在按鍵按下或松開的時(shí)候，按鍵輸入值是有抖動(dòng)的，無(wú)論按下去是多平穩(wěn)，都難以消除抖動(dòng)，按鍵消抖方式有很多，...

2021-02-04 標(biāo)簽：FPGA RTL 按鍵 PDS 紫光同創(chuàng) 6523

【紫光同創(chuàng)國(guó)產(chǎn)FPGA教程】【第五章】串口收發(fā)實(shí)驗(yàn)

本文主要講解如何編寫FPGA串口通信的收發(fā)程序，在程序中使用了狀態(tài)機(jī)，是學(xué)習(xí)狀態(tài)機(jī)的重要實(shí)驗(yàn)。...

2021-02-04 標(biāo)簽：FPGA 串口 uart 開發(fā)板紫光同創(chuàng) 7864

【紫光同創(chuàng)國(guó)產(chǎn)FPGA教程】【第四章】PDS下PLL實(shí)驗(yàn)

很多初學(xué)者看到板上只有一個(gè)50Mhz時(shí)鐘輸入的時(shí)候都產(chǎn)生疑惑，時(shí)鐘怎么才50Mhz？如果要工作在100Mhz、150Mhz怎么辦？在很多FPGA芯片內(nèi)部都集成了PLL，其他廠商可能不叫PLL，但是也有類似的功能模...

2021-02-04 標(biāo)簽：FPGA pll 時(shí)鐘 PDS 紫光同創(chuàng) 9166

【紫光同創(chuàng)國(guó)產(chǎn)FPGA教程】【第三章】按鍵檢測(cè)實(shí)驗(yàn)

通過(guò)按鍵檢測(cè)實(shí)驗(yàn)，檢測(cè)開發(fā)板的按鍵功能是否正常，了解硬件描述語(yǔ)言和FPGA的具體關(guān)系，學(xué)習(xí)PDS View RTL Schematic的使用。...

2021-02-02 標(biāo)簽：FPGA RTL 按鍵紫光同創(chuàng)FPGA RTL 按鍵硬件描述語(yǔ)言紫光同創(chuàng) 5271

【紫光同創(chuàng)國(guó)產(chǎn)FPGA教程】【第二章】LED流水燈實(shí)驗(yàn)及仿真

通過(guò)LED流水燈實(shí)驗(yàn)，介紹使用PDS軟件開發(fā)FPGA的基本流程，器件選擇、設(shè)置、代碼編寫、編譯、分配管腳、下載、程序FLASH固化、擦除等；同時(shí)也檢驗(yàn)板上LED燈是否正常。...

2021-02-02 標(biāo)簽：FPGA led 流水燈 PDS 紫光同創(chuàng) 9623

【ZYNQ Ultrascale+ MPSOC FPGA教程】第三十二章PL讀寫PS端DDR數(shù)據(jù)

PL和PS的高效交互是zynq soc開發(fā)的重中之重，我們常常需要將PL端的大量數(shù)據(jù)實(shí)時(shí)送到PS端處理，或者將PS端處理結(jié)果實(shí)時(shí)送到PL端處理，常規(guī)我們會(huì)想到使用DMA的方式來(lái)進(jìn)行，但是各種協(xié)議非常麻...

2021-01-30 標(biāo)簽：FPGA DDR dma Zynq MPSoC 16864

【ZYNQ Ultrascale+ MPSOC FPGA教程】第三十一章FreeRTOS實(shí)驗(yàn)

如何搭建Free RTOS實(shí)時(shí)操作系統(tǒng)運(yùn)行環(huán)境，這里不深入探討Free RTOS的具體使用。本實(shí)驗(yàn)以FreeRTOS Hello World做舉例，并實(shí)現(xiàn)兩個(gè)LED燈以不同間隔持續(xù)閃爍。...

2021-01-30 標(biāo)簽：FPGA led RTOS FreeRTOS Zynq MPSoC 8050

【紫光同創(chuàng)國(guó)產(chǎn)FPGA教程第一章】Pango Design Suite 2020.3安裝

ango Design Suite是深圳市紫光同創(chuàng)電子有限公司的FPGA開發(fā)軟件，截止到目前，軟件的最新版本為Pango Design Suite 2020.3。...

2021-01-26 標(biāo)簽：FPGA Linux WINDOWS 編譯紫光同創(chuàng) 15671

FPGA：I/O之差分信號(hào)

區(qū)別于傳統(tǒng)的一根信號(hào)線一根地線的做法，差分傳輸在兩根線上都傳輸信號(hào)，這兩個(gè)信號(hào)的振幅相同，相位相反，在這兩根線上的傳輸?shù)男盘?hào)就是差分信號(hào)。信號(hào)接收端通過(guò)比較這兩個(gè)電壓的差...

2022-07-25 標(biāo)簽：FPGA 差分信號(hào) 7045

Vitis AI1.1系列教程1——軟件安裝

本博文介紹Vitis AI1.1 系列軟件安裝教程。...

2022-07-25 標(biāo)簽：FPGA FPGA Vitis 2602

Vitis IDE入門helloworld程序

第一個(gè)Xilinx Vitis IDE入門helloworld程序...

2022-07-25 標(biāo)簽：Xilinx IDE Vitis 1898

ZYNQ-7000系列MIO、EMIO、AXI_GPIO接口

ZYNQ-7000系列MIO/EMIO/AXI_GPIO接口...

2022-07-25 標(biāo)簽：Zynq-7000 3736

【ZYNQ Ultrascale+ MPSOC FPGA教程】第三十章自定義IP實(shí)驗(yàn)

創(chuàng)建自己的IP核有很多好處，例如系統(tǒng)設(shè)計(jì)定制化；設(shè)計(jì)復(fù)用，可以在在IP核中加入license, 有償提供給別人使用；簡(jiǎn)化系統(tǒng)設(shè)計(jì)和縮短設(shè)計(jì)時(shí)間。用ZYNQ系統(tǒng)設(shè)計(jì)IP核，最常用的就是使用AXI總線將...

2021-02-01 標(biāo)簽：FPGA Xilinx IP Zynq MPSoC 6355

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十九章PL端AXI GPIO的使用

使用zynq最大的疑問(wèn)就是如何把PS和PL結(jié)合起來(lái)使用，在其他的SOC芯片中一般都會(huì)有GPIO，本實(shí)驗(yàn)使用一個(gè)AXI GPIO的IP核，讓PS端通過(guò)AXI總線控制PL端的LED燈，實(shí)驗(yàn)雖然簡(jiǎn)單，不過(guò)可以讓我們了解PL和...

2021-02-01 標(biāo)簽：FPGA Xilinx GPIO Zynq MPSoC 8216

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十八章PS端EMIO的使用

如果想用PS點(diǎn)亮PL的LED燈，該如何做呢？一是可以通過(guò)EMIO控制PL端LED燈，二是通過(guò)AXI GPIO的IP實(shí)現(xiàn)控制。本章介紹如何使用EMIO控制PL端LED燈的亮滅。同時(shí)也介紹了，利用EMIO連接PL端按鍵控制PL端L...

2021-01-30 標(biāo)簽：FPGA 按鍵 GPIO Zynq MPSoC 9101

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十七章System Monitor

本章介紹system monitors的使用，用于監(jiān)測(cè)芯片的電壓、溫度值等，也可以通過(guò)PL端的ADC引腳作為外部信號(hào)的采集。PL端可以做17路ADC的采集，但開發(fā)板并沒有在這些管腳上接設(shè)備，因此本章不做講解...

2021-01-29 標(biāo)簽：FPGA adc 開發(fā)板 Zynq MPSoC 6548

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十六章PS端網(wǎng)絡(luò)遠(yuǎn)程更新QSPI

在實(shí)際工作中，會(huì)遇到產(chǎn)品升級(jí)問(wèn)題，如果按照程序燒錄的方式，可能需要打開產(chǎn)品的外殼，這無(wú)疑。本章介紹一種通過(guò)網(wǎng)絡(luò)遠(yuǎn)程更新FLASH程序的方法，包含UDP和TCP兩種方法。...

2021-01-29 標(biāo)簽：FPGA FlaSh Zynq MPSoC FlaSh FPGA MPSoC QSPI Zynq 8635

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十五章PS端以太網(wǎng)使用之lwip

開發(fā)板有兩路千兆以太網(wǎng)，通過(guò)RGMII接口連接，本實(shí)驗(yàn)演示如何使用Vitis自帶的LWIP模板進(jìn)行PS端千兆以太網(wǎng)TCP通信。 LWIP雖然是輕量級(jí)協(xié)議棧，但如果從來(lái)沒有使用過(guò)，使用起來(lái)會(huì)有一定的困難...

2021-01-28 標(biāo)簽：FPGA 以太網(wǎng)LwIP Zynq MPSoC 11229

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十四章PS端SD卡讀寫

FatFs是一個(gè)通用的文件系統(tǒng)模塊，用于在小型嵌入式系統(tǒng)中實(shí)現(xiàn)FAT文件系統(tǒng)。FatFs的編寫遵循 ANSI C，因此不依賴于硬件平臺(tái)。它可以嵌入到便宜的微控制器中，如 8051, PIC, AVR, SH, Z80, H8, ARM等等，...

2021-01-28 標(biāo)簽：FPGA 嵌入式 SD卡 Zynq MPSoC 6595

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十三章PS端DP的使用

DisplayPort v1.2協(xié)議，支持4個(gè)5.4G的lane，但本控制器只支持兩個(gè)lane，分辨率最大支持4096*2160@30。...

2021-01-27 標(biāo)簽：FPGA 音頻 DP Zynq MPSoC 8175

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十二章PS端I2C的使用

ReadBuffer清0，WriteBuffer賦FF寫16個(gè)字節(jié)到EEPROM讀EEPROM的16個(gè)字節(jié)到ReadBuffer檢驗(yàn)是否正確Readbuffer清0，WriteBuffer賦值10~25寫16字節(jié)到EEPROM讀16字節(jié)到ReadBuffer檢驗(yàn)是否正確返回....

2021-01-27 標(biāo)簽：FPGA EEPROM I2C Zynq MPSoC 7532

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十一章PS端UART讀寫控制

除了打印信息之外，如果我們想用UART進(jìn)行數(shù)據(jù)傳輸呢？本章便來(lái)介紹PS端UART的讀寫控制，實(shí)驗(yàn)中，每隔1S向外發(fā)送一串字符，如果收到數(shù)據(jù)，產(chǎn)生中斷，并將收到的數(shù)據(jù)再發(fā)送出去。...

2021-01-27 標(biāo)簽：FPGA 串口 uart Zynq MPSoC 7417

【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十章PS端RTC中斷實(shí)驗(yàn)

實(shí)驗(yàn)中通過(guò)簡(jiǎn)單的修改Vitis的例程，就完成了RTC，中斷的應(yīng)用，看似簡(jiǎn)單的操作，但蘊(yùn)含了豐富的知識(shí)，我們需要非常了解RTC的原理、中斷的原理，這些基本知識(shí)是學(xué)習(xí)好ZYNQ的必要條件。...

2021-01-26 標(biāo)簽：FPGA 實(shí)時(shí)時(shí)鐘 RTC Zynq MPSoC 7573

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十九章 Hello World(下)

本章從FPGA工程師和軟件工程師兩者角度出發(fā)，介紹了ZYNQ開發(fā)的經(jīng)典流程，F(xiàn)PGA工程師的主要工作是搭建好硬件平臺(tái)，提供硬件描述文件hdf給軟件工程師，軟件工程師在此基礎(chǔ)上開發(fā)應(yīng)用程序。本...

2021-01-26 標(biāo)簽：FPGA ARM 工程師 Zynq MPSoC 8300

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十八章 Hello World(上)

我們從原理圖中可以看到ZYNQ芯片分為PL和PS，PS端的IO分配相對(duì)是固定的，不能任意分配，而且不需要在Vivado軟件里分配管腳，雖然本實(shí)驗(yàn)僅僅使用了PS，但是還要建立一個(gè)Vivado工程，用來(lái)配置...

2021-01-26 標(biāo)簽：FPGA ARM 工程師 Zynq MPSoC 5458

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十七章Vitis準(zhǔn)備工程及注意事項(xiàng)

所有的工程目錄下都有個(gè)bootimage文件夾，存放了對(duì)應(yīng)的BOOT.bin文件，可將此文件拷貝到Vitis_image_download文件夾，覆蓋原有的BOOT.bin。也可以把BOOT.bin放到SD卡啟動(dòng)驗(yàn)證功能。...

2021-01-26 標(biāo)簽：FPGA 編譯 Zynq MPSoC Vitis 5110

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十六章7寸液晶屏顯示實(shí)驗(yàn)

LCD屏顯示方式從屏幕左上角一點(diǎn)開始，從左向右逐點(diǎn)顯示，每顯示完一行,再回到屏幕的左邊下一行的起始位置，在這期間，需要對(duì)行進(jìn)行消隱，每行結(jié)束時(shí)，用行同步信號(hào)進(jìn)行同步；LCD的驅(qū)動(dòng)...

2021-01-25 標(biāo)簽：FPGA 觸摸屏液晶 Zynq MPSoC 6351

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十五章HDMI字符顯示實(shí)驗(yàn)

在HDMI輸出實(shí)驗(yàn)中講解了HDMI顯示原理和顯示方式，本實(shí)驗(yàn)介紹如何使用FPGA實(shí)現(xiàn)字符顯示，通過(guò)這個(gè)實(shí)驗(yàn)更加深入的了解HDMI的顯示方式。...

2021-01-25 標(biāo)簽：FPGA HDMI 開發(fā)板 Zynq MPSoC 6590

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十四章HDMI輸出實(shí)驗(yàn)

由于開發(fā)板上只有DP可以顯示，但卻是PS端的，PL端沒有HDMI的接口，因此我們采用AN9134的HDMI擴(kuò)展模塊實(shí)現(xiàn)HDMI顯示。將24位RGB編碼輸出TMDS差分信號(hào)。SIL9134功能強(qiáng)大，本實(shí)驗(yàn)只使用其中一小部分，...

2021-01-25 標(biāo)簽：FPGA HDMI 開發(fā)板 Zynq MPSoC 6957

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十三章RS485實(shí)驗(yàn)

RS485與RS422類似，也是采用差分信號(hào)傳輸，但RS485是半雙工傳輸，也就是說(shuō)，同一時(shí)刻只能有一個(gè)方向的數(shù)據(jù)傳輸。而且接口也比RS422少，只有差分信號(hào)A和B，而與ARM或FPGA相連的信號(hào)為DE（方向選...

2021-01-25 標(biāo)簽：FPGA RS485 差分信號(hào)Zynq MPSoC 6207

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