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FPGA/ASIC技術(shù)
電子發(fā)燒友本欄目為FPGA/ASIC技術(shù)專欄，內(nèi)容有fpga培圳資料、FPGA開發(fā)板、FPGA CPLD知識(shí)以及FPGA/ASIC技術(shù)的其它應(yīng)用等；是您學(xué)習(xí)FPGA/ASIC技術(shù)的好欄目。
基于FPGA的DVI接收器設(shè)計(jì)與實(shí)現(xiàn)
DVI(Digital Video Interface)接口是由數(shù)字顯示工作組在1999年制定的，利用最小變換差分信號(hào)TMDS作為基本電氣鏈接信號(hào)。圖像源生成的3路紅、綠、藍(lán)信號(hào)和控制信號(hào)在時(shí)鐘的作用下由DVI發(fā)送器進(jìn)行編...
基于FPGA的毛刺問題及解決方法
毛刺現(xiàn)象在FPGA設(shè)計(jì)中非常普遍, 而毛刺的出現(xiàn)往往導(dǎo)致系統(tǒng)結(jié)果的錯(cuò)誤。本文從FPGA的原理結(jié)構(gòu)的角度深入探討了毛刺產(chǎn)生的原因及產(chǎn)生的條件,總結(jié)了多種不同的解決方法,并結(jié)合具體的應(yīng)用對(duì)解...
基于FPGA速率匹配算法的實(shí)現(xiàn)
LTE(長期演進(jìn))是3.9G的全球標(biāo)準(zhǔn)，采用OFDM和MIMO技術(shù)作為其無線網(wǎng)絡(luò)演進(jìn)的唯一標(biāo)準(zhǔn)，極大地提高了系統(tǒng)的帶寬[1]。而速率匹配是LTE系統(tǒng)中重要的組成部分，因此速率匹配設(shè)計(jì)的優(yōu)劣，決定整個(gè)系...
基于FPGA的指針反饋式低功耗Viterbi譯碼器的性能分析和設(shè)計(jì)
隨著現(xiàn)代無線通信系統(tǒng)日益復(fù)雜化的發(fā)展，無線基帶通信系統(tǒng)中各模塊的實(shí)際性能、延時(shí)、功耗等參數(shù)成為基帶設(shè)計(jì)的重要考慮因素。Viterbi譯碼器廣泛應(yīng)用于無線局域網(wǎng)和移動(dòng)通信系統(tǒng)，并且...
通過可編程邏輯來提高器件處理系統(tǒng)的性能
賽靈思 Zynq?- 7000 All Programmable SoC真正的重要優(yōu)勢(shì)之一就是能夠通過在可編程邏輯（PL）側(cè)構(gòu)建外設(shè)來提高器件處理系統(tǒng)（PS）側(cè)的性能。最初您可能會(huì)認(rèn)為這將是一項(xiàng)比較復(fù)雜的工作，但是，創(chuàng)...
一款基于FPGA的無線電系統(tǒng)教學(xué)平臺(tái)
利用賽靈思Spartan-6器件和一些外設(shè)組件輕松為學(xué)生和新手構(gòu)建一款有趣的演示平臺(tái)。 我們近期打算北京理工大學(xué)開發(fā)一款數(shù)字設(shè)計(jì)教學(xué)平臺(tái)，它能展現(xiàn)FPGA在通信和信號(hào)處理領(lǐng)域的實(shí)際效用。這...
2017-11-22 標(biāo)簽：FPGA 2693
一種高頻高可靠性的信號(hào)采樣和相關(guān)處理系統(tǒng)
為同時(shí)完成4個(gè)Stokes 矢量參數(shù)的相關(guān)測(cè)量，反演海面風(fēng)場(chǎng)，提出了新型數(shù)字相關(guān)器的設(shè)計(jì)方法。結(jié)合高速數(shù)字相關(guān)器在數(shù)字極化輻射計(jì)中的應(yīng)用，介紹了高速數(shù)據(jù)采樣和相關(guān)處理系統(tǒng)。通過兩片...
2017-11-22 標(biāo)簽：FPGAadc08d1500 3350
基于FPGA配置電路的設(shè)計(jì)
FPGA配置方式靈活多樣，根據(jù)芯片是否能夠自己主動(dòng)加載配置數(shù)據(jù)分為主模式、從模式以及JTAG模式。典型的主模式都是加載片外非易失(斷電不丟數(shù)據(jù))性存儲(chǔ)器中的配置比特流，配置所需的時(shí)鐘...
基于FPGA的高速嵌入式通信系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
針對(duì)CPCI架構(gòu)通用信號(hào)處理平臺(tái)上利用系統(tǒng)自身以太網(wǎng)絡(luò)接口實(shí)現(xiàn)數(shù)據(jù)傳輸效率低、擴(kuò)展性差等問題, 提出一種采用高速Link口基于FPGA上硬核PowerPC405 的嵌入式千兆以太網(wǎng)通信實(shí)現(xiàn)方案,詳細(xì)說明了...
基于FPGA的反應(yīng)堆控制保護(hù)系統(tǒng)的設(shè)計(jì)
在基于現(xiàn)場(chǎng)可編程門陣列(FPGA)的反應(yīng)堆控制保護(hù)系統(tǒng)設(shè)計(jì)中，針對(duì)各種電子設(shè)備的電磁干擾，通過在硬件設(shè)計(jì)中采用信號(hào)隔離、消噪、消激和閾值調(diào)節(jié)電路等抗干擾措施，并利用軟件提高抗干擾...
2017-11-22 標(biāo)簽：FPGA 1549
基于FPGA的NoC多核處理器的設(shè)計(jì)
為了能夠靈活地驗(yàn)證和實(shí)現(xiàn)自主設(shè)計(jì)的基于NoC的多核處理器，縮短N(yùn)oC多核處理器的設(shè)計(jì)周期，提出了設(shè)計(jì)集成4片Virtex-6—550T FPGA的NoC多核處理器原型芯片設(shè)計(jì)／驗(yàn)證平臺(tái)。分析和評(píng)估了NoC多核處...
2017-11-22 標(biāo)簽：FPGAxc6vlx550t 5477
基于FPGA的視頻圖像處理系統(tǒng)的設(shè)計(jì)
通過研究視頻圖像處理和視頻圖像幀格式以及FIF0緩存技術(shù)，提出了基于FPGA的視頻圖像處理系統(tǒng)設(shè)計(jì)。該設(shè)計(jì)運(yùn)用幀間差分法、同步FIF0緩存設(shè)計(jì)，有效避免了圖像處理系統(tǒng)設(shè)計(jì)中亞穩(wěn)態(tài)和異步信...
基于FPGA的數(shù)字下變頻器的設(shè)計(jì)與實(shí)現(xiàn)
設(shè)計(jì)和實(shí)現(xiàn)了基于FPGA的可編程數(shù)字下變頻器（DDC），用于寬帶數(shù)字中頻軟件無線電接收機(jī)中，主要完成了數(shù)字下變頻、數(shù)據(jù)抽取等功能。采用自頂向下的模塊化設(shè)計(jì)方法，將整個(gè)下變頻器劃分...
基于FPGA的高速可靠數(shù)據(jù)傳輸系統(tǒng)的實(shí)現(xiàn)
在各種不同的場(chǎng)合中，人們需要將大批數(shù)據(jù)從一個(gè)設(shè)備無差錯(cuò)地傳輸?shù)搅硪粋€(gè)設(shè)備上。對(duì)于設(shè)備間距離較近的場(chǎng)合，可以選擇PCIE（典型距離是15～30cm）或者USB（最長傳輸距離5m）等接口。而對(duì)于...
基于MSP430的三線串行接口通信系統(tǒng)
通過研究三線串行接口的構(gòu)成原理，設(shè)計(jì)了一種基于MSP430單片機(jī)和FPGA的三線串行接口測(cè)試儀。該測(cè)試儀利用MSP430單片機(jī)來控制三線傳輸功能，由FPGA產(chǎn)生三線傳輸時(shí)序，由相應(yīng)的上位機(jī)軟件來測(cè)...
基于細(xì)節(jié)增強(qiáng)和動(dòng)態(tài)壓縮算法的圖像處理方案
在FPGA處理板上實(shí)現(xiàn)了細(xì)節(jié)增強(qiáng)與動(dòng)態(tài)范圍壓縮算法，實(shí)驗(yàn)表明，處理系統(tǒng)對(duì)于大動(dòng)態(tài)以及小動(dòng)態(tài)場(chǎng)景目標(biāo)都有較好的適應(yīng)性，使原始圖像數(shù)據(jù)中大動(dòng)態(tài)范圍的目標(biāo)細(xì)節(jié)信息在8bit數(shù)據(jù)圖像上都...
基于FPGA的千兆以太網(wǎng)協(xié)議分析技術(shù)
以太網(wǎng)是當(dāng)前最基本、最流行的局域網(wǎng)組網(wǎng)技術(shù)，為了適應(yīng)各種新開展的業(yè)務(wù)如流視頻等，其速率也在不斷提高。千兆以太網(wǎng)是建立在以太網(wǎng)標(biāo)準(zhǔn)基礎(chǔ)之上的技術(shù)，具有高效、高速、高性能的特...
2017-11-22 標(biāo)簽：FPGA 5895
基于FPGA 的SPI Flash 控制器設(shè)計(jì)及驗(yàn)證
現(xiàn)場(chǎng)可編程門陣列FPGA 常常進(jìn)行大數(shù)據(jù)量的處理,數(shù)據(jù)的存儲(chǔ)便成了問題,利用SPI Flash 大容量、讀寫速度快、成本低廉以及數(shù)據(jù)在斷電后不丟失的特點(diǎn),可以將配置數(shù)據(jù)存儲(chǔ)于SPI Flash 中[1] 。它比起...
基于FPGA的信號(hào)去直流系統(tǒng)的設(shè)計(jì)
利用FPGA進(jìn)行數(shù)字信號(hào)處理時(shí)，信號(hào)中的直流分量通常需要去除，而直流分量在AD前段就存在，如果采用模擬電路去除直流分量比較復(fù)雜，因此通常在AD后端數(shù)字域去除直流分量。在FPGA中，常規(guī)去...
2017-11-22 標(biāo)簽：FPGA 9440
基于FPGA的多核嵌入式系統(tǒng)的設(shè)計(jì)
隨著嵌入式器件在過去數(shù)十年來的爆炸性成長，使得硬件組件及軟件工具都有顯著的改善。雖然有著這種成長與創(chuàng)新，但傳統(tǒng)嵌入式系統(tǒng)的設(shè)計(jì)方法卻少有進(jìn)步，并逐漸變成一種障礙。有鑒于新...
基于FPGA的視頻圖像縮放與疊加融合技術(shù)的設(shè)計(jì)方案及實(shí)現(xiàn)
針對(duì)兩通道視頻圖像疊加融合，設(shè)計(jì)并實(shí)現(xiàn)了一種實(shí)時(shí)性好、靈活性強(qiáng)的FPGA硬件系統(tǒng)。該系統(tǒng)可以根據(jù)實(shí)際需求進(jìn)行任意比例和任意位置的視頻圖像疊加融合。方案經(jīng)仿真驗(yàn)證后，運(yùn)用雙線性...
2017-11-22 標(biāo)簽：FPGA 5788
基于FPGA二模冗余技術(shù)的MIPS處理器系統(tǒng)設(shè)計(jì)
基于二模冗余技術(shù)和FPGA動(dòng)態(tài)部分可重構(gòu)技術(shù)設(shè)計(jì)了一種二模冗余MIPS處理器。處理器可以在不中斷系統(tǒng)運(yùn)行的同時(shí)，使用動(dòng)態(tài)可重構(gòu)技術(shù)修復(fù)系統(tǒng)故障；通過對(duì)系統(tǒng)內(nèi)部重要模塊設(shè)置冗余邏輯，...
2017-11-22 標(biāo)簽： 1623
Zynq器件三種主要類型的存儲(chǔ)控制接口解析
基于Zynq器件的嵌入式開發(fā)時(shí)，我們不可避免地需要規(guī)劃設(shè)計(jì)使用什么樣類型和多大地內(nèi)存與FLASH，本文就ZYNQ器件的存儲(chǔ)控制器作一個(gè)拋磚引玉的描述，以期大家對(duì)它有個(gè)基本了解，如有不當(dāng)或...
IP保護(hù)的各種途徑
本應(yīng)用筆記介紹了FPGA (現(xiàn)場(chǎng)可編程門陣列)及其如何保護(hù)系統(tǒng)的關(guān)鍵功能和知識(shí)產(chǎn)權(quán)(IP)。本文探討了IP保護(hù)的各種途徑。SHA-1質(zhì)詢-響應(yīng)認(rèn)證被認(rèn)為是最安全的方法。本文提出了一種能夠保護(hù)基于...
2017-11-22 標(biāo)簽：FPGA設(shè)計(jì) 3240
了解Vivado設(shè)計(jì)套件集成能力的九大理由分析
理由一：突破器件密度極限：在單個(gè)器件中更快速集成更多功能；理由二：Vivado以可預(yù)測(cè)的結(jié)果提供穩(wěn)健可靠的性能和低功耗；理由三：Vivado設(shè)計(jì)套件提供了無與倫比的運(yùn)行時(shí)間和存儲(chǔ)器利用率...
2017-11-22 標(biāo)簽：Vivado 2417
ZYNQ中斷使用入門基礎(chǔ)教程
任何一個(gè)嵌入式系統(tǒng)級(jí)的設(shè)計(jì)都離不開中斷，對(duì)于擁有雙cotex-A9的Zynq來說也一樣。Zynq的中斷設(shè)計(jì)由ARM與GIC pl390中斷控制器組成，用于接收IOP(I/O peripherals)與PL的信號(hào)。如下圖所示，CPU中的中斷分...
基于FPGA+DSP的跳頻電臺(tái)傳輸系統(tǒng)的設(shè)計(jì)方案分析
高速率跳頻、高帶寬技術(shù)是提高跳頻發(fā)射機(jī)性能的關(guān)鍵，本文結(jié)合軟件無線電思想和架構(gòu)，提出一種基于FPGA+DSP的跳頻電臺(tái)傳輸系統(tǒng)的設(shè)計(jì)方案，該系統(tǒng)兼容多種調(diào)制方式和跳頻速率及數(shù)碼率。...
基于PC機(jī)與FPGA的脈沖雷達(dá)通信系統(tǒng)設(shè)計(jì)
使用WinPcap 自定義通信幀格式，實(shí)現(xiàn)一種PC 機(jī)與FPGA 之間雙向高速數(shù)據(jù)傳輸?shù)姆椒?，繞過TCP 協(xié)議和IP 協(xié)議，只涉及到鏈路層和物理層，降低了FPGA 端的協(xié)議解析復(fù)雜度、減少拆包時(shí)間和時(shí)延，且...
基于ARM和FPGA的DMD驅(qū)動(dòng)波形實(shí)驗(yàn)平臺(tái)設(shè)計(jì)與實(shí)現(xiàn)
提出了一種基于ARM和FPGA的數(shù)字微鏡器件（DMD）驅(qū)動(dòng)波形實(shí)驗(yàn)平臺(tái)的設(shè)計(jì),該設(shè)計(jì)由數(shù)字微鏡驅(qū)動(dòng)器和電壓轉(zhuǎn)換器兩部分構(gòu)成。闡述了數(shù)字微鏡驅(qū)動(dòng)器和電壓轉(zhuǎn)換器的硬件工作原理,以及ARM微控制器...
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