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FPGA/ASIC技術(shù)
電子發(fā)燒友本欄目為FPGA/ASIC技術(shù)專欄，內(nèi)容有fpga培圳資料、FPGA開發(fā)板、FPGA CPLD知識以及FPGA/ASIC技術(shù)的其它應(yīng)用等；是您學(xué)習(xí)FPGA/ASIC技術(shù)的好欄目。
高云半導(dǎo)體小蜜蜂家族GW1N系列新增兩款非易失性FPGA芯片成員
高云半導(dǎo)體研發(fā)副總裁王添平先生這樣認(rèn)為，“GW1N-9、GW1N-6的推出標(biāo)志著高云半導(dǎo)體小蜜蜂家族GW1N系列成員全部面市，至此，在公司成立的短短3年半時間里，高云半導(dǎo)體已累計向市場推出了十...
2017-08-02 標(biāo)簽：FPGA低功耗高云半導(dǎo)體 4544
賽靈思用定點數(shù)實現(xiàn)信號處理鏈
賽靈思器件和工具支持從二進(jìn)制到雙精度在內(nèi)的多種數(shù)據(jù)類型。UltraScale ? 架構(gòu)的可擴(kuò)展精度提供極大靈活性，便于優(yōu)化功耗和資源利用，同時滿足設(shè)計性能目標(biāo)要求。 摘要 在數(shù)據(jù)中心、航空...
華為工程師喜歡采用MATLAB開發(fā)產(chǎn)品的7大理由
今天華為的成功離不開3大基礎(chǔ)軟件系統(tǒng)的支撐，一是全球團(tuán)隊項目協(xié)作溝通郵件系統(tǒng)LOTUS，二是產(chǎn)品全生命周期管理軟件PLM，三是算法開發(fā)和大數(shù)據(jù)處理軟件MATLAB，其中MATLAB可能大家比較陌生，...
美高森美和Athena 用于PolarFire “S級” FPGA器件的 TeraFire 硬件加密微處理器提供先
美高森美公司（Microsemi Corporation，紐約納斯達(dá)克交易所代號：MSCC） 致力于在功耗、安全、可靠性和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商，宣布其全新PolarFire? “S級”系列可編程...
FPGA市場前景誘人，這些廠商不可不知！
FPGA市場前景誘人，但是門檻之高在芯片行業(yè)里無出其右。全球有60多家公司先后斥資數(shù)十億美元，前赴后繼地嘗試登頂FPGA高地，其中不乏英特爾、IBM、德州儀器、摩托羅拉、飛利浦、東芝、三...
Xilinx 廣泛部署動態(tài)重配置技術(shù)
2017年4月21日，北京—All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司（Xilinx， Inc.，（NASDAQ:XLNX））宣布，在今天發(fā)布的Vivado? Design Suite HLx 2017.1版中廣泛納入部分重配置技術(shù)，為有線和無線...
美高森美最新發(fā)布 FPGA 可編程工具 Libero系統(tǒng)級芯片(SoC)軟件
致力于在功耗、安全、可靠性和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司發(fā)布Libero系統(tǒng)級芯片(SoC)軟件的 v11.8最新版本。這是一款綜合性可編程邏輯器件(FPGA)設(shè)計工具，具...
Plunify 將出席5月在成都和長沙的2017 Xilinx All Programmable 技術(shù)研討會
Plunify 將分別于2017年5月3日（成都）和2017年5月5日（長沙）的2017Xilinx All Programmable 技術(shù)研討會。同時對于InTime時序優(yōu)化工具有興趣的朋友可以在Comtech科通展位上可以了解和參觀到具體InTime的演...
Plunify回歸至Amazon亞馬遜AWS網(wǎng)絡(luò)服務(wù)上
對于那些熟悉我們發(fā)展歷史的朋友們來說，Plunify就是在云端誕生的。我們最早的InTime產(chǎn)品原型的開發(fā)，實現(xiàn)和測試就是在亞馬遜網(wǎng)絡(luò)服務(wù)（Amazon Web Service）完成的。在那些日子里，我們僅需要...
Plunify成為Amazon EC2 F1 Instance Partner的合作廠家
祝賀Plunify正式成為Amazon 亞馬遜 AWS EC2 F1 Instance在亞太區(qū)域的首家合作伙伴。...
基于Vivado HLS的Down Scaler視頻系統(tǒng)設(shè)計
介紹一種基于FPGA的 Down Scaler視頻系統(tǒng)設(shè)計。...
2017-04-11 標(biāo)簽：VivadoDown Scaler 2572
關(guān)于FPGA展現(xiàn)卓越的全可編程性的介紹和分析
Keysight本次全新發(fā)布 M3系列，包含六個新PXI數(shù)字轉(zhuǎn)換器和AWG（隨機(jī)波形發(fā)生器），均采用了Xilinx Kintex-7 FPGA 325T或410T FPGA，具備極強(qiáng)的實時處理能力和強(qiáng)大的可編程性。Keysight為C，C ++，Visual Stu...
2019-10-06 標(biāo)簽：處理器控制器數(shù)字轉(zhuǎn)換器 875
Z1上搭建二值神經(jīng)網(wǎng)絡(luò)（BNN）
機(jī)器學(xué)習(xí)（Machine Learning）以及其中的深度學(xué)習(xí)（Deep Learning）在最近幾年的科技行業(yè)非常地吸引眼球，取得了爆發(fā)式的發(fā)展——僅僅在過去兩年間，機(jī)器學(xué)習(xí)技術(shù)所取得的發(fā)展成就，就已超越了...
2017-04-06 標(biāo)簽：神經(jīng)網(wǎng)絡(luò)cnnBNN 4729
Aldec新推基于Virtex UltraScale VU440 HES
Xilinx 的Virtex UltraScale系列的器件均采用20nm工藝實現(xiàn)，具有極高的性能，包含較高的串行I/O帶寬和強(qiáng)大的邏輯能力，作為行業(yè)內(nèi)僅有的20nm處理器中的高端FPGA，可以實現(xiàn)高達(dá)400G的網(wǎng)絡(luò)設(shè)計應(yīng)用和...
傳輸速率顯著提升：Berten DSP發(fā)布GigaX高速API
BERTEN是一家由擁有航空航天技術(shù)經(jīng)驗的工程師創(chuàng)立的私人公司，可為復(fù)雜苛刻環(huán)境提供高速電子產(chǎn)品和嵌入式軟件，應(yīng)用于國防、航空電子、導(dǎo)航、無人車、科學(xué)研究等諸多領(lǐng)域。...
認(rèn)識多種處理芯片的特性和實戰(zhàn)
以x86體系為代表的CPU已經(jīng)占有了桌面和服務(wù)器處理器的絕大部分份額，而且這個趨勢還在不斷增強(qiáng)。CPU具有兼容性強(qiáng)、易編程、應(yīng)用資源豐富、價格低廉的優(yōu)勢，但是在某些領(lǐng)域，CPU存在天然的...
基于單/雙核Zynq的GigaExpress SBC PCIe卡
Berten團(tuán)隊主要研發(fā)高速電子產(chǎn)品，或者為大多數(shù)需求應(yīng)用提供信號處理解決方案，尤其是在一些極端環(huán)境下，通過可靠傳輸，對數(shù)據(jù)進(jìn)行高級處理。...
2017-03-31 標(biāo)簽：ZynqGigaExpress SBC PCIe 2379
52個有用的機(jī)器學(xué)習(xí)與預(yù)測接口盤點
隨著基于人工智能與機(jī)器學(xué)習(xí)的應(yīng)用如雨后春筍般不斷涌現(xiàn)，我們也看到有很多提供類似功能的 API 悄悄登上了舞臺。...
2017-03-29 標(biāo)簽：機(jī)器學(xué)習(xí)預(yù)測接口 1340
DRAM原理 5 ：DRAM Devices Organization
隨著系統(tǒng)對內(nèi)存容量、帶寬、性能等方面的需求提高，系統(tǒng)會接入多個 DRAM Devices。而多個 DRAM Devices 不同的組織方式，會帶來不同的效果。本文將對不同的組織方式及其效果進(jìn)行簡單介紹。...
2017-03-28 標(biāo)簽：DRAM 1793
三界大融合：AXIOM完美融合Arduino，ARM及FPGA
歷時兩年時間，AXIOM板卡終于面世了。AXIOM在開始之初，主要由歐洲七家不同的企業(yè)單位支持。其中有三所研究機(jī)構(gòu)/高校：錫耶納大學(xué)，巴塞羅那超級計算中心和Fourth，四家科技公司：SECo，Vi...
FPGA技術(shù)協(xié)助嵌入式系統(tǒng)競逐于機(jī)器學(xué)習(xí)之路
機(jī)器學(xué)習(xí)技術(shù)是人工智能的一個重要科學(xué)發(fā)展，透過在經(jīng)驗學(xué)習(xí)中改善具體算法的效能，而且用來訓(xùn)練的數(shù)據(jù)越多，所學(xué)習(xí)出來的結(jié)果越好，為了處理分析大量圖像或是語音等辨識的機(jī)器學(xué)習(xí)算...
Scaler IP仿真時，所有的輸出數(shù)據(jù)都是0是怎么回事？
最近一個客戶使用Vivado里面的ScalerIP做設(shè)計，碰到了一個奇怪的問題。過程是這樣的，為了盡快熟悉scalerIP的用法，他在vivado里面搭建了一個最基本的仿真環(huán)境，scalerIP被配置成1:1的放大模式，固...
一個內(nèi)嵌FPGA硬件加速器的低價語音識別平臺
背景： 與機(jī)器進(jìn)行語言交談，讓它聽明白你在說什么，語音識別技術(shù)將人類這一曾經(jīng)的夢想變成了現(xiàn)實。...
ISE約束導(dǎo)入vivado總共分幾步
最近有些朋友在ISE中做的V7項目需要切換到vivado來，但導(dǎo)入代碼后，導(dǎo)入約束時，發(fā)現(xiàn)vivado不再支持UCF文件，如果手抄UCF約束到 VIVADO 的 XDC 約束，不僅浪費時間，而且容易出錯，這里介紹一種方...
零中頻架構(gòu)在無線電設(shè)計中的優(yōu)勢
零中頻(ZIF) 架構(gòu)自無線電初期即已出現(xiàn)。...
2017-03-23 標(biāo)簽：工程師無線電零中頻零中頻架構(gòu) 10161
基于MicroZed的五軸自動化機(jī)械臂Dexter
想必大家都對“鋼鐵俠（電影）”中Tony Stark在MIT學(xué)院制作的兩個機(jī)械臂很感興趣，它們分別叫dummy和butterfinget，dummy什么都能干，泡咖啡、收拾垃圾等，而butterfinget甚至一邊幫Tony Stark更換胸部的...
如何在Zynq 7000平臺上使用Linux spidev.c驅(qū)動
在上一篇博客中，介紹了如何配置Vivado下的硬件工程、例化SPI硬件接口和如何使用petalinux加載Xilinx提供的SPI總線驅(qū)動，如果要通過SPI控制外部器件，還需要添加SPI的設(shè)備驅(qū)動以實現(xiàn)SPI的對外控制...
創(chuàng)建ZYNQ處理器設(shè)計和Logic Analyzer的使用
我們的目的是創(chuàng)建一個Zynq Soc處理器設(shè)計，并用Logic Analyzer來調(diào)試我們感興趣的信號。...
2017-03-21 標(biāo)簽：ZynqVivadoLogic Analyzer 1544
合理使用JTAG和IMPACT幫助你調(diào)試FPGA不能啟動的問題
本來想著把GTX后面兩篇博文找時間寫了，但是最近實在是忙，一直在搭圖像處理的AXI框架和整FPGA-DSP雙平臺的板子，下面先和大家分享一下調(diào)試心得。...
關(guān)于高阻態(tài)和OOC（out of context）綜合方式
Xilinx Vivado工具支持僅將系統(tǒng)設(shè)計的一部分進(jìn)行綜合，即OOC（out of context）綜合方式。OOC綜合方式的流程就是將設(shè)計的某個模塊單獨完成綜合操作，這會帶來如下可能性...
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