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FPGA/ASIC技術(shù)
電子發(fā)燒友本欄目為FPGA/ASIC技術(shù)專欄，內(nèi)容有fpga培圳資料、FPGA開發(fā)板、FPGA CPLD知識(shí)以及FPGA/ASIC技術(shù)的其它應(yīng)用等；是您學(xué)習(xí)FPGA/ASIC技術(shù)的好欄目。
zedboard的linux的交叉編譯環(huán)境的建立
要開發(fā)ZedBoard最重要的是Xilinx ISE工具集，在這個(gè)IDE里能夠完成大部分的邏輯及底層軟件開發(fā)工作。...
2017-02-10 標(biāo)簽：LinuxZedboard交叉編譯環(huán)境 1390
如果是的話，取代它的將會(huì)是什么？
SemiWiki的Eric Esteve剛剛發(fā)表一篇博客，標(biāo)題為 “再見，DDRn協(xié)議”。博客中Esteve承認(rèn)這份博客將引起轟動(dòng)，且聲稱 “ 今后數(shù)年主流機(jī)器極有可能都將使用DDR4。...
“軟”定義規(guī)范環(huán)境（SDNet）擴(kuò)展至數(shù)據(jù)層實(shí)現(xiàn)高速SDN
一個(gè)月前Xilinx 新興技術(shù)研究會(huì)上，斯坦福大學(xué)計(jì)算機(jī)科學(xué)系教授Nick McKeown教授說“未來的SDN芯片看起來將類似FPGA或某種可以在FPGA上構(gòu)建的器件。...
一個(gè)FPGA中現(xiàn)在可集成多少32位RISC處理器？
Jan Gray是在FPGA中集成32位RISC處理器的專家，他寫了一篇博客叫作FPGA CPU 新聞，副標(biāo)題為 “使用FPGA開發(fā)并行計(jì)算機(jī)體系架構(gòu)”。...
IIoT風(fēng)潮興 開放式軟硬件設(shè)計(jì)平臺(tái)身價(jià)漲
工業(yè)物聯(lián)網(wǎng)(IIoT)應(yīng)用商機(jī)蓬勃。包含空氣污染、食品安全、智慧交通、遠(yuǎn)程醫(yī)療、信息化教育、智能工廠等領(lǐng)域都可透過物聯(lián)網(wǎng)的布建，達(dá)到降低能耗/營(yíng)運(yùn)成本、提升操作效率等目標(biāo)，因此工...
2017-02-10 標(biāo)簽：工業(yè)物聯(lián)網(wǎng)IIoT 920
SDAccel突破編程局限 實(shí)現(xiàn)FPGA應(yīng)用加速
近年來，云計(jì)算和大數(shù)據(jù)應(yīng)用呈爆發(fā)式增長(zhǎng),在推動(dòng)數(shù)據(jù)中心產(chǎn)業(yè)升級(jí)的同時(shí)，也為數(shù)據(jù)中心的應(yīng)用開發(fā)與運(yùn)行維護(hù)帶來了一系列問題。...
搶攻數(shù)據(jù)中心 賽靈思發(fā)布OpenCL開發(fā)工具
賽靈思(Xilinx)推出首款支持OpenCL的開發(fā)工具?，F(xiàn)場(chǎng)可編程門陣列(FPGA)廠商正積極推出可支持OpenCL設(shè)計(jì)工具的新一代解決方案，期能協(xié)助FPGA深入到主流異質(zhì)架構(gòu)運(yùn)算領(lǐng)域，并加速軟件定義數(shù)據(jù)中心...
ZedBoard上的點(diǎn)燈簽名實(shí)驗(yàn)（六）驅(qū)動(dòng)開機(jī)自啟動(dòng)及OLED簽名
寫好了驅(qū)動(dòng)，也就是留好了API的接口，接下來就可以在應(yīng)用層面上調(diào)用API接口，從而實(shí)現(xiàn)對(duì)LED的操作了。為此我們要做一個(gè)準(zhǔn)備工作，我們希望驅(qū)動(dòng)開機(jī)自動(dòng)加載，省去手動(dòng)執(zhí)行insmod命令，從而...
2017-02-10 標(biāo)簽：OLEDZedboard開機(jī)自啟動(dòng) 1453
使用Vivado HLS創(chuàng)建一個(gè)EDK PCore
由于Zedboard是ARM+FGPA的架構(gòu)，所以在使用的時(shí)候經(jīng)常會(huì)涉及到關(guān)于FPGA設(shè)計(jì)方面的知識(shí)，對(duì)于像我這樣對(duì)FPGA一竅不通的人來說，這是一個(gè)不可逾越的障礙(至少目前是)。...
2017-02-09 標(biāo)簽：FPGAVivado HLSEDK PCore 2110
從ISE啟動(dòng)ModelSim時(shí)遇到的問題及解決辦法
從Windows的Start Menu開始，Xilinx ISE Design Suite 13.4 —〉EDK —〉Tools —〉Compile Simulation Libraries...
zynq使用自帶外設(shè)IP讓ARM PS訪問FPGA（八）
參考超群天晴的博客 ，使用XPS為PS 處理系統(tǒng) 添加額外的IP。從IP Catalog 標(biāo)簽添加GPIO，并與ZedBoard板子上的8個(gè)LED燈相連。當(dāng)系統(tǒng)建立完后，產(chǎn)生bitstream，并對(duì)外設(shè)進(jìn)行測(cè)試。以后還有一個(gè)很重要...
此通用電路可以實(shí)現(xiàn)任意奇數(shù)分頻電路
最近正在準(zhǔn)備找工作，由于是做FPGA開發(fā)，所以verilog實(shí)現(xiàn)技術(shù)分頻電路是一道經(jīng)常出現(xiàn)的題目，三分頻，五分頻電路等等；經(jīng)過一下午時(shí)間總結(jié)出了一個(gè)通用電路，可以實(shí)現(xiàn)任意奇數(shù)分頻電路。...
輕松實(shí)現(xiàn)PL“打包”PS的功能
因?yàn)镸icroZed是個(gè)低成本的開發(fā)套件，所以在板子上除了給PS（33.3333 MHz）、DDR、SPI FLASH、microSD卡接口和USB提供時(shí)鐘信號(hào)外，并沒有為PL部分提供單獨(dú)的晶振。...
2017-02-09 標(biāo)簽：PS時(shí)鐘信號(hào)MicroZed 5127
如何單獨(dú)打開Xilinx SDK項(xiàng)目工程
.PPR文件是PLANAHEAD的工程文件，在WINDOWS下面可以直接雙擊打開，PROJECT.cache PROJECT.data是項(xiàng)目產(chǎn)生的臨時(shí)文檔，可以不用管。...
Digilent公司發(fā)布新款FPGA開發(fā)板
Digilent公司宣布了新款FPGA開發(fā)板，歸屬于其Nexys產(chǎn)品線——Nexys4——板上集成一個(gè)賽靈思Artix-7100T FPGA。...
基于新400Gbps CDFP2.0規(guī)范的模塊
通過將100Mbps的CFP4光模塊替換到基于新400Gbps CDFP2.0規(guī)范的模塊，您將能夠?qū)?U前面板網(wǎng)絡(luò)程控交換機(jī)的帶寬從1.6Tbps提升到4.4Tbps。這種新的規(guī)范，今天剛由CDFP多源協(xié)議（MSA）公布——定義了使用...
基于FPGA開放流程的SDN轉(zhuǎn)發(fā)引擎
博主Greg Ferro在其Ethereal Mind網(wǎng)頁(yè)上發(fā)布了一則關(guān)于 Corsa Technology簡(jiǎn)短博客信息，提到Corsa公司制作了一對(duì)基于FPGA開放流程的SDN轉(zhuǎn)發(fā)引擎。Ferro同時(shí)簡(jiǎn)單討論了此引擎是否適用于WANs網(wǎng)絡(luò)。...
ADI發(fā)布的AD9625器件可以幫你解決這一問題
直接采樣RF信號(hào)需要很高的速度，ADI發(fā)布的AD9625器件可以幫你解決這一問題，因?yàn)樵撈骷С忠粋€(gè)JESD204B接口，它的采樣速率可以達(dá)到2Gsamples/sec，它可以和Xilinx All Programmable器件的JESD204 LogiCORE...
兩款開發(fā)板卡開啟您先進(jìn)的全新的系統(tǒng)設(shè)計(jì)
盡管它是KintexUltraScale FPGA系列芯片中體積排名第二小的成員，但是這款20nm KintexUltraScale KU040 FPGA提供系統(tǒng)設(shè)計(jì)者更多的片上資源，在比較注重功耗的7系列產(chǎn)品系列中，這款新型的FPGA芯片比大部...
OKI IDS和Xylon成為合作伙伴進(jìn)軍日本的ADAS
兩大賽靈思聯(lián)盟成員，OKI IDS和Xylon成為合作伙伴進(jìn)軍日本的ADAS（先進(jìn)型驅(qū)動(dòng)輔助系統(tǒng)）市場(chǎng)。 Xylon的 logicBRICKS IP核庫(kù)包括眾多優(yōu)化過的圖形和視頻處理IP塊，用于賽靈思All Programmable器件，并在...
TECH:基于FPGA的高速以太網(wǎng)適配器卡必備的PCIe Gen3技術(shù)
INVEA-TECH公司制作了基于FPGA的硬件加速以太網(wǎng)接口卡（HANICs）。本周，該公司在加利福尼亞圣克拉拉以太網(wǎng)技術(shù)峰會(huì)上展示了兩款高速以太網(wǎng)適配器卡—COMBO 80G和最近發(fā)布的COMBO 100G，它們都著重...
Xilinx FPGA普通IO作PLL時(shí)鐘輸入
普通IO可以通過BUFG再連到PLL的時(shí)鐘輸入上,但要修改PLL的設(shè)置 input clk的選項(xiàng)中要選擇"No Buffer";...
骨灰級(jí)音響發(fā)燒友如何打造隨身DAC兼耳擴(kuò)？
Chord電子產(chǎn)品Hugo，一種專為骨灰級(jí)音響發(fā)燒友打造的電池供電的隨身DAC兼耳擴(kuò)，使用賽靈思 Spartan-6 FPGA.(使用了1/2的單元)實(shí)現(xiàn)了一個(gè)32位、26K抽頭的WTA插值濾波器，為音樂愛好者創(chuàng)建了通往音樂...
ADI章新明：軟件定義無線電助推RF器件層面革新
在近日舉行的“易維訊第四屆年度ICT媒體論壇”上，ADI公司技術(shù)大拿、高級(jí)客戶應(yīng)用經(jīng)理章新明發(fā)表演講，縱論了軟件定義無線電技術(shù)（SDR）在RF器件層面的創(chuàng)新應(yīng)用。...
賽靈思攜手BEEcube推出全球首款毫米波原型設(shè)計(jì)平臺(tái)解決方案
致力于支持5G應(yīng)用創(chuàng)新開發(fā)，集成在BEEcube BEE7基帶平臺(tái)上的賽靈思256QAM毫米波調(diào)制解調(diào)器IP為寬帶回程原型設(shè)計(jì)提供完整的開箱即用型解決方案...
用現(xiàn)有的Cat 5e/6傳輸設(shè)備將數(shù)據(jù)中心帶寬和吞吐量提高5倍？
將1Gbps以太網(wǎng)線纜提高到2.5或者5Gbps承諾的數(shù)據(jù)中心帶寬效率和吞吐量，并在低成本投入下實(shí)現(xiàn)高帶寬， 這就是新NBASE-T Alliance的目的，這剛由創(chuàng)世成員思科、Aquantia、飛思卡爾和賽靈思宣布。...
FMC板擴(kuò)展了基于Zynq的Avnet ZedBoard的網(wǎng)絡(luò)性能
來自O(shè)psero ElectronicDesign的以太網(wǎng)FMC卡接入基于 Zynq的 Avnet ZedBoard的LPC（低引腳數(shù)）FMC連接器，在板子的外設(shè)上添加了4個(gè)千兆以太網(wǎng)端口。板子本身有4個(gè)Marvell 88E1510千兆以太網(wǎng)PHY和帶有集成磁件的...
使用FPGA，NPU或者多核處理器來實(shí)現(xiàn)高性能包處理？
作者：Steve Leibson, 賽靈思戰(zhàn)略營(yíng)銷與業(yè)務(wù)規(guī)劃總監(jiān) 你想對(duì)FPGA、NPU和多核CPU在包處理中的優(yōu)缺點(diǎn)有個(gè)清晰認(rèn)識(shí)嗎？在圣克拉拉的Linley Processor Conference 2014上賽靈思的AtulShinde發(fā)表了為最佳載體以太...
2017-02-09 標(biāo)簽： 873
2400 PHY同時(shí)又能確保FPGA需要的I/O靈活性？
來自賽靈思的Adrian Cosoroaba和Terry Magee在圣克拉拉會(huì)議中心的Memcon中發(fā)表了關(guān)于高性能DDR4接口和FPGA靈活性的主題演講。賽靈思首席工程師Magee，設(shè)計(jì)了用于新賽靈思UltraScale All Programmable FPGA的DD...
2017-02-09 標(biāo)簽： 424
啟動(dòng)流程分析及各環(huán)節(jié)文件生成流程(ZedBoard為例)
1. ZYNQ的啟動(dòng)流程 Zynq7000就如同他的名字一樣，Zynq-7000 Extensible Processing Platform，是一個(gè)可擴(kuò)展處理平臺(tái)，簡(jiǎn)單說就是有個(gè)FPGA做外設(shè)的A9雙核處理器。 所以，它的啟動(dòng)流程自然也和FPGA完全不同，...
2017-02-09 標(biāo)簽： 1767
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