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FPGA/ASIC技術(shù)
電子發(fā)燒友本欄目為FPGA/ASIC技術(shù)專欄，內(nèi)容有fpga培圳資料、FPGA開發(fā)板、FPGA CPLD知識以及FPGA/ASIC技術(shù)的其它應(yīng)用等；是您學習FPGA/ASIC技術(shù)的好欄目。
ZedBoard學習手記（九） 在ZedBoard上運行QT圖形軟件
在Zynq平臺上運行QT其實與PC無異，都需要相應(yīng)的執(zhí)行環(huán)境，只不過PC上的QT Lib可以使用QT SDK自動安裝配置，而Zynq平臺上的QT Lib則需要手動安裝。...
ZedBoard學習手記（八） 更大的目標！
在Linux下做GUI，比較簡單的方法是使用QT。QT一直被用于跨平臺的應(yīng)用程序開發(fā)，之前屬于Nokia，現(xiàn)在被賣給了Digia，開源版本的主頁是。...
按鍵消抖的原理和基于verilog的消抖設(shè)計
按鍵開關(guān)是各種電子設(shè)備不可或缺的人機接口。在實際應(yīng)用中，很大一部分的按鍵是機械按鍵。在機械按鍵的觸點閉合和斷開時，都會產(chǎn)生抖動，為了保證系統(tǒng)能正確識別按鍵的開關(guān)，就必須對...
2017-02-11 標簽：Verilog 23754
一步一步學ZedBoard Zynq(四)：基于AXI Lite 總線的從設(shè)備IP設(shè)計
本小節(jié)通過使用XPS中的定制IP向?qū)?ipwiz)，為已經(jīng)存在的ARM PS 系統(tǒng)添加用戶自定IP(Custom IP )，了解AXI Lite IP基本結(jié)構(gòu)，并掌握AXI Lite IP的定制方法，為后續(xù)編寫復雜AXI IP打下基礎(chǔ)。...
一步一步學ZedBoard Zynq(三)：使用自帶外設(shè)IP讓ARM PS訪問FPGA
這一節(jié)的目的是使用XPS為ARM PS?處理系統(tǒng)?添加額外的IP。從IP Catalog 標簽添加GPIO，并與ZedBoard板子上的8個LED燈相連。當系統(tǒng)建立完后，產(chǎn)生bitstream，并對外設(shè)進行測試。...
一步一步學ZedBoard Zynq(二)：使用PL做流水燈
《一步一步學ZedBoard & Zynq》系列第二篇，目的是為了學習不使用ARM PS情況下，只對Zynq PL的編程方法，同時學習Xilinx?PlanAhead工具的使用方法?...
開啟400G以太網(wǎng)：Spirent 400G以太網(wǎng)測試系統(tǒng)
在法國尼斯舉行的2014WDM和下一代光纖網(wǎng)絡(luò)研討會上，思博倫通信 和 賽靈思公司討論了通過Spirent 400G以太網(wǎng)測試系統(tǒng)對華為NE5000E以太網(wǎng)核心路由成功測試的完成情...
Kevin學ZED之（5）：順藤摸瓜
當你可以修改點亮LED燈那個實驗led_test.sh, 改變LED點燈的速度,以及順序時, 一定想知道究竟發(fā)生了什么, 憑什么一個簡單的腳本, 就在Linux的用戶層控制板子上的某一個硬件,比如說,燈。...
Kevin學ZED之3：知一點點所以然
嵌入式系統(tǒng)軟硬件協(xié)同設(shè)計實戰(zhàn)指南-基于Xilinx ZYNQ>的實驗1.2 , 是一個很酷的實驗, 照貓畫虎一番,居然ZED板就能當一個能跑Ubuntu的小電腦使, 更酷的是, 只是運行腳本, 居然就可以控制板子上的L...
2017-02-10 標簽：led嵌入式系統(tǒng)ZED 1483
System Generator實現(xiàn)串口通信（一行HDL代碼都不用寫）
一直都在System Generator下做圖像處理相關(guān)的算法，感覺SysGen挺強大的，前幾天突發(fā)奇想，能否直接用SysGen實現(xiàn)數(shù)據(jù)的通信呢，畢竟一句HDL代碼都不寫對于做FPGA的人來說卻是很有吸引力的。...
2017-02-10 標簽：HDL串口通信System Generator 3485
Transceiver對電源文波噪聲的要求
XILINX在Transceiver用戶手冊里提出了對模擬電源的文波噪聲要求：10mV p-p 10kHz~80Mhz。大多數(shù)客戶一看到該指標要求的第一反應(yīng)是——我做不到，XILINX的Transceiver不好，對電源要求太嚴了!...
2017-02-10 標簽：Xilinxtransceiver電源文波 2702
Kevin學ZED之2：磨刀不誤砍柴功
在 高效能人士的七個習慣 中, 最后一條是 Sharpen the saw , 一般翻譯成:不斷更新, 看了以后就不知所云了....
運行于Zynq SoC上μITRON（操作系統(tǒng)）的繼任者：eT
eT-Kernel是由eSOL公司推出的基于T-Engine的操作系統(tǒng)，有望成為?ITRON操作系統(tǒng)的繼任者，可在Zynq SoC上運行。...
裸機下運行Hello,World【常見錯誤解決方案】
開發(fā)環(huán)境：Win7-64bit + ISE 14.4 器件：Zedboard 硬件搭建圖...
PS2鍵盤接口設(shè)計之二（實現(xiàn)了從鍵盤輸入并顯示在LCD液晶屏上）
在熟悉了PS2鍵盤接口設(shè)計之后，我想大家都希望將輸入的數(shù)據(jù)在顯示屏中實時的顯示出來或者看看我們到底輸入的是什么樣的東西，基于這個原因，結(jié)合Spartan-3E開發(fā)板上的資源，我利用了液晶...
從零開始構(gòu)建Linux環(huán)境（詳細步驟）
剛從師兄那里拿過來板子，便迫不及待的開始了Zedboard的學習之旅。說實話，從剛開始報名參加這個比賽，便對開發(fā)板是欣羨不已，只可惜沒機會仔細研究，現(xiàn)在拿到手了，雖然說好的捐贈并沒...
基于zed的tesseract移植過程記錄
于是今天就打算把這個軟件移植到Zynq上，在PC上之前就已經(jīng)成功安裝了tesseract了，并且利用自帶的測試圖片試了下，沒問題。...
FPGA專家教您如何在FPGA設(shè)計中使用HLS
Luke Miller并非一開始就是HLS（高層次綜合）的倡導者。在使用早期的工具版本的時候，他似乎有過一些糟糕的經(jīng)歷。...
2017-02-10 標簽：FPGAFPGA設(shè)計HLS 3997
制作ZedBoard上linux根文件系統(tǒng)(ramdisk)
Digilent的OOB設(shè)計給出了一個ZedBoard上完整的運行的linux系統(tǒng)所需要的所有文件，包括配置FPGA的bit文件、 配置ARM PS系統(tǒng)的First-Stage boot loader(FSBL)和引導linux需要的Second-Stage boot loader(SSBL)、Linux內(nèi)核...
Kevin學ZED之7：交叉編譯初探
在Kevin學ZED之6:指鹿為馬中, 我們明確了學習方法, 也就是試圖修改一點點軟件的源代碼,找到那個寫LED0,LED1的地址那句話, 然后換一下它們的地址或命令字,然后重新編譯源代碼, 使得最終我們點亮...
參考時鐘對SERDES性能的影響
我們知道，SERDES對參考時鐘有嚴格的相位噪聲性能要求。通常，SERDES供應(yīng)商會根據(jù)其SERDES采用的PLL以及CDR架構(gòu)特點，以及性能數(shù)據(jù)，提出對參考時鐘的相位噪聲的具體要求。...
HASS試驗對CDR的PPM容忍度要求
我們知道，對于PI-base CDR(XILINX 的5、6、7系列SERDES的CDR采用的共同架構(gòu))，CDR的不同配置，代表作不同的CDR帶寬、所能處理數(shù)據(jù)PPM偏差的能力，也就是跟蹤輸入數(shù)據(jù)相位變化的能力。...
Zedboard學習（七）PS下第一個裸奔程序
一路默認，只有Board項需要選擇ZedBoard Zynq Evaluation and Development Kit...
基于賽靈思Kintex-7 FPGA設(shè)計或硬件原型的快速部署方法
PLDA集團的990美元XpressK7 PCIe板卡，為系統(tǒng)設(shè)計師提供了一個基于賽靈思Kintex-7 FPGA設(shè)計或硬件原型的快速部署方法。這個主板支持1代、2代和3代PCIe，同時帶有一個端點卡緣連接器，可以支持多達...
2017-02-10 標簽：FPGAFPGA設(shè)計賽靈思PLDA 2753
基于賽靈思FPGA的低成本MIPI接口IP
基于FPGA的低成本MIPI接口，專門針對視頻顯示器和攝像頭的。設(shè)計嵌入式系統(tǒng)DSI和CSI-2視頻接口的用戶現(xiàn)在即可采用低成本MIPI接口...
Maxim為三款Xilinx FPGA參考設(shè)計提供電源管理方案
Maxim Integrated Products, Inc. (NASDAQ: MXIM)宣布成為Xilinx UltraScale FPGA電源方案的主要供應(yīng)商，Maxim為三款Xilinx FPGA參考設(shè)計提供電源管理方案。X-Fest 2014展會期間，系統(tǒng)設(shè)計人員可通過Xilinx Kintex UltraSc...
深度學習算法有望在FPGA和超級計算機上運行
由NSF資助的一個研究項目，目前正在研究如何使用RDMA高性能連接器將深度學習算法在FPGA和跨系統(tǒng)之間運行；另一個由Andrew Ng和兩個超算專家牽頭的項目，則希望把模型放在超級計算機上，給它...
Zedboard甲診opencv圖像處理（二）
通過前面的努力已經(jīng)得到了n個輪廓了，現(xiàn)在要把最終的輪廓確定下來 ，然后進行特征提取。...
Zedboard甲診opencv圖像處理（一）
首先基于前面的工作，通過調(diào)整已經(jīng)很好的把指甲邊緣顯示出來了，不曾想我卻從那時開始走上了彎路，使用matlab去處理靜態(tài)圖片，以獲得更好的指甲和特征提取效果，結(jié)果就是，效果不理想（...
Xilinx 7系列FPGA使用之CLB探索（一）
7系列FPGA是Xilinx新推出的基于28nm工藝的FPGA，其中包含三個系列：Artix、Kintex和Virtex。因項目要使用kintex7為平臺做設(shè)計，需要對其內(nèi)部結(jié)構(gòu)做了研究，首先從CLB（Configurable Logic Block）開始...
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