可編程邏輯
提供權(quán)威的PLD及可編程邏輯器件設(shè)計應(yīng)用、Altera公司、Xilinx公司資訊和解決方案，包括HDL語言與源代碼、FPGA開發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。
基于FPGA的分布式視頻處理平臺設(shè)計方案
目前人們對于高清視頻的需求日益普遍，極致的視覺體驗帶來的是技術(shù)上的革新，...
2024-04-15 標(biāo)簽：FPGADDR3PCB設(shè)計CORTEX-A9PCIe接口 4037
CAM在FPGA上的最優(yōu)化實現(xiàn)方案
我們都知道RAM是根據(jù)地址查找對應(yīng)的數(shù)據(jù)，而對于CAM，則恰好相反，是已知數(shù)據(jù)查找其對應(yīng)的地址。像在網(wǎng)絡(luò)報文處理里，根據(jù)報文的五元組的一些信息去查詢其所屬的規(guī)則地址，隨后通過該地...
FPGA在駕駛輔助系統(tǒng)中的關(guān)鍵作用
發(fā)動機控制幾乎從未被認(rèn)為是獲得更好燃油經(jīng)濟性的一種方式。但在燃油價格不斷上漲的今天，電子技術(shù)可以非常有效地提高燃油經(jīng)濟性。...
2024-04-15 標(biāo)簽：FPGA發(fā)動機通信系統(tǒng)ecu發(fā)動機控制 943
易靈思Jtag_bridge_loader生成-v2
Efinity版本：2023.1及以前版本。 易靈思器通過jtag bridge燒寫flash時需要自己生成一個jtage birdge文件。jtage bridge 工程的目的是為了打通JTAG與flash的連接。 ? （1）打開IPM (2)選擇Memory Controllers -->?J...
gtkwave界面每次都更新太麻煩？來個小技巧-v1
迄今為止，大家都在吐槽gtkwave debug每次彈窗都會覆蓋上一次彈窗設(shè)置好的排序和參數(shù)。下面我們分享一個可以暫時規(guī)避該問題的方法，聊以慰藉久被摧殘的心~~。 （1）添加debug ,無論手動或者自...
FPGA 原型設(shè)計開發(fā)復(fù)雜性策略
FPGA 被封裝在更大的封裝中，從而提供了更多的 I/O。"然而，I/O 的增加并不像邏輯資源那樣引人注目。...
2024-04-11 標(biāo)簽：FPGAasicsocHDL機器學(xué)習(xí) 842
FPGA助力簡化電源設(shè)計
科通技術(shù)了解到AnDAPT電源解決方案的目標(biāo)市場是電源軌數(shù)量較多的市場，因此需要電源管理功能，并通過AnDAPT產(chǎn)品線幫助AMD產(chǎn)品線的客戶簡化電源設(shè)計。...
基于FPGA加速的bird-oid object算法實現(xiàn)
Bird-oid object 簡稱Boids模型，是美國的一個圖形計算機科學(xué)家Craig Reynolds在 1986 年開發(fā)出來的。...
基于FPGA加速的熱擴散模擬器
這個項目的目標(biāo)是創(chuàng)建一個交互式的熱擴散模擬器，它使用離散域上的熱方程，允許用戶在VGA屏幕上選擇熱源和熱匯，并在VGA屏幕上實時模擬出隨之產(chǎn)生的反應(yīng)。...
基于FPGA的TLC5620數(shù)模轉(zhuǎn)換（DA）設(shè)計
本設(shè)計采用串行數(shù)/模轉(zhuǎn)換芯片TLC5620，TLC5620是一個擁有四路輸出的數(shù)/模轉(zhuǎn)換器，時鐘頻率最大可達(dá)到1MHz。...
2024-04-08 標(biāo)簽：FPGA運算放大器數(shù)模轉(zhuǎn)換器數(shù)模轉(zhuǎn)換基準(zhǔn)電源 2684
FPGA為什么比GPU的延遲低這么多？
FPGA 正是一種硬件可重構(gòu)的體系結(jié)構(gòu)。它的英文全稱是Field Programmable Gate Array，中文名是現(xiàn)場可編程門陣列。 FPGA常年來被用作專用芯片（ASIC）的小批量替代品，然而近年來在微軟、百度等公...
2024-04-08 標(biāo)簽：cpugpu圖像處理交換機機器學(xué)習(xí) 1490
基于FPGA的網(wǎng)絡(luò)加速設(shè)計實現(xiàn)
首先是FPGA硬件的變化太多，各個模塊可配參數(shù)的變化（比如卷積模塊并行數(shù)的變化），另外一個是網(wǎng)絡(luò)模型多種多樣以及開源的網(wǎng)絡(luò)模型平臺也很多（tensorflow，pytorch等）。網(wǎng)絡(luò)壓縮也有很多種...
2024-04-08 標(biāo)簽：FPGA神經(jīng)網(wǎng)絡(luò)算力 2257
基于FPGA進(jìn)行DNN設(shè)計的經(jīng)驗總結(jié)
DNN中應(yīng)用最廣泛的是CNN和RNN，CNN是一種卷積網(wǎng)絡(luò)，在圖片識別分類中用的較多，RNN可以處理時間序列的信息，比如視頻識別和語音識別。...
2024-04-07 標(biāo)簽：FPGAcpu神經(jīng)網(wǎng)絡(luò)機器學(xué)習(xí)dnn 1292
深入探索Vivado非工程模式FPGA設(shè)計流程
在設(shè)計過程的每個階段，設(shè)計者均可以打開Vivado集成開發(fā)環(huán)境，對存儲器中保存的當(dāng)前設(shè)計進(jìn)行分析和操作。...
2024-04-03 標(biāo)簽：FPGA數(shù)據(jù)庫Vivado 2155
詳解Vivado非工程模式的精細(xì)設(shè)計過程
將設(shè)置設(shè)計的輸出路徑，設(shè)置設(shè)計輸出路徑的步驟如下所示。 第一步：如圖4.3所示，在“Vivado%”提示符后輸入命令“set outputDir ./gate_Created_Data/top_output”。...
2024-04-03 標(biāo)簽：XilinxWINDOWS操作系統(tǒng)Vivado 3435
FPGA學(xué)習(xí)-以太網(wǎng)的原理介紹
在以太網(wǎng)鏈路上的數(shù)據(jù)包稱作以太網(wǎng)幀。以太網(wǎng)幀起始部分由前導(dǎo)碼和幀開始符組成。后面緊跟著一個以太網(wǎng)報頭，以MAC地址說明目的地址和源地址。...
2024-04-02 標(biāo)簽：FPGA以太網(wǎng)FCSARP協(xié)議串口傳輸 3023
?淺析片上網(wǎng)絡(luò)（NoC）技術(shù)的發(fā)展及其給高端FPGA帶來的優(yōu)勢
在摩爾定律的推動下，集成電路工藝取得了高速發(fā)展，單位面積上的晶體管數(shù)量不斷增加。...
2024-04-02 標(biāo)簽：FPGA摩爾定律數(shù)據(jù)傳輸AMBA總線晶體管 3552
FPGA設(shè)計中SPI的參數(shù)化結(jié)構(gòu)設(shè)計方法
為了避免每次SPI驅(qū)動重寫，直接參數(shù)化，盡量一勞永逸。SPI master有啥用呢，你發(fā)現(xiàn)各種外圍芯片的配置一般都是通過SPI配置的，只不過有三線和四線。...
國產(chǎn)FPGA應(yīng)用專題--易靈思Efinity軟件使用心得
做為FPGA的集成開發(fā)環(huán)境，不同的廠家其實大同小異。很多國產(chǎn)廠家，如安路，高云，會在軟件上貼近Xilinx和Intel，以節(jié)省客戶的軟件使用成本。而國產(chǎn)廠商的易靈思的集成開發(fā)環(huán)境Efinity似乎并...
2024-04-23 標(biāo)簽：FPGA國產(chǎn)FPGA易靈思 4055
FPGA布局布線優(yōu)化策略（五）
對設(shè)計者很通常的情況是花費幾天或幾周的時間圍繞一個設(shè)計來滿足時序，甚至多半利用上面描述的自動種子變化，只面對可以起伏通過已有布局的小改變和時序特性完全改變。...
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