可編程邏輯
提供權(quán)威的PLD及可編程邏輯器件設(shè)計應(yīng)用、Altera公司、Xilinx公司資訊和解決方案，包括HDL語言與源代碼、FPGA開發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。
FPGA芯片EP2S90F1508C3實(shí)現(xiàn)SM3算法的硬件實(shí)現(xiàn)策略
本文采用Altera公司Stratix II系列的EP2S90F1508C3芯片，以Quartus II 8.1為開發(fā)環(huán)境[4]，采用硬件描述語言VHDL進(jìn)行SM3算法的FPGA實(shí)現(xiàn)。SM3算法實(shí)現(xiàn)的整體結(jié)構(gòu)可分為庫函數(shù)模塊和主程序模塊兩大模塊[1，...
2017-11-24 標(biāo)簽：FPGAEP2S90F1508C3FPGASM3算法 3188
基于FPGA的SPI串行方式自動發(fā)送技術(shù)設(shè)計
SPI接口應(yīng)用十分廣泛，在很多情況下，人們會用軟件模擬的方法來產(chǎn)生SPI時序或是采用帶SPI功能模塊的MCU。但隨著可編程邏輯技術(shù)的發(fā)展，人們往往需要自己設(shè)計簡單的SPI發(fā)送模塊。本文介紹一...
基于軟件的空間輻照下FPGA可靠性設(shè)計方法
針對空間輻照效應(yīng)影響的高可靠性設(shè)計，將越來越成為FPGA軟硬件設(shè)計的難點(diǎn)和重點(diǎn)。根據(jù)飛行器空間軌道的不同、輻射總劑量的差異，從硬件上，可以通過加厚屏蔽層、元器件加固等方式，盡...
一種基于分布式算法的低通FIR濾波器
分布式算法是一種適合FPGA設(shè)計的乘加運(yùn)算，由于FPGA中硬件乘法器資源有限，直接應(yīng)運(yùn)乘法會消耗大量的資源。本文利用了豐富的存儲器資源進(jìn)行查找表運(yùn)算，設(shè)計了一種基于分布式算法低通...
利用中端FPGA實(shí)現(xiàn)低成本網(wǎng)絡(luò)
從網(wǎng)絡(luò)的核心模塊到邊緣設(shè)備，都在經(jīng)歷著巨大的變革。無線市場與其數(shù)千萬的“永遠(yuǎn)在線”連接、下一代回程通信的巨大傳輸壓力，以及各種為使用現(xiàn)有有線通信基礎(chǔ)設(shè)施的消費(fèi)者提供寬帶通...
基于液晶面板走勢FPGA的腦機(jī)接口實(shí)時系統(tǒng)的分析與實(shí)驗(yàn)
腦機(jī)接口BCI(Brain Computer Interface)是一種新穎的人機(jī)接口方式。它的定義是：不依賴于腦的正常輸出通路(外周神經(jīng)系統(tǒng)及肌肉組織)的腦-機(jī)(計算機(jī)或其他裝置)通訊系統(tǒng)[1]。液晶面板走勢要實(shí)現(xiàn)腦...
2017-11-24 標(biāo)簽：FPGAFPGA腦機(jī)接口系統(tǒng) 1655
基于FPGA三種供電要求方案的分析與實(shí)驗(yàn)結(jié)果對比
目前越來越多的家用電器從低速的撥號上網(wǎng)向?qū)拵Щヂ?lián)網(wǎng)接入或互聯(lián)網(wǎng)協(xié)議電視(IPTV)轉(zhuǎn)移，尤其是IPTV有望在中國獲得快速的發(fā)展。比較而言，IPTV的基礎(chǔ)設(shè)施成本相當(dāng)?shù)?，因?yàn)檫@種方法不需要銅...
基于FPGA用VerilogHDL設(shè)計實(shí)現(xiàn)DDS直接頻率合成的方法
DDS的具體工作過程如圖1所示。N位相位累加器由N位加法器和N位累加寄存器組成。每來一個時鐘脈沖，N位加法器將頻率控制字K與N位累加寄存器輸出的累加相位數(shù)據(jù)相加，并把相加后的結(jié)果送至...
2017-11-24 標(biāo)簽：DDSVerilogHDL 8146
基于Virtex-II ProTM平臺FPGA產(chǎn)品可解決與嵌入式系統(tǒng)設(shè)計相關(guān)的挑戰(zhàn)
設(shè)計嵌入系統(tǒng)的主要挑戰(zhàn)來自于需要同時優(yōu)化眾多設(shè)計因素。這些需要優(yōu)化的設(shè)計因素包括單位成本、NRE（不可回收工程）成本、功率、尺寸、性能、靈活性、原型制造時間、產(chǎn)品上市時間、產(chǎn)...
一種自適應(yīng)數(shù)字傳感器的設(shè)計
高量程加速度傳感器的一般靈敏度在1 mV左右，如果加速度信號在1g～10g的范圍內(nèi)，則傳感器的輸出在1mV～10mV，傳統(tǒng)測試系統(tǒng)的噪聲就可能覆蓋如此小的電壓信號，那么將會無法測到完整的加速...
基于FPGA圖像信號發(fā)生器設(shè)計的原理與實(shí)驗(yàn)結(jié)果分析
在自適應(yīng)光學(xué)系統(tǒng)中，哈特曼波前傳感器檢測到的波前信息通過高速CCD相機(jī)采集輸出，然后由波前處理機(jī)完成斜率計算、波前復(fù)原運(yùn)算和控制運(yùn)算。自適應(yīng)光學(xué)系統(tǒng)研制時，為了縮短研制周期，...
2017-11-24 標(biāo)簽：FPGAFPGA圖像信號發(fā)生器 3951
FPGA集成數(shù)據(jù)緩沖器與分離FIFO
許多年輕的工程師在工作中考慮潛在設(shè)計選項(xiàng)時首先想到可編程邏輯。然而，隨著對可編程邏輯的日益依賴也給教授電路設(shè)計帶來了經(jīng)常被忽略的一些問題，這使許多年輕的工程師在創(chuàng)建系統(tǒng)時...
基于FPGA進(jìn)行控制平面與數(shù)據(jù)平面視頻的詳細(xì)分析與優(yōu)勢
嵌入式設(shè)計人員面臨的最大挑戰(zhàn)之一就是界定系統(tǒng)的性能需求。用以確定實(shí)際性能需求所需的信息要么無法獲取，要么難以獲得。最精確的估算有時也會因無法預(yù)料的計算負(fù)荷而失效。分析通常...
基于FPGA的快速9/7整形離散小波變換系統(tǒng)的設(shè)計過程與仿真
CCSDS圖像數(shù)據(jù)壓縮標(biāo)準(zhǔn)中采用9／7整形離散小波變換為核心算法，該算法結(jié)構(gòu)簡單，易于硬件設(shè)計實(shí)現(xiàn)。文中基于FPGA設(shè)計實(shí)現(xiàn)了9／7整數(shù)離散小波變換系統(tǒng)，設(shè)計中使用內(nèi)部RAM存儲方式，減小了...
采用FPGA設(shè)計科學(xué)級CCD相機(jī)時序發(fā)生器
科學(xué)級CCD相機(jī)一般由高速CCD感光芯片、視頻信號處理器、時序控制器、時序發(fā)生器、時序驅(qū)動器、外部光學(xué)成像系統(tǒng)等部分組成，本文分析了IL-E2型TDI-CCD 芯片的工作過程和對驅(qū)動信號的要求，...
2017-11-24 標(biāo)簽：FPGACCDFPGA設(shè)計時序 2758
利用FPGA 實(shí)現(xiàn)了一種改進(jìn)的M/T法并克服M/T法的不足
增量式碼盤是一種原理簡單，抗干擾能力強(qiáng)，可靠性高，適合于長距離傳輸?shù)奈恢门c速度測量裝置，已成功應(yīng)用于大量的控制系統(tǒng)中，極大地提高了其位置控 制精度。理論上，只要測得碼盤輸...
2017-11-24 標(biāo)簽：FPGA 3484
基于FPGA的千兆以太網(wǎng)及E1信號光纖傳輸系統(tǒng)構(gòu)成的詳細(xì)分析和性能測試
目前，隨著多媒體應(yīng)用的普及，千兆位以太網(wǎng)已經(jīng)發(fā)展成為主流網(wǎng)絡(luò)技術(shù)。大到成千上萬人的大型企業(yè)，小到幾十人的中小型企業(yè)，在建設(shè)企業(yè)局域網(wǎng)時都會把千兆位以太網(wǎng)技術(shù)作為首選的高速...
2017-11-24 標(biāo)簽：千兆以太網(wǎng)E1千兆以太網(wǎng) 7542
基于FPGA用窗函數(shù)法設(shè)計16階線性相位FIR數(shù)字低通濾波器
本文設(shè)計的16階線性相位FIR數(shù)字低通濾波器，利用XC4005EPC84－2芯片實(shí)現(xiàn)時，處理數(shù)據(jù)的系統(tǒng)時鐘頻率為36MHz，采樣速率為4MHz，計算結(jié)果和軟件計算結(jié)果相比最大誤差≤±1。在實(shí)際使用時，還可以...
一種基于FPGA的真隨機(jī)數(shù)發(fā)生器設(shè)計與實(shí)現(xiàn)
本文嘗試了一種用純數(shù)字電路實(shí)現(xiàn)的TRNG結(jié)構(gòu)，且不使用諸如PLL等特殊資源，便于設(shè)計由FPGA驗(yàn)證移植到芯片設(shè)計。其核心思想是使用反相器和延時單元構(gòu)成兩個相互獨(dú)立的振蕩器，由于內(nèi)部噪聲...
采用FPGA實(shí)現(xiàn)多項(xiàng)式運(yùn)算
傳統(tǒng)的DSP都基于CPU結(jié)構(gòu)，是一種基于特定指令系統(tǒng)的處理器，但隨著運(yùn)算時鐘越來越接近電子器件可以接受的極限，這種DSP的處理能力也在接近它的極限。通信系統(tǒng)的仿真與硬件實(shí)現(xiàn)涉及到很多...
DDFS的原理及DDFS的FPGA實(shí)現(xiàn)
本設(shè)計在不向外擴(kuò)展ROM存儲器的情況下，對DDFS設(shè)計執(zhí)行 優(yōu)化，充分運(yùn)用 Cyclone II系列FPGA的片上資源，其輸出正弦信號最高頻率可達(dá)4 MHz以上。只要采用更好的方案執(zhí)行 設(shè)計，使采樣點(diǎn)可以做到...
2017-11-24 標(biāo)簽：ddfs 11044
利用FPGA進(jìn)行交通信號燈控制系統(tǒng)的設(shè)計
隨著社會經(jīng)濟(jì)的高速發(fā)展，由車輛大幅增加而帶來的交通問題日趨嚴(yán)重。因此，作為交通監(jiān)管系統(tǒng)的重要組成部分，交通信號燈在協(xié)調(diào)人、車、路的關(guān)系時發(fā)揮著巨大的作用。利用FPGA進(jìn)行交通...
基于FPGA系統(tǒng)應(yīng)用的供電要求和最新高性能DC/DC穩(wěn)壓器解決方案詳解
隨著FPGA制造工藝尺寸持續(xù)縮小、設(shè)計配置更加靈活，以及采用FPGA的系統(tǒng)的不斷發(fā)展，原來只采用微處理器和ASIC的應(yīng)用現(xiàn)在也可以用FPGA來實(shí) 現(xiàn)了。最近FPGA供應(yīng)商推出的新型可編程器件進(jìn)一步縮...
在FPGA平臺上實(shí)現(xiàn)對DPA攻擊的電路級防護(hù)技術(shù)
近年來，現(xiàn)場可編程門陣列(FPGA)由于其高性能、低價格、高開發(fā)速度、方便的編程方式等特點(diǎn)得到了廣泛的應(yīng)用。但對FPGA進(jìn)行DPA攻擊已經(jīng)成為FPGA應(yīng)用中信息安全的主要威脅之一，受到了廣泛的...
2017-11-24 標(biāo)簽：DPA現(xiàn)場可編程門陣列 3230
AI計算系統(tǒng)選擇FPGA的六大疑惑與解答
FPGA 同時擁有流水線并行和數(shù)據(jù)并行，因此處理任務(wù)時候延遲更低。例如處理一個數(shù)據(jù)包有 10 個步驟，F(xiàn)PGA 可以搭建一個 10 級流水線，流水線的不同級在處理不同的數(shù)據(jù)包，每個數(shù)據(jù)包流經(jīng) 1...
關(guān)于FPGA的嵌入式系統(tǒng)的設(shè)計問題
FPGA是今天許多要求最嚴(yán)苛的嵌入式系統(tǒng)設(shè)計的重要元件。由于FPGA器件的價格大幅下跌，加上為設(shè)計人員帶來的便利性和靈活性，F(xiàn)PGA在競爭激烈的全球市場上嵌入式設(shè)計產(chǎn)品的應(yīng)用中日益增加并...
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