可編程邏輯
提供權(quán)威的PLD及可編程邏輯器件設(shè)計(jì)應(yīng)用、Altera公司、Xilinx公司資訊和解決方案，包括HDL語(yǔ)言與源代碼、FPGA開(kāi)發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。
FPGA零基礎(chǔ)學(xué)習(xí)之TLC5620驅(qū)動(dòng)教程
在FPGA處理完數(shù)字信號(hào)之后，我們有些情況下是需要將數(shù)字信號(hào)轉(zhuǎn)變?yōu)槟M信號(hào)再輸出的。比如音頻信號(hào)在濾波后，需要轉(zhuǎn)換為聲音信號(hào)進(jìn)行輸出。...
2023-08-04 標(biāo)簽：示波器FPGA設(shè)計(jì)鎖存器數(shù)模轉(zhuǎn)換器FPGA設(shè)計(jì)TLC5620數(shù)模轉(zhuǎn)換器示波器鎖存器 1578
神經(jīng)網(wǎng)絡(luò)模型用于解決什么樣的問(wèn)題 神經(jīng)網(wǎng)絡(luò)模型有哪些
神經(jīng)網(wǎng)絡(luò)模型是一種機(jī)器學(xué)習(xí)模型，可以用于解決各種問(wèn)題，尤其是在自然語(yǔ)言處理領(lǐng)域中，應(yīng)用十分廣泛。具體來(lái)說(shuō)，神經(jīng)網(wǎng)絡(luò)模型可以用于以下幾個(gè)方面： 語(yǔ)言模型建模：神經(jīng)網(wǎng)絡(luò)模型可...
2023-08-03 標(biāo)簽：編碼器神經(jīng)網(wǎng)絡(luò)機(jī)器學(xué)習(xí)自然語(yǔ)言機(jī)器學(xué)習(xí)神經(jīng)網(wǎng)絡(luò)神經(jīng)網(wǎng)絡(luò)模型編碼器自然語(yǔ)言 8048
誤碼儀的使用方法 基于FPGA的誤碼儀設(shè)計(jì)案例
誤碼儀（Error Code Monitor）是一種用于檢測(cè)和識(shí)別數(shù)據(jù)傳輸中發(fā)生的錯(cuò)誤的測(cè)試設(shè)備。下面是一般誤碼儀的使用方法： 1. 連接設(shè)備：將誤碼儀與需要進(jìn)行測(cè)試的數(shù)據(jù)傳輸設(shè)備（例如路由器、...
2023-08-03 標(biāo)簽：FPGA寄存器數(shù)據(jù)傳輸FPGA寄存器數(shù)據(jù)傳輸誤碼儀 6566
基于紫光同創(chuàng)FPGA芯片的12G-SDI IP方案
SDI (serial digital interface)，數(shù)字分量串行接口，是由SMPTE (Society of Motion Picture and Television Engineers) 組織制定的一種數(shù)字視頻接口標(biāo)準(zhǔn)，該標(biāo)準(zhǔn)已被廣電，安防等眾多行業(yè)廣泛采用，用于傳輸未壓縮...
2023-08-03 標(biāo)簽：FPGA芯片串行接口SDI紫光同創(chuàng) 3982
薄膜PMUT研究進(jìn)展綜述
據(jù)麥姆斯咨詢報(bào)道，近日，新加坡國(guó)立大學(xué)（National University of Singapore）和新加坡科技研究局（A*STAR）微電子研究所的研究人員組成的團(tuán)隊(duì)在Microsystems & Nanoengineering期刊上發(fā)表了題為“Thin-...
2023-08-03 標(biāo)簽：ASIC技術(shù)TOFASIC技術(shù)TOF聲波傳感器換能器驅(qū)動(dòng)電壓 3387
時(shí)鐘偏移對(duì)時(shí)序收斂有什么影響呢？
FPGA設(shè)計(jì)中的絕大部分電路為同步時(shí)序電路，其基本模型為“寄存器+組合邏輯+寄存器”。同步意味著時(shí)序路徑上的所有寄存器在時(shí)鐘信號(hào)的驅(qū)動(dòng)下步調(diào)一致地運(yùn)作。...
2023-08-03 標(biāo)簽：FPGAFPGA設(shè)計(jì)寄存器時(shí)鐘FPGAFPGA設(shè)計(jì)同步電路寄存器時(shí)鐘時(shí)鐘偏移 2452
Vivado仿真器和代碼覆蓋率簡(jiǎn)析
編寫(xiě) HDL 通常是 FPGA 開(kāi)發(fā)中耗時(shí)最少的部分，最具挑戰(zhàn)性和最耗時(shí)的部分可能是驗(yàn)證。根據(jù)最終應(yīng)用程序，驗(yàn)證可能非常簡(jiǎn)單，也可能非常復(fù)雜，簡(jiǎn)單的話只需對(duì)大多數(shù)功能進(jìn)行檢查或執(zhí)行完全...
2023-08-03 標(biāo)簽：仿真器RTLVivadoHDL語(yǔ)言FPGA開(kāi)發(fā)板HDL語(yǔ)言RTLVivado仿真器 3551
FPGA設(shè)計(jì)攔路虎之亞穩(wěn)態(tài)度決定一切
亞穩(wěn)態(tài)這種現(xiàn)象是不可避免的，哪怕是在同步電路中也有概率出現(xiàn)，所以作為設(shè)計(jì)人員，我們能做的是減少亞穩(wěn)態(tài)發(fā)生的概率。...
2023-08-03 標(biāo)簽：FPGAFPGA設(shè)計(jì)觸發(fā)器同步電路FPGAFPGA設(shè)計(jì)MTBF亞穩(wěn)態(tài)同步電路觸發(fā)器 805
開(kāi)源大數(shù)據(jù)OLAP的演化過(guò)程和最佳實(shí)踐
首先是對(duì) SQL 的支持，比如是否支持 IC SQL，還是會(huì)違背 IC SQL 的語(yǔ)法，有很多自己的 SQL 語(yǔ)法。引申就是有沒(méi)有一些 MySQL 協(xié)議或者是 PG 協(xié)議，直接可以去對(duì)接更好的 BI 工具，能夠較少地去改動(dòng)...
MicroBlaze串口設(shè)計(jì)
本系統(tǒng)中，Basys3的MicroBlaze模塊調(diào)用基于AXI協(xié)議的UART IP核，通過(guò)AXI總線實(shí)現(xiàn)MicroBlaze-UART之間的通信，完成串口打印。...
2023-08-02 標(biāo)簽：FPGA設(shè)計(jì)連接器RTLVivadoFPGA設(shè)計(jì)RTLuart通信Vivado連接器 2592
在大算力芯片領(lǐng)域“彎道超車”的機(jī)會(huì)
關(guān)于“彎道超車”，行業(yè)內(nèi)很多人士對(duì)此嗤之以鼻，他們認(rèn)為：做事情要腳踏實(shí)地，持之以恒，才有可能超越。...
2023-08-02 標(biāo)簽：處理器電動(dòng)車FPGA設(shè)計(jì)加速器DSA 2103
什么是三態(tài)電路？在FPGA上如何使用三態(tài)電路作為IO呢？
一般來(lái)說(shuō)，我們認(rèn)為CMOS數(shù)字電路的輸出的穩(wěn)定狀態(tài)只有2種，就是邏輯0和邏輯1，從模擬信號(hào)量來(lái)說(shuō)，就是0V和VDD。...
2023-08-01 標(biāo)簽：FPGA反相器仿真器CMOS數(shù)字電路FPGANMOS管三態(tài)電路仿真器反相器 6558
FPGA設(shè)計(jì)的10個(gè)實(shí)用技巧
FPGA 設(shè)計(jì)工程師需要對(duì)如何創(chuàng)建系統(tǒng)以及使用行業(yè)軟件和工具有深入的了解。在軟件方面，設(shè)計(jì)工程師必須知道如何建模自己的設(shè)計(jì)，并通過(guò)一系列測(cè)試保證正確的運(yùn)行。業(yè)界有許多這種高級(jí)建...
2023-08-01 標(biāo)簽：FPGAFPGA可編程門(mén)陣列 932
一種基于FPGA實(shí)現(xiàn)的800G信號(hào)處理平臺(tái)設(shè)計(jì)
一種基于FPGA 實(shí)現(xiàn)的800G信號(hào)處理平臺(tái)...
2023-07-31 標(biāo)簽：FPGAFPGA設(shè)計(jì)寄存器信號(hào)處理器虛擬機(jī)FPGAFPGA設(shè)計(jì)信號(hào)處理器寄存器虛擬機(jī)調(diào)控器 856
光子集成電路（PIC）加速未來(lái)光子芯片的開(kāi)發(fā)周期
液晶技術(shù)和MEMS技術(shù)使可重新編程光子集成電路（PIC）成為可能，這些PIC能夠支持多種功能，并顯著加速未來(lái)光子芯片的開(kāi)發(fā)周期。...
2023-07-31 標(biāo)簽：驅(qū)動(dòng)器光信號(hào)MEMS技術(shù)FPGA芯片光子芯片 6460
FPGA設(shè)計(jì)中flash讀寫(xiě)工作原理解析
真實(shí)數(shù)據(jù)是保存在較長(zhǎng)的一行。分析后可以看到較長(zhǎng)行的長(zhǎng)度都是一樣的。具體內(nèi)容是，前端若干位是控制符（包含地址），然后是具體數(shù)據(jù)，之后是校驗(yàn)碼。找到規(guī)律后，就可以直接提取其中...
怎么去設(shè)計(jì)一種基于FPGA的擴(kuò)頻模塊呢？
擴(kuò)頻系統(tǒng)最早可以追溯到20世紀(jì)20年代左右，擴(kuò)頻通信就有了初步的應(yīng)用。但是一直到20世紀(jì)年代中期，擴(kuò)頻系統(tǒng)才真正應(yīng)用和發(fā)展起來(lái)。...
2023-07-31 標(biāo)簽：FPGAFPGA設(shè)計(jì)接收機(jī)存儲(chǔ)FIFO存儲(chǔ)頻譜儀FIFO存儲(chǔ)FPGAFPGA設(shè)計(jì)存儲(chǔ)擴(kuò)頻模塊接收機(jī)頻譜儀 1344
如何將程序?qū)懙絝lash中？
在做在線遠(yuǎn)程升級(jí)的時(shí)候，一般需要兩步：1、將數(shù)據(jù)寫(xiě)到外掛的flash中。2重新啟動(dòng)FPGA配置。...
FPGA時(shí)序Bug分析
Bug的現(xiàn)象是這樣的，假設(shè)我們跑一次test，結(jié)果正確為T(mén)，結(jié)果不正確為F。...
2023-07-30 標(biāo)簽：FPGAFPGA設(shè)計(jì)TCP通信FPGAfpga時(shí)序FPGA設(shè)計(jì)TCP通信 850
FPGA時(shí)序分析-建立時(shí)間和保持時(shí)間裕量都是inf怎么解決呢？
今天有個(gè)小伙伴遇到一個(gè)問(wèn)題，就是在vivado里面綜合后看到的建立時(shí)間和保持時(shí)間裕量都是inf，我們來(lái)看看怎么解決這個(gè)問(wèn)題。...
2023-07-30 標(biāo)簽：FPGAFPGA設(shè)計(jì)寄存器時(shí)序分析CLKVivado 2390
如何實(shí)現(xiàn)基于FPGA Vivado的74系列IP封裝呢？
雙擊桌面圖標(biāo)打開(kāi)Vivado 2017.2，或者選擇開(kāi)始>所有程序>Xilinx Design Tools> Vivado 2017.2>Vivado 2017.2；...
2023-07-30 標(biāo)簽：FPGAFPGA設(shè)計(jì)TCLNAND閃存RTLFPGAFPGA設(shè)計(jì)IP封裝NAND閃存RTLTCL 1496
基于Digilent basys 3開(kāi)發(fā)板的FPGA示波器設(shè)計(jì)
首先，AD模塊對(duì)模擬信號(hào)進(jìn)行采樣，觸發(fā)電路根據(jù)采樣信號(hào)判斷觸發(fā)條件（例如：上升沿觸發(fā)）。滿足觸發(fā)條件后，連續(xù)采樣一定數(shù)量的點(diǎn)（本系統(tǒng)中為640個(gè)點(diǎn)），存儲(chǔ)到RAM中。...
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