可編程邏輯
提供權(quán)威的PLD及可編程邏輯器件設(shè)計(jì)應(yīng)用、Altera公司、Xilinx公司資訊和解決方案，包括HDL語(yǔ)言與源代碼、FPGA開發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。
MicroZed開發(fā)板筆記，第72部分：多周期約束
By Adam Taylor 在最近的幾篇博客中，我們研究了基本的時(shí)序約束。那么在設(shè)計(jì)中我們現(xiàn)在應(yīng)該能定義時(shí)鐘了，并且可以創(chuàng)建和聲明它們的關(guān)系，還應(yīng)該能在時(shí)鐘和系統(tǒng)中聲明任何缺陷。作為系統(tǒng)設(shè)...
2017-02-08 標(biāo)簽： 513
如何通過(guò)SerDes獲得32Gbps的板級(jí)傳輸速度
作者：Steve Leibson, 賽靈思戰(zhàn)略營(yíng)銷與業(yè)務(wù)規(guī)劃總監(jiān) 我設(shè)計(jì)PCB已經(jīng)多久了，但很不好意思的說(shuō)，一直都沒聽說(shuō)過(guò)PCB可以有超過(guò)1Gbps的信號(hào)傳輸。我正在寫的東西是關(guān)于最新的Xilinx 16nmVirtex UltraSca...
2017-02-08 標(biāo)簽： 929
一個(gè)DSP怪物的演化：具有大量DSP的UltraScale+ 和UItraScale全可編程器件
作者：Steve Leibson, 賽靈思戰(zhàn)略營(yíng)銷與業(yè)務(wù)規(guī)劃總監(jiān) 采用16nm工藝的Virtex UltraScale+全可編程器件的最多DSP數(shù)量是11904DSP48E2 slices。那是一個(gè)很大很大的數(shù)目。它已經(jīng)大到足以讓我好好地回顧賽靈思全...
2017-02-08 標(biāo)簽： 770
7000器件在測(cè)量類紅外圖像系統(tǒng)中的應(yīng)用
備注：主圖是從Fluke TiX1000宣傳冊(cè)中截取 作者：Hello，Panda 基于非制冷探測(cè)器的紅外測(cè)量系統(tǒng)可在各領(lǐng)域廣泛應(yīng)用。如海關(guān)、機(jī)場(chǎng)等公共場(chǎng)所民眾體溫監(jiān)測(cè)，芯片、焊點(diǎn)、激光光纖等微米級(jí)目標(biāo)...
2017-02-08 標(biāo)簽： 519
模塊間連接及輸入輸出端口設(shè)置
1、點(diǎn)擊XPS的Ports選項(xiàng)卡，包括個(gè)模塊，ExternalPorts是所有PS的對(duì)外輸出管腳，也就是PS部分與外部相連的管腳；axi_interconnect_1是總線連接器模塊；processing_system7_0是嵌入式處理器內(nèi)核模塊；my_gpio...
2017-02-08 標(biāo)簽： 1755
Xilinx FPGA I/O電平標(biāo)準(zhǔn)簡(jiǎn)介（三）
作者：Player? FPGA那點(diǎn)事兒 一、GTLP（GunningTransceiver Logic Plus） GTL+電平標(biāo)準(zhǔn)即岡寧收發(fā)器邏輯電平標(biāo)準(zhǔn)加，是在Pentium Pro處理器中首先使用的一種高速總線電平標(biāo)準(zhǔn)，該標(biāo)準(zhǔn)需要差分放大輸入bu...
2017-02-08 標(biāo)簽： 3413
淺談Xilinx Microblaze Bootloader實(shí)現(xiàn)
作者：Hello，Panda 一般而言，Xilinx Microblaze會(huì)被用來(lái)在系統(tǒng)中做一些控制類和簡(jiǎn)單接口的輔助性工作，比如運(yùn)行IIC、SPI、UART之類的低速接口驅(qū)動(dòng)，對(duì)FPGA邏輯功能模塊初始化配置及做些輔助計(jì)算等...
2017-02-08 標(biāo)簽： 2150
Xilinx FPGA I/O電平標(biāo)準(zhǔn)簡(jiǎn)介（二）
三、PCI（PeripheralComponent Interconnect） PCI電平標(biāo)準(zhǔn)即外設(shè)器件互聯(lián)電平標(biāo)準(zhǔn)，該標(biāo)準(zhǔn)支持33MHz和66MHz的總線應(yīng)用，包括PCI-X、PCI-33、PCI-66等各類電平標(biāo)準(zhǔn)，該標(biāo)準(zhǔn)的輸入輸出供電電壓（VCCO）為3.3V，...
2017-02-08 標(biāo)簽： 2913
HLS系列– HLS中的數(shù)據(jù)類型1
數(shù)據(jù)類型優(yōu)化的意義 C語(yǔ)言中所提供的數(shù)據(jù)類型，其長(zhǎng)度都是8bit的整數(shù)倍（8,16,32,64bits）。但是rtl所描述的硬件，卻可以支持任意長(zhǎng)度的數(shù)據(jù)寬度。所以，在很多情況下，使用標(biāo)準(zhǔn)C所提供的數(shù)據(jù)...
2017-02-08 標(biāo)簽： 1323
HLS系列–HighLevel Synthesis(HLS)的端口綜合8
本章介紹PortLevel Interface中的最后一個(gè)IO Protocol：ap_bus 。 ap_bus可以用來(lái)和外部的總線進(jìn)行互聯(lián)，它不遵循任何標(biāo)準(zhǔn)的總線協(xié)議，但是它也有自己的總線接口時(shí)序，雖然并不復(fù)雜。從接口特性上，...
2017-02-08 標(biāo)簽： 706
HLS系列 – High Level Synthesis(HLS) 的端口綜合7
在前幾章里，已經(jīng)分別介紹了BlockLevel Interface，Port Level Interface中的NoI/O Protocol和AXI4。本章里著重介紹下Port Level Interface的另一個(gè)子類別：MemoryInterface： Memory Interface中分為3個(gè)子類別，分別是：...
2017-02-08 標(biāo)簽： 1373
FPGA配置– 使用JTAG是如何燒寫SPI/BPI Flash的？
Xilinx的JTAG電纜可以通過(guò)FPGA“直接”燒寫SPI/BPI。很多對(duì)xilinx開發(fā)環(huán)境不熟悉的用戶，如果第一次接觸這種燒寫模式可能會(huì)有疑惑，F(xiàn)PGA是如何做到JTAG和Flash之間的橋接的，難道FPGA內(nèi)部有專用的電...
2017-02-08 標(biāo)簽： 10609
深度學(xué)習(xí)：基于FPGA的解決方案更具優(yōu)勢(shì)
近幾年來(lái)人工智能相關(guān)信息登上了各大媒體頭條，自動(dòng)駕駛，無(wú)人車也不再顯得那么陌生，其實(shí)這一切都源于機(jī)器學(xué)習(xí)，深度學(xué)習(xí)和人工神經(jīng)網(wǎng)絡(luò)等相關(guān)學(xué)科的興起。機(jī)器學(xué)習(xí)（Machine Learning,...
2017-02-08 標(biāo)簽： 456
HLS系列–實(shí)例分享，用HLS實(shí)現(xiàn)Goertzel算法（快速頻點(diǎn)檢測(cè)）
HLS非常適合一些信號(hào)處理模塊的快速實(shí)現(xiàn)。下面是一個(gè)實(shí)際的例子，由于使用了HLS，非常高效的就完成了模塊的rtl的實(shí)現(xiàn)，比用手工coding節(jié)約了大量的時(shí)間！ 需求描述： 在一個(gè)項(xiàng)目里面，需要...
2017-02-08 標(biāo)簽： 1189
基于vivado的fir ip核的重采樣設(shè)計(jì)與實(shí)現(xiàn)
本文基于xilinx 的IP核設(shè)計(jì)，源于音頻下采樣這一需求。 創(chuàng)建vivado工程 1. 首先打開vivado，創(chuàng)建一個(gè)新的project（勾選create project subdirectory選項(xiàng)），并將工程命填為firfilter。 2.選擇工程創(chuàng)建的類型為...
2017-02-08 標(biāo)簽：FIR 6081
雙通道方法讓Zynq SoC資源利用最大化
By Adam P. Taylor 本篇的摘錄和改編來(lái)自于Xcell雜志的最近一期 許多裸機(jī)應(yīng)用和簡(jiǎn)單的操作系統(tǒng)只使用ZYNQ SoC PS( processing system)中的兩個(gè)ARM內(nèi)核中的一個(gè)，一種設(shè)計(jì)上的選擇會(huì)潛在地限制了系統(tǒng)的性...
2017-02-08 標(biāo)簽： 417
Adam Taylor玩轉(zhuǎn)MicroZed系列，第75部分：放置約束
By Adam Taylor 在先前的博客中我們研究過(guò)I/O約束，下一個(gè)合乎邏輯的步驟就是研究如何在我們的設(shè)計(jì)中用FPGA進(jìn)行放置和布線約束。使用放置約束的原因如下：為了幫助實(shí)現(xiàn)時(shí)序，或者為了在設(shè)計(jì)...
2017-02-08 標(biāo)簽： 453
Adam Taylor玩轉(zhuǎn)MicroZed系列74：物理約束
研究了相關(guān)的時(shí)序約束后，在設(shè)計(jì)中我們也不能忽視所能運(yùn)用到的物理約束。一個(gè)工程師最常用的物理約束是I/O管腳的放置和與每個(gè)I/O腳相關(guān)的參數(shù)定義（標(biāo)準(zhǔn)、驅(qū)動(dòng)能力等）。然而，還有其它...
2017-02-08 標(biāo)簽： 522
采用高速串行端口的I/O bit傳輸比FPGA仿真有更廣的適用性
作者：Steve Leibson, 賽靈思戰(zhàn)略營(yíng)銷與業(yè)務(wù)規(guī)劃總監(jiān) Luis Bielich所撰寫的名為Zero Latency Multiplexing I/O for ASIC Emulation的Xilinx應(yīng)用手冊(cè)XAPP1217介紹了一種技術(shù)。這種技術(shù)使用一個(gè)高速的串行接口，將許多...
2017-02-08 標(biāo)簽： 584
如何把PetaLinux移植到Xilinx FPGA上
作者：作者：Sweta（印度班加羅爾PES理工學(xué)院），Srikanth Chintala（印度班加羅爾遠(yuǎn)程信息處理開發(fā)中心），以及Manikandan?教授（印度班加羅爾PES大學(xué)） （賽靈思中國(guó)通訊雜志的最新一期（55期）...
2017-02-08 標(biāo)簽： 643
Adam Taylor玩轉(zhuǎn)MicroZed系列73：用其他的Zynq
By Adam Taylor 在過(guò)去一周中，我接到了很多不同人的來(lái)信，他們正在使用以Zynq為基礎(chǔ)的開發(fā)工具。他們非常想知道怎么樣去把MicroZed系列博客教程應(yīng)用到他們所選擇的硬件平臺(tái)上。加上Avnet Micro...
2017-02-08 標(biāo)簽： 806
關(guān)于XDC約束文件，你需要知道的幾點(diǎn)
作者：?圓宵?FPGA那點(diǎn)事兒 在ISE時(shí)代，使用的是UCF約束文件。從Vivado開始，XDC成了唯一支持的約束標(biāo)準(zhǔn)。XDC除了遵循工業(yè)界的通行標(biāo)準(zhǔn)SDC（Synopsys Design Constraints）之外，還加入了XILINX FPGA特有的...
2017-02-08 標(biāo)簽： 5945
7 50T 入門級(jí)FPGA試用筆記（一）/初探
作為Xlinx-FPGA的學(xué)習(xí)者，學(xué)習(xí)之路頗為坎坷。在感慨Xilinx高大上的同時(shí)不得不吐槽真貴，特別是好的開發(fā)板（在這里真誠(chéng)感謝xilinx電子創(chuàng)新網(wǎng)提供的試用板）。同時(shí)高冷的Xilinx在學(xué)習(xí)上也沒有像...
2017-02-08 標(biāo)簽： 559
Zedboard移植USB無(wú)線網(wǎng)卡驅(qū)動(dòng)心得
最近因?yàn)樾枰赯edboard上移植一個(gè)無(wú)線網(wǎng)卡驅(qū)動(dòng)，因?yàn)橐郧霸谟焉浦凵厦嬉浦策^(guò)，所以以為很簡(jiǎn)單，沒想到這件事情卻花了我將近一周才搞好，中間就因?yàn)閮?nèi)核的一個(gè)小的疏忽，特在此將...
2017-02-08 標(biāo)簽： 767
能源無(wú)以為繼 到2040年計(jì)算機(jī)產(chǎn)業(yè)將終結(jié)？
據(jù)國(guó)外媒體每日郵報(bào)報(bào)道，電子信息產(chǎn)業(yè)在未來(lái)25年內(nèi)可能會(huì)遭遇瓶頸，因?yàn)槿澜绲碾娔軐o(wú)法支持這么多的電腦一起運(yùn)行。一份報(bào)告稱，如果按照目前的趨勢(shì) 繼續(xù)發(fā)展下去，截至2040年，計(jì)...
2017-02-08 標(biāo)簽： 414
Zybo Board 開發(fā)記錄: Zynq與LED閃爍控制
本文轉(zhuǎn)載自：coldnew's blog 在zybo board 開發(fā)記錄: 透過(guò)可程序邏輯控制 LED 閃爍一文中我們說(shuō)到了怎樣純粹使用 可程序邏輯 (Programmable Logic, PL) 去控制 Zybo board 上面的四個(gè) LED 燈 (LD0 ~ LD3)，接下來(lái)就...
2017-02-08 標(biāo)簽： 2402
Zybo Board 開發(fā)記錄： 透過(guò)可程序邏輯控制LED閃爍
本文轉(zhuǎn)載自：coldnew's blog 在進(jìn)入到這種混搭 ARM/FPGA 的開發(fā)板的世界之前，很多人都是從純粹的 FPGA 開發(fā)板玩起，因此也讓我們看看如何僅透過(guò)可程序邏輯(Programmable Logic, PL) 來(lái)對(duì) Zybo board 上面的...
2017-02-08 標(biāo)簽： 1017
Zynq Petalinux編譯用戶自定義系統(tǒng)
Design Flow Step Hardware Platform Creation Create PetaLinux Project Initialize PetaLinux Project Configure System-level Options Create User Components Configure the Linux Kernel Configure the Root Filesystem Build the system Test the System Deploy th...
2017-02-08 標(biāo)簽： 499
Zybo Board開發(fā)記錄: 讓 Vivado有Zybo Board的配置文件
本文轉(zhuǎn)載自：coldnew's blog 在透過(guò) Vivado 去建立新的項(xiàng)目的時(shí)候，開發(fā)板沒有 Zybo Board 的選項(xiàng)可以選，我們就必須自己去設(shè)定關(guān)于 Zybo Board 的信息。幸好， Digilentinc 針對(duì)這個(gè)問(wèn)題有提供關(guān)于 Zybo...
2017-02-08 標(biāo)簽： 893
Zybo Board 開發(fā)記錄: Xilinx SDK 在 Linux 的一些注意事項(xiàng)
本文轉(zhuǎn)載自：coldnew's blog 在使用 Xilinx 的開發(fā)環(huán)境 Vivado 2016.1 有遇到一些問(wèn)題，特別紀(jì)錄之。 安裝 Vivado 在其他的 Linux 平臺(tái) Vivado 安裝程序在非官方支持的 Linux 平臺(tái)上可能會(huì)導(dǎo)致安裝出問(wèn)題，以...
2017-02-08 標(biāo)簽： 1217
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