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電子發(fā)燒友網(wǎng)>可編程邏輯>

可編程邏輯

提供權(quán)威的PLD及可編程邏輯器件設(shè)計應(yīng)用、Altera公司、Xilinx公司資訊和解決方案,包括HDL語言與源代碼、FPGA開發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。
System generator DSP48E1 (2):四路加法器

System generator DSP48E1 (2):四路加法器

概述 利用4個dsp48e1模塊,實(shí)現(xiàn)四路加法器,dsp48e1模塊在手冊中表示比較復(fù)雜,找了兩個圖,可以大致看懂他的基本功能。 圖1 dsp48e1端口說明 圖2 簡化的DSP48E1結(jié)構(gòu) 軟件環(huán)境 ?Matlab 2014 a ?Viva...

2017-02-08 標(biāo)簽: 1080

System generator DSP48E1 (1):端口說明

System generator DSP48E1 (1):端口說明

概述 Xilinx的DSP48E1模塊在7系列的fpga芯片中經(jīng)常被用于DSP應(yīng)用當(dāng)中。他能夠有效提高設(shè)計的靈活性和效率,提高產(chǎn)品的性能。 DSP48E1支持許多獨(dú)立的功能。包括:乘法、乘加(MACC, ),乘加,三輸入...

2017-02-08 標(biāo)簽: 1288

Zybo Board 開發(fā)記錄: 升級Digilent提供的設(shè)計檔

Zybo Board 開發(fā)記錄: 升級Digilent提供的設(shè)計檔

Digilent 針對 Zybo board 用于 Embedded Linux 的環(huán)境上,提供了一個預(yù)先定義好接腳的配置文件 (zybo_base_system), 早期的版本 是直接將項目打包起來釋出,后期則采用 git 去進(jìn)行維護(hù),其項目位于GitHu...

2017-02-08 標(biāo)簽: 659

美國五大科技巨頭將聯(lián)合制定人工智能的道德標(biāo)準(zhǔn)

去多年中,科幻電影的情節(jié)常常是人工智能機(jī)器毀滅了人類。然而在未來10到20年中,我們最大的擔(dān)心或許是,機(jī)器人將搶走我們的工作,或是在高速公路上撞上我們的汽車。 目前,全球最大的...

2017-02-08 標(biāo)簽: 213

datamover完成ZYNQ片內(nèi)PS與PL間的數(shù)據(jù)傳輸

datamover完成ZYNQ片內(nèi)PS與PL間的數(shù)據(jù)傳輸

分享下PS與PL之間數(shù)據(jù)傳輸比較另類的實(shí)現(xiàn)方式,實(shí)現(xiàn)目標(biāo)是: 1、傳輸時數(shù)據(jù)不能滯留在一端,無論是1個字節(jié)還是1K字節(jié)都能立即發(fā)送; 2、PL端接口為FIFO接口; PS到PL的數(shù)據(jù)傳輸流程: PS到PL的...

2017-02-08 標(biāo)簽: 2425

Xilinx7系列基于PCIe的設(shè)計如何滿足PCIe啟動時間的要求

Xilinx7系列基于PCIe的設(shè)計如何滿足PCIe啟動時間的要求

根據(jù)PCIe的協(xié)議,當(dāng)設(shè)備啟動后,PCIe設(shè)備必須滿足啟動時間的要求,即上電后100ms內(nèi),完成PCIe設(shè)備的初始化。如果不能滿足PCIe設(shè)備啟動時間的要求,則lspci可能無法檢測到基于FPGA的PCIe設(shè)備,需...

2017-02-07 標(biāo)簽: 4435

基于7系列的新工程不再推薦使用Winbond Flash

基于7系列的新工程不再推薦使用Winbond Flash

我們知道,早先在ISE時代,Xilinx的A / K / V 系列FPGA支持Winbond / Micron / Spanion 三家的Flash: 但是從Vivado時代開始, Vivado Device Programmer 已經(jīng)不支持Winbond 的Flash了,參見 AR# 61497 Xilinx 官方的狀態(tài)為...

2017-02-07 標(biāo)簽: 3032

SDK– 如何減小Microblaze的代碼體積

SDK– 如何減小Microblaze的代碼體積

在FPGA中使用軟核做嵌入式開發(fā),有時我們會非常在意其編譯后的代碼體積大小,畢竟通常情況下,Microblaze都不是直接運(yùn)行在DDR當(dāng)中,而是運(yùn)行在FPGA內(nèi)部的LocalBRAM里面的,而BRAM通常是FPGA里面比...

2017-02-07 標(biāo)簽: 2085

Vivado的helloword程序(一):硬件工程部分

Vivado的helloword程序(一):硬件工程部分

硬件平臺:ZedBoard 軟件平臺:vivado2013.3 本示例通過綜合、實(shí)現(xiàn),生成比特流,發(fā)送到SDK實(shí)現(xiàn)。 啟動vivado并且創(chuàng)建一個項目 根據(jù)提示操作一步步創(chuàng)建新項目的時候記得選擇RTL Project 板子選擇Ze...

2017-02-07 標(biāo)簽: 1043

IBM宣布造出世界首個人造納米隨機(jī)相變神經(jīng)元

據(jù)外媒報道,IBM蘇黎世研究中心宣布,他們制造出世界上首個人造納米尺度隨機(jī)相變神經(jīng)元,可實(shí)現(xiàn)高速無監(jiān)督學(xué)習(xí)??茖W(xué)家表示:這一突破標(biāo)志著人類在認(rèn)知計算應(yīng)用中超密度集成神經(jīng)形態(tài)技...

2017-02-07 標(biāo)簽: 394

Zybo Board 開發(fā)記錄: 執(zhí)行 Linux 操作系統(tǒng)

Zybo Board 開發(fā)記錄: 執(zhí)行 Linux 操作系統(tǒng)

本文轉(zhuǎn)載自:coldnew's blog 在 zybo board 開發(fā)記錄: Zynq 與 LED 閃爍控制 一文中我們談到了如何透過 C 語言撰寫?yīng)毩⒌某绦颍屗刂?Zynq 的處理器系統(tǒng) (Processing System, PS) 去閃爍 LED 的亮暗。既然 ...

2017-02-07 標(biāo)簽: 1024

MicroBlaze Ethernetlite lwIP Applications測試

MicroBlaze Ethernetlite lwIP Applications測試

硬件環(huán)境:7A50T 軟件環(huán)境VIVADO2014.04 項目內(nèi)容: 7A50t LWIP應(yīng)用測試 備注:在跑第二個例子的時候,遇到問題“XMD既不是內(nèi)部命令也不是外部命令”,此問題糾結(jié)了一周多,最后在重新安裝軟件之...

2017-02-07 標(biāo)簽: 1419

7 50T FPGA試用筆記(二)/DSP48E1

前段時間一直在幫本科生做電賽,需要用到FPGA筆者作為學(xué)長責(zé)無旁貸去幫忙,耽誤了更新,抱歉。為了表現(xiàn)筆者的誠意,今天拿出干貨——DSP48E1的使用,全程高能不要眨眼。 安富利的陳博士出...

2017-02-07 標(biāo)簽: 3231

Xilinx的HDMI的IPCORE輸出調(diào)試成功

首先要把 主要的架構(gòu)圖看明白, hdmi_tx_ss模塊,是需要改動的。主要能夠保證進(jìn)入到 hdmi_tx_0模塊的數(shù)據(jù)是,標(biāo)準(zhǔn)的 行場信號就行。 需要3個信號分量, video_vs, video_de, video_data[143: 0]就行。 只...

2017-02-07 標(biāo)簽: 843

【科普】卷積神經(jīng)網(wǎng)絡(luò)基礎(chǔ)知識

【科普】卷積神經(jīng)網(wǎng)絡(luò)基礎(chǔ)知識

本文的主要目的,是簡單介紹時下流行的深度學(xué)習(xí)算法的基礎(chǔ)知識,本人也看過許多其他教程,感覺其中大部分講的還是太過深奧,于是便有了寫一篇科普文的想法。博主也是現(xiàn)學(xué)現(xiàn)賣,文中如...

2017-11-10 標(biāo)簽: 2139

4.3.2的ZYNQ的時鐘驅(qū)動架構(gòu)和原理解析

在查看zynq的clk時鐘驅(qū)動時,在源碼文件clkc.c中我們看到匹配屬性字段”xlnx,ps7-clkc”,該字段匹配zynq-7000.dtsi的時鐘子節(jié)點(diǎn)的compatible關(guān)鍵字屬性相匹配,時鐘的setup函數(shù)為zynq_clk_setup,查看整個源...

2017-11-10 標(biāo)簽: 5053

Zybo board 開發(fā)記錄: 使用Yocto建立系統(tǒng)

本文轉(zhuǎn)載自:coldnew's blog 在zybo board 開發(fā)記錄: 執(zhí)行 Linux 操作系統(tǒng)一文中,我們提到了如何自行編譯 u-boot、Linux kernel、busybox 來讓 Zybo Board 可以開機(jī)進(jìn)到 SD 卡上的 Linux 系統(tǒng)。這一次,我們要來...

2017-11-10 標(biāo)簽: 3359

解密:“無中生有”的計算機(jī)視覺

計算機(jī)視覺(Computer Vision,CV)是一門研究如何使機(jī)器“會看”的科學(xué)。1963年來自MIT的Larry Roberts發(fā)表了該領(lǐng)域第一篇博士論文《Machine Perception of Three-Dimensional Solids》,標(biāo)志著CV作為一門新興人...

2017-11-10 標(biāo)簽: 1223

I/O接口標(biāo)準(zhǔn)(1):LVTTL、LVCMOS、SSTL、HSTL

I/O接口標(biāo)準(zhǔn)(1):LVTTL、LVCMOS、SSTL、HSTL

I/O接口標(biāo)準(zhǔn) 1.單端信號接口標(biāo)準(zhǔn) LVTTL和LVCMOS(JESD8-5,JESD8-B) SSTL(JESD8-8,JESD8-9B,JESD8-15) HSTL(JESD8-6) LVTTL和LVCMOS結(jié)構(gòu)通常是簡單的push-pull。最簡單的例子就是CMOS反向器,需要滿足的唯一參...

2017-11-10 標(biāo)簽: 48535

基于Microblaze的LwIP以太網(wǎng)環(huán)境搭建

基于Microblaze的LwIP以太網(wǎng)環(huán)境搭建

安富利陳志勇博士出的試用題目: 通過以太網(wǎng)口,PC把一幅圖片傳給FPGA,F(xiàn)PGA做處理后再回傳給PC做顯示。這樣可以實(shí)現(xiàn)算法驗證,并且可以比較基于PC純軟件處理,和FPGA硬加速處理的時間。圖...

2017-11-10 標(biāo)簽: 13636

認(rèn)知計算揭開計算新時代序幕?路漫漫其修遠(yuǎn)兮

據(jù)Techopedia報道,人類總是想要從生活中獲取更多,計算系統(tǒng)也在這些預(yù)期范圍之內(nèi)。最初時,計算機(jī)只能匯總數(shù)據(jù),接著只能去做編程安排它們?nèi)プ龅氖虑?。但我們從未放棄去?chuàng)建新的計算系...

2017-11-10 標(biāo)簽: 535

Python機(jī)器學(xué)習(xí)庫和深度學(xué)習(xí)庫總結(jié)

我們在Github上的貢獻(xiàn)者和提交者之中檢查了用Python語言進(jìn)行機(jī)器學(xué)習(xí)的開源項目,并挑選出最受歡迎和最活躍的項目。 1. Scikit-learn(重點(diǎn)推薦) Scikit-learn 是基于Scipy為機(jī)器學(xué)習(xí)建造的的一個...

2017-11-10 標(biāo)簽:python 1112

Vivado Synthesis中如何為Verilog代碼中的“include file”設(shè)置路徑?

在Verilog代碼開發(fā)時,我們可以把經(jīng)常會用到的公共變量和參數(shù),單獨(dú)放在一個cfg.v文件中,然后在別的文件中include這個文件,這樣便于代碼的組織管理,可以使得代碼結(jié)構(gòu)更加清晰。 下面是在...

2017-11-10 標(biāo)簽: 10903

新型“擴(kuò)散式憶阻器”可逼真模擬突觸行為

據(jù)美國趣味科學(xué)網(wǎng)站26日報道,美國科學(xué)家研制出了一種新型“擴(kuò)散式憶阻器”,模擬了人腦兩個神經(jīng)元的結(jié)點(diǎn)——突觸內(nèi)鈣離子的行為,逼真度有史以來最高。研究人員表示,新設(shè)備有助于開...

2017-11-10 標(biāo)簽: 972

Vivado Design Suite HLx 版本 2016.4 現(xiàn)已發(fā)布

最新版 Vivado HLx Edition 現(xiàn)已推出, 其中包括: 支持 Zynq? UltraScale+? MPSoC ZCU102-ES2 和 Virtex? UltraScale+ VCU118-ES1 開發(fā)板 支持 Virtex UltraScale+ XCVU11P 和 XCVU13P 器件 針對 Kintex? 和 Virtex UltraScale? 器件的...

2017-11-10 標(biāo)簽: 1278

玩轉(zhuǎn)Xilinx嵌入式視覺開發(fā)者專區(qū) 讓視覺系統(tǒng)開發(fā)更加簡單

開發(fā)下一代視覺系統(tǒng)的 “一站式平臺” ——Xilinx嵌入式視覺開發(fā)者專區(qū) 賽靈思近日推出了面向軟件、硬件及系統(tǒng)開發(fā)人員的嵌入式視覺開發(fā)者專區(qū),以幫助他們加速生產(chǎn)力并打造 All Programma...

2017-11-10 標(biāo)簽: 1390

Enclustra公司在ESC2016大會上推出Mercury+ XU1 SOM核心模塊

ESC是Embedded Systems Conference的簡稱,即嵌入式系統(tǒng)大會,每年都會舉行一次。ESC2016于2016年12月6號至2016年12月8號在美國加州圣何塞(San Jose)會議中心舉行,為期三天。行業(yè)內(nèi)的各大電子和半導(dǎo)體...

2017-11-10 標(biāo)簽: 1610

TSN開放標(biāo)準(zhǔn)掛保證 車用以太網(wǎng)搶進(jìn)ADAS市場

作者:Arthur Marris/Sachin Dhingra/Robert Schweiger 以太網(wǎng)絡(luò)技術(shù)具有成本低、重量輕、數(shù)據(jù)傳輸率高的特性,且并非專有性質(zhì),因此成為實(shí)現(xiàn)先進(jìn)駕駛輔助系統(tǒng)(ADAS)應(yīng)用及自動駕駛的關(guān)鍵。為達(dá)成操控...

2017-11-10 標(biāo)簽: 1766

“讓系統(tǒng)具有自愈能力”:基于Artix

冗余系統(tǒng)是為了為增加系統(tǒng)的可靠性,采取兩套或兩套以上相同、相對獨(dú)立配置的設(shè)計。采取兩套同樣配置的獨(dú)立硬件、軟件或設(shè)計等,可以做到在其中一套系統(tǒng)出現(xiàn)故障時,另一套系統(tǒng)能立即...

2017-11-10 標(biāo)簽: 648

popping:一個基于Zynq架構(gòu),OpneCV庫的目標(biāo)跟蹤系統(tǒng)

1999年,Intel建立了OpenCV庫(Open Source Computer Vision library),如今由Willow Garage提供支持。它是一個基于BSD許可的開源發(fā)行的跨平臺計算機(jī)視覺庫,可以運(yùn)行在Linux,Windows和Mac OS操作系統(tǒng)上。OpenC...

2017-11-10 標(biāo)簽: 1163

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