可編程邏輯
提供權(quán)威的PLD及可編程邏輯器件設(shè)計(jì)應(yīng)用、Altera公司、Xilinx公司資訊和解決方案，包括HDL語言與源代碼、FPGA開發(fā)板、EDA工具、FPGA、FPGA軟件等領(lǐng)域。
基于DSP芯片TMS320VC33和XCV50TQ144實(shí)現(xiàn)USB口數(shù)據(jù)采集分析系統(tǒng)設(shè)計(jì)
選擇DSP處理器時主要考慮其運(yùn)算速度、總線寬度和性價比。本系統(tǒng)采樣結(jié)構(gòu)24位，最好選用32位DSP;系統(tǒng)要進(jìn)行實(shí)時信號分析、模態(tài)分析等，要求有較高運(yùn)算速度，所以選用TI公司的32位浮點(diǎn)DSP——...
2020-12-24 標(biāo)簽：dspFPGA數(shù)據(jù)采集 2398
基于DSP芯片TMS320LF2407A和EPM570T100C5N實(shí)現(xiàn)多路數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
由于多路模擬開關(guān)映射到DSP的I／O空間中的0X8000-0XFFFF之間，所以在DSP程序中，對0X8000-0XFFFF之間進(jìn)行一個讀操作，由DSP的GPIO選擇的通道就被選通，信號由CD4067輸出到A／D轉(zhuǎn)換器MAXl94。...
2020-12-23 標(biāo)簽：dspcpld數(shù)據(jù)采集 2756
SoC設(shè)計(jì)中的IP軟核與硬核的對比及方案選擇
IP核可以兩種形式提供給客戶：軟核和硬核。兩種方式都可使客戶獲得在功能上經(jīng)過驗(yàn)證的設(shè)計(jì)。軟核也被稱為可綜合內(nèi)核，需要由客戶進(jìn)行綜合并在其SoC上實(shí)現(xiàn)。而硬核已完全實(shí)現(xiàn)（完成了版...
基于FPGA實(shí)現(xiàn)FIR數(shù)字濾波電路的設(shè)計(jì)及應(yīng)用
這樣就可以把FIR濾波器設(shè)計(jì)成具有線性相位。利用這一情況，可以得到的乘法結(jié)構(gòu)，需要（N+1）/2次乘法，僅是級聯(lián)或并聯(lián)結(jié)構(gòu)所需次數(shù)的一半，因此，實(shí)際應(yīng)用中多采用此方法。...
2020-12-22 標(biāo)簽：FPGA轉(zhuǎn)換器汽車電子 2478
英特爾開放式 FPGA 化自定義加速平臺解決方案介紹
上個月舉行的 2020 英特爾 FPGA 技術(shù)大會發(fā)布了兩款重磅新品，之前小編為筒子們詳細(xì)介紹了首款用于 5G、人工智能、云端與邊緣的結(jié)構(gòu)化 ASIC——英特爾? eASIC N5X。...
基于FPGA 實(shí)現(xiàn) PN 碼生成器實(shí)現(xiàn)設(shè)計(jì)介紹
近年來，擴(kuò)頻通信技術(shù)在移動通信、個人通信、室內(nèi)無線通信以及衛(wèi)星通信中得到越來越廣泛的應(yīng)用。對于 DS-CDMA（DirectSequence-CodeDivisionMulTIpleAccess，直接序列 - 碼分多址）移動通信系統(tǒng)，因其...
基于FPGA卡拉 ok 系統(tǒng)內(nèi)部音頻算法系統(tǒng)
音頻模擬信號經(jīng)過音頻 adc 采集后轉(zhuǎn)化為數(shù)字信號通過 I2S 送入 FPGA，F(xiàn)PGA 內(nèi)部可做均衡器算法，反饋抑制算法，高低通濾波器混響回聲以及變聲的音頻處理算法。...
2021-01-01 標(biāo)簽：FPGAadc硬件系統(tǒng) 2027
基于FPGA 圖像數(shù)據(jù)存儲方法
圖像在采集和傳輸?shù)倪^程中，通常會產(chǎn)生噪聲，使圖像質(zhì)量降低，影響后續(xù)處理。因此須對圖像進(jìn)行一些圖像濾波、圖像增強(qiáng)等預(yù)處理。為改善圖像質(zhì)量，去除噪聲通常會對圖像進(jìn)行濾波處理...
基于可編程邏輯器件實(shí)現(xiàn)MPEG-4簡易編碼器和解碼器核的設(shè)計(jì)
您是否曾想在您的 FPGA 設(shè)計(jì)中使用先進(jìn)的視頻壓縮技術(shù)，卻發(fā)現(xiàn)實(shí)現(xiàn)起來太過復(fù)雜？現(xiàn)在您無需成為一名視頻專家就能在您的系統(tǒng)中使用視頻壓縮。賽靈思新推出的 MPEG-4“ target=”_blank“》MP...
基于可編輯邏輯器件實(shí)現(xiàn)的LVDS接收端電路的優(yōu)化設(shè)計(jì)
通過以上分析，首先在硬件設(shè)計(jì)方面對LVDS接口電路進(jìn)行優(yōu)化。在數(shù)據(jù)發(fā)送端，使用SN65LV1023A串化器將FPGA輸出的并行數(shù)據(jù)轉(zhuǎn)化為串行輸出，其次在發(fā)送端增加LMH0001SQ高速驅(qū)動器，增強(qiáng)信號驅(qū)動能...
如何通過FPGA和軟件開發(fā)工具包（SDK）創(chuàng)建邊緣AI應(yīng)用
邊緣推理處理器實(shí)現(xiàn)人工智能（AI）算法的設(shè)計(jì)人員不斷需要降低功耗和開發(fā)時間，即使處理需求不斷增加?，F(xiàn)場可編程門陣列（FPGA）提供了速度和功率效率的有效組合，用于實(shí)現(xiàn)邊緣AI所需的...
2021-02-21 標(biāo)簽：FPGA神經(jīng)網(wǎng)絡(luò)人工智能 6039
基于FPGA和自適應(yīng)濾波技術(shù)實(shí)現(xiàn)LMS自適應(yīng)濾波器的設(shè)計(jì)
由空氣動力學(xué)原理，當(dāng)超音速運(yùn)動的物體，由于運(yùn)動速度大于局部聲速時會產(chǎn)生激波，彈道聲波是超聲速彈丸飛行時沖擊空氣分子所形成的激波（ Shock waves）。采用激波原理進(jìn)行報靶是一項(xiàng)具有...
2020-12-18 標(biāo)簽：FPGA濾波器數(shù)模轉(zhuǎn)換器 3995
基于TMS320C6713和EP2C5 FPGA實(shí)現(xiàn)實(shí)時視頻圖像加密系統(tǒng)的設(shè)計(jì)
流加密的密鑰是利用兩個不同的一維逐段性混沌映射x1（i+1）=F1（x1（i），p1），x2（i+1）=F2（x2（i），p2）來生成x1（i+1）和x2（i+1）兩個擬混沌軌道變量，然后利用非線性變換生成偽隨機(jī)比特序...
現(xiàn)場可編程邏輯門陣列（FPGA）賦能下一代通信和網(wǎng)絡(luò)解決方案
5G的興起和數(shù)據(jù)中心的重構(gòu)將更好和更多地集成和應(yīng)用加速技術(shù)，這給通信和網(wǎng)絡(luò)設(shè)計(jì)人員帶來了巨大的壓力，要求他們?nèi)ゴ蛟烀棵肟商幚砗娃D(zhuǎn)發(fā)萬億字節(jié)數(shù)據(jù)的系統(tǒng)。...
2020-12-16 標(biāo)簽：FPGA可編程邏輯通信網(wǎng)絡(luò)機(jī)器學(xué)習(xí)智能網(wǎng)卡 2005
采用FPGA芯片的系統(tǒng)應(yīng)用的電源管理問題
目前的電子產(chǎn)品市場競爭非常激烈，廠商都希望能在最短時間內(nèi)將新產(chǎn)品推出市場，以致子系統(tǒng)的設(shè)計(jì)周期越縮越短。在這個發(fā)展過程中，F(xiàn)PGA及ASIC 的重要性越來越受到重視，例如新系統(tǒng)的很多...
使用嵌入式開發(fā)套件將軟件編譯并形成有效硬件
Xilinx Platform Studio（XPS）是一款普遍使用的嵌入式開發(fā)套件（EDK），其升級版XPS 8.2版本新增加了獨(dú)特的功能和性能，可進(jìn)一步提高嵌入式系統(tǒng)設(shè)計(jì)的效率，通過這一新版本，工程師可以獲得針對...
基于DSP器件DSP56F803和XC95XL144實(shí)現(xiàn)通用板的設(shè)計(jì)
隨著電力電子市場需求與日俱增， 為了縮短電力電子硬件設(shè)計(jì)的開發(fā)時間，本文設(shè)計(jì)開發(fā)了DSP56F803通用板作為各種電力電子應(yīng)用的硬件開發(fā)平臺。...
基于VirtexⅡXC2V1000-5 FPGA實(shí)現(xiàn)寬帶多速率解調(diào)器的設(shè)計(jì)
解調(diào)器作為數(shù)字接收機(jī)中的關(guān)鍵部分，對通信系統(tǒng)的整體性能有著重要的影響．隨著多媒體業(yè)務(wù)的發(fā)展，對無線通信寬帶傳輸?shù)男枨笤絹碓酱?，而無線信道環(huán)境是時變的，為了適應(yīng)在不同的信道...
基于STEP-MAX10M08核心板實(shí)現(xiàn)簡易電壓表的設(shè)計(jì)
傳統(tǒng)的數(shù)字電壓表設(shè)計(jì)通常以大規(guī)模ASIC（專用集成電路）為核心器件，并輔以少量中規(guī)模集成電路及顯示器件構(gòu)成。這種電壓表的設(shè)計(jì)簡單、精確度高，但是由于采用了ASIC器件使得它欠缺靈活...
基于JavaCAD架構(gòu)的安全性與IP保護(hù)研究
目前，基于IP的EDA設(shè)計(jì)流程面臨著兩大挑戰(zhàn)。首先，必須提供方法技術(shù)，用于測試包含IP組件設(shè)計(jì)的可靠性和質(zhì)量；另一方面，必須保護(hù)IP供應(yīng)商和設(shè)計(jì)者的知識產(chǎn)權(quán)。第三方IP核的使用確實(shí)可以...
利用MP3C和Spartan-IIE開發(fā)板實(shí)現(xiàn)復(fù)雜FFT電路的驗(yàn)證
MP3C系統(tǒng)是Aptix公司的產(chǎn)品，是一種價格低、驗(yàn)證速度快、基于層次化和模塊化的硬件驗(yàn)證平臺，可以逐步驗(yàn)證每一個邏輯模塊直到驗(yàn)證整個系統(tǒng)功能。MP3C硬件中的現(xiàn)場可編程互連電路板（FPCB）...
現(xiàn)場可編模擬陣列AN221E04的特點(diǎn)及應(yīng)用范圍
Anadigm公司推出的第二代現(xiàn)場可編模擬陣列（FPAA）系列AN221E04，使設(shè)計(jì)者能在工業(yè)，汽車電子，醫(yī)療，通信，自動測試設(shè)備和儀表系統(tǒng)中實(shí)現(xiàn)信號調(diào)節(jié)，濾波，數(shù)據(jù)采集，閉環(huán)控制和其它模擬方...
2020-12-11 標(biāo)簽：asic數(shù)據(jù)采集微處理器 1774
Graphcore IPU-M2000在首個benchmark測試中顯著優(yōu)于GPU
Benchmark中包括了BERT-Large（基于Transformer的自然語言處理模型）在IPU-POD64的全部64個處理器上運(yùn)行的結(jié)果。...
2020-12-10 標(biāo)簽：處理器gpu網(wǎng)絡(luò)技術(shù)IPU自然語言 1458
基于MAX1951實(shí)現(xiàn)Stratix II FPGA系統(tǒng)供電的設(shè)計(jì)方案
Stratix II是ALTERA公司生產(chǎn)的一款高性能FPGA器件。它采用TSMC的90 nm低k絕緣工藝技術(shù)生產(chǎn)，等價邏輯單元（LE）高達(dá)180 k，嵌入式存儲器容量達(dá)到9 MB。該器件不但具有極高的性能和密度，而且還針對...
基于FPGA器件和VHDL語言實(shí)現(xiàn)EPCClass1讀寫器系統(tǒng)的設(shè)計(jì)
一個完整的RFID系統(tǒng)包括：讀寫器、天線、標(biāo)簽和PC機(jī)。讀寫器完成對標(biāo)簽（Tag）的讀寫操作。通過RS232或RS485總線完成PC機(jī)的命令接收和EPC卡號的上傳。圖l是讀寫器的系統(tǒng)組成框圖。讀寫器組成...
基于FPGA實(shí)現(xiàn)PN序列發(fā)生器的設(shè)計(jì)
近年來，擴(kuò)頻通信技術(shù)在移動通信、個人通信、室內(nèi)無線通信以及衛(wèi)星通信中得到越來越廣泛的應(yīng)用。對于DS-CDMA（Direct Sequence-Code Division Multiple Access，直接序列-碼分多址）移動通信系統(tǒng)，因其...
基于可編輯邏輯器件和VHDL語言實(shí)現(xiàn)猝發(fā)多脈沖產(chǎn)生系統(tǒng)的應(yīng)用方案
脈沖功率技術(shù)是一種功率壓縮技術(shù)，以較低的輸入功率將能量緩慢存儲起來，隨后在極短時間內(nèi)釋放，以獲得極高的峰值輸出功率。該技術(shù)是應(yīng)國防科技需要而發(fā)展起來的一門新興科學(xué)技術(shù)，是...
基于FPGA器件實(shí)現(xiàn)FMMU地址映射和數(shù)據(jù)字節(jié)和位提取的功能
EtherCAT主要優(yōu)勢在于高速、高實(shí)時性以及精確時鐘同步。這些優(yōu)勢的實(shí)現(xiàn)基于EtherCAT設(shè)計(jì)的幾個關(guān)鍵技術(shù)：飛讀飛寫（processing on the fly）、FMMU（Fieldbus Memory Management Unit）、DC（Distribute Clock）。以...
2020-12-09 標(biāo)簽：FPGA現(xiàn)場總線工業(yè)以太網(wǎng) 3206
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