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標(biāo)簽 > 仿真
仿真(Simulation),即使用項(xiàng)目模型將特定于某一具體層次的不確定性轉(zhuǎn)化為它們對(duì)目標(biāo)的影響,該影響是在項(xiàng)目仿真項(xiàng)目整體的層次上表示的。項(xiàng)目仿真利用計(jì)算機(jī)模型和某一具體層次的風(fēng)險(xiǎn)估計(jì),一般采用蒙特卡洛法進(jìn)行仿真。
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2018-10-11 標(biāo)簽:電源轉(zhuǎn)換器maxim 4.3k 0
FPGA之硬件語(yǔ)法篇:用Verilog代碼仿真與驗(yàn)證數(shù)字硬件電路
大家都知道軟件設(shè)計(jì)使用軟件編程語(yǔ)言,例如我們熟知的C、Java等等,而FPGA設(shè)計(jì)使用的是HDL語(yǔ)言,例如VHDL和Verilog HDL。說(shuō)的直白點(diǎn),...
靜態(tài)時(shí)序分析:如何編寫(xiě)有效地時(shí)序約束(一)
靜態(tài)時(shí)序分析是一種驗(yàn)證方法,其基本前提是同步邏輯設(shè)計(jì)(異步邏輯設(shè)計(jì)需要制定時(shí)鐘相對(duì)關(guān)系和最大路徑延時(shí)等,這個(gè)后面會(huì)說(shuō))。靜態(tài)時(shí)序分析僅關(guān)注時(shí)序間的相對(duì)關(guān)...
ADI建議電源開(kāi)發(fā)優(yōu)先考慮電源架構(gòu)的優(yōu)化
電源開(kāi)發(fā)的另一個(gè)關(guān)鍵點(diǎn)是定義電源架構(gòu)或創(chuàng)建電源樹(shù)。完整的系統(tǒng)電源通常需要多個(gè)電源轉(zhuǎn)換器,而且往往需要多個(gè)不同的電壓。為此,有多種方法可達(dá)到目的??梢允褂?..
現(xiàn)代FPGA的體系結(jié)構(gòu)包括CLB陣列、塊RAM、乘法器、DSP、IOB和數(shù)字時(shí)鐘管理器(DCM)。延遲鎖定環(huán)(DLL)用于賦值具有均勻時(shí)鐘偏移的時(shí)鐘。X...
整個(gè)基礎(chǔ)知識(shí)體系中,差分線(對(duì))是很難搞的部分,卻是最常用的部分。說(shuō)到差分線基礎(chǔ)知識(shí),里面的概念很多,記得剛接觸的時(shí)候,奇模&共模有時(shí)候會(huì)搞不清...
自動(dòng)駕駛聯(lián)合仿真——功能模型接口FMI(終)
本文帶您了解,如何在aiSim中,通過(guò)UDP和aiSim車(chē)輛動(dòng)力學(xué)API(Vehicle Dynamics Interface, VDI)來(lái)實(shí)現(xiàn)和外部的...
2024-08-07 標(biāo)簽:仿真智能汽車(chē)自動(dòng)駕駛 4.3k 0
采用FPGA芯片完成基于LMS算法的自適應(yīng)譜線增強(qiáng)系統(tǒng)的設(shè)計(jì)
自適應(yīng)濾波是相對(duì)固定濾波器而言的.固定濾波器濾波頻率是固定的,自適應(yīng)濾波器濾波的頻率自動(dòng)適應(yīng)輸入信號(hào)而變化的,所以其適用范圍更加廣泛。自適應(yīng)濾波器是滿足...
1、 運(yùn)行ModelSim,如果上一次使用ModelSim建立過(guò)工程,這時(shí)候會(huì)自動(dòng)打開(kāi) 上一次所建立的工程; 2、 點(diǎn)擊File-New-Project...
多學(xué)科仿真集成與優(yōu)化設(shè)計(jì)軟件產(chǎn)品介紹
Optimus是比利時(shí)Noesis Solutions公司專注研發(fā)的一款多學(xué)科仿真集成與優(yōu)化設(shè)計(jì)軟件產(chǎn)品。通過(guò)Optimus平臺(tái),可管理多學(xué)科的仿真流程...
2022-03-25 標(biāo)簽:數(shù)據(jù)仿真顯示 4.3k 0
自定義EE-Sim仿真波形的顯示,實(shí)現(xiàn)最優(yōu)分析??膳渲玫膮?shù)包括信號(hào)顏色、順序和分組;坐標(biāo)軸比例、布局和同步;標(biāo)記數(shù)量和標(biāo)簽;自動(dòng)和手動(dòng)縮放;以及保存數(shù)...
2018-10-08 標(biāo)簽:轉(zhuǎn)換器maxim仿真 4.3k 0
本文將分為三部去講述天線隔離的定義、影響天線隔離度的幾個(gè)關(guān)鍵因素和終端天線如何提高隔離度,希望對(duì)大家有所幫助。
2023-10-17 標(biāo)簽:天線仿真移動(dòng)通信 4.2k 0
直接使用計(jì)數(shù)器實(shí)現(xiàn),在計(jì)數(shù)一半時(shí)將時(shí)鐘翻轉(zhuǎn)即可。
2023-01-17 標(biāo)簽:電路設(shè)計(jì)仿真Verilog 4.2k 0
System Generator設(shè)計(jì)工具的基本介紹
了解Vivado實(shí)現(xiàn)中2015.3中的新增量編譯功能,包括更好地處理物理優(yōu)化和自動(dòng)增量編譯流程。
Zynq UltraScale+ MPSoC在仿真板上的運(yùn)行展示
Xilinx展示Zynq UltraScale + MPSoC在由6個(gè)FPGA組成的硬件仿真板上運(yùn)行,以實(shí)現(xiàn)四核ARM Cortex-A53,雙核ARM...
基于ADS平臺(tái)改進(jìn)型Doherty電路設(shè)計(jì)與仿真
在現(xiàn)代數(shù)字通信中,調(diào)制技術(shù)運(yùn)用了非恒包絡(luò)調(diào)制方式,峰值和平均值相差較大,描述為峰均比(PAR),為了滿足線性度的要求,則往往采用功率回退的方法來(lái)達(dá)到線性...
2018-05-17 標(biāo)簽:電路設(shè)計(jì)仿真ads 4.2k 0
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