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PCI Express IP設(shè)計(jì)的過程與仿真介紹

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2017-02-11 標(biāo)簽：FPGA DLL 賽靈思 3.3k 0

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Zerotech Dobby AI無人機(jī)與DeePhi的深度學(xué)習(xí)推理技術(shù)介紹

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u-boot映像及其功能的介紹

了解有關(guān)設(shè)備樹的背景信息，各種類型的u-boot映像及其功能以及有關(guān)使用的內(nèi)容。除了dumpimage工具從圖像中提取組件。

2018-11-22 標(biāo)簽：賽靈思圖像 3.3k 0

N維內(nèi)核范圍的問題空間

OpenCL的一個(gè)關(guān)鍵概念是將應(yīng)用程序問題劃分為多維問題空間。被稱為N維內(nèi)核范圍的問題空間的每個(gè)塊在...之間并行執(zhí)行相同的計(jì)算。

2018-11-22 標(biāo)簽：內(nèi)核賽靈思應(yīng)用程序 3.3k 0

用于Zynq微處理器和可編程邏輯的新型操作系統(tǒng)Dyplo介紹

Xilinx的Dave Tokic與Topic Embedded Systems的創(chuàng)始人兼首席執(zhí)行官Rieny Rijnen進(jìn)行了交談，他描述了Dypl...

2018-11-30 標(biāo)簽：賽靈思操作系統(tǒng)微處理器 3.3k 0

借助Zynq RFSoC DFE解決 5G 大規(guī)模部署難題

無線電單元（RU）對(duì)更大帶寬的需求，不僅是為了增加數(shù)據(jù)速率。運(yùn)營商還需要為現(xiàn)有和新的頻段解決復(fù)雜的無線電配置問題。

2021-07-23 標(biāo)簽：賽靈思 5G 3.3k 0

如何快速地創(chuàng)建圖像處理流水線，實(shí)時(shí)檢測(cè)運(yùn)動(dòng)物體

這段視頻中，我們將向您演示如何快速地創(chuàng)建一個(gè)簡單的圖像處理流水線，實(shí)時(shí)檢測(cè)運(yùn)動(dòng)物體。把運(yùn)動(dòng)物體邊緣勾勒并實(shí)時(shí)地插入到視頻流中，視頻幀速是1080p每秒6...

2018-11-27 標(biāo)簽：視頻賽靈思圖像處理 3.2k 0

在Artix A35T Arty評(píng)估套件評(píng)估Xilinx的AMS技術(shù)

了解如何使用內(nèi)置IPI且無任何HDL的簡單但功能強(qiáng)大的設(shè)計(jì)，快速輕松地在Artix A35T Arty評(píng)估套件上快速輕松地評(píng)估Xilinx的模擬混合信號(hào)...

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reVISION堆棧為視覺導(dǎo)向應(yīng)用鋪路

全新的reVISION?堆棧能夠支持更廣泛的沒有或者很少硬件設(shè)計(jì)專業(yè)知識(shí)的嵌入式軟件和系統(tǒng)工程師，使其也可以使用賽靈思技術(shù)更輕松，更快速地開發(fā)視覺導(dǎo)向的...

2018-11-22 標(biāo)簽：賽靈思無人機(jī)增強(qiáng)現(xiàn)實(shí) 3.2k 0

Vivado Design Suite設(shè)計(jì)套件的UltraFast設(shè)計(jì)方法的介紹

UltraFast設(shè)計(jì)方法對(duì)您在Vivado Design Suite中的成功至關(guān)重要。介紹UltraFast for Vivado并了解可用的材料...

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【自適應(yīng)計(jì)算在機(jī)器人領(lǐng)域的應(yīng)用】連載七：用ROS 2在機(jī)器人內(nèi)部集成自適應(yīng)計(jì)算的新架構(gòu)

第一個(gè)支柱是 ament ROS 2 構(gòu)建系統(tǒng)的擴(kuò)展。ament_vitis（1）通過一系列 CMake 宏和實(shí)用工具實(shí)現(xiàn)這些擴(kuò)展，將 Vitis 工具...

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面向未來的AI加速， ACAP可編程器件具有突破性意義

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