asic

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ASIC是Application Specific Integrated Circuit的英文縮寫，在集成電路界被認(rèn)為是一種為專門目的而設(shè)計(jì)的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫，即澳大利亞證券和投資委員會(huì)，它是澳大利亞金融服務(wù)和市場(chǎng)的法定監(jiān)管機(jī)構(gòu)。

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asic技術(shù)

EDA工具提供便攜高效設(shè)計(jì)環(huán)境

如今FPGA已進(jìn)入硅片融合時(shí)代，集成了DSP、ARM等，這種混合系統(tǒng)架構(gòu)需要更好的開發(fā)環(huán)境。FPGA的應(yīng)用范圍越來越廣，這給第三方工具和開發(fā)平臺(tái)提供商帶...

2012-08-14 標(biāo)簽：fpga asic eda 1.7k 0

IC設(shè)計(jì)中的多時(shí)鐘域處理方法總結(jié)

我們?cè)贏SIC或FPGA系統(tǒng)設(shè)計(jì)中，常常會(huì)遇到需要在多個(gè)時(shí)鐘域下交互傳輸?shù)膯栴}，時(shí)序問題也隨著系統(tǒng)越復(fù)雜而變得更為嚴(yán)重。

2023-04-06 標(biāo)簽：fpga asic 存儲(chǔ)器 1.7k 0

如何區(qū)分FPGA與ASIC

ASIC基本都是基于標(biāo)準(zhǔn)單元開始設(shè)計(jì)的，還需要進(jìn)行Place & Route。當(dāng)芯片存在任何問題時(shí)，必須再次重新投片，直到達(dá)到你想要的功能和性能...

2023-03-21 標(biāo)簽：fpga 芯片 asic 1.7k 0

異構(gòu)計(jì)算為什么會(huì)異軍突起？基于FPGA的異構(gòu)計(jì)算討論

簡(jiǎn)單的介紹幾個(gè)概念，同道中人可以忽略這一段。云計(jì)算取代傳統(tǒng)IT基礎(chǔ)設(shè)施已經(jīng)基本成為業(yè)界共識(shí)和不可阻擋的趨勢(shì)。

2023-10-26 標(biāo)簽：fpga asic 晶體管 1.7k 0

將Blackfin DSP連接到無線應(yīng)用的高速轉(zhuǎn)換器

直到最近，大多數(shù)設(shè)計(jì)人員還必須將高速并行轉(zhuǎn)換器連接到專用IC（ASIC）或快速現(xiàn)場(chǎng)可編程門陣列（FPGA）。像這樣的設(shè)備能夠解決許多所需的同步并行數(shù)字操...

2023-06-17 標(biāo)簽：fpga 轉(zhuǎn)換器 ASIC 1.7k 0

如何用ASIC的思路開發(fā)FPGA應(yīng)用

5G，AI和AIoT，讓所有東西都聯(lián)網(wǎng)和數(shù)字化，使得算力缺口不斷擴(kuò)大，從端側(cè)到云端，數(shù)據(jù)運(yùn)算需求呈現(xiàn)指數(shù)級(jí)增長(zhǎng)，都在思考如何打破“算力瓶頸”。也許你會(huì)說...

2023-09-01 標(biāo)簽：fpga 芯片 asic 1.7k 0

FPGA中邏輯資源和門是如何進(jìn)行對(duì)應(yīng)的

而且現(xiàn)在的LUT都是4輸入或者6輸入，可以做成邏輯門的組合，跟普通的邏輯門個(gè)數(shù)肯定不會(huì)是一對(duì)一關(guān)系。今天我們來看下這個(gè)關(guān)系如果對(duì)應(yīng)。

2022-11-01 標(biāo)簽：fpga asic LUT 1.7k 0

基于Xilinx Spartan II系列FPGA器件實(shí)現(xiàn)IP核的設(shè)計(jì)

精簡(jiǎn)指令集計(jì)算機(jī)RISC（Reduced Instruction Set Computer）是針對(duì)復(fù)雜指令集計(jì)算機(jī)CISC（Complex Instru...

2020-08-07 標(biāo)簽：fpga asic ip核 1.6k 0

ASIC單個(gè)模塊的設(shè)計(jì)和優(yōu)化思路

ASIC設(shè)計(jì)中詳細(xì)設(shè)計(jì)方案的確定非常重要，同樣的設(shè)計(jì)，別人可以用比你小30%的面積和少30%的處理時(shí)間來實(shí)現(xiàn)，這才是設(shè)計(jì)工程師的價(jià)值體現(xiàn)之處。任何設(shè)計(jì)在...

2022-10-12 標(biāo)簽：asic 寄存器 1.6k 0

如何構(gòu)建更涼爽、更密集的ASIC礦機(jī)鉆機(jī)

加密貨幣和其他區(qū)塊鏈技術(shù)是計(jì)算密集型的。目前的區(qū)塊鏈采礦設(shè)備依賴于數(shù)百個(gè)專用ASIC，這些ASIC消耗千瓦的功率進(jìn)行計(jì)算。用于為ASIC供電的轉(zhuǎn)換器必須...

2023-06-16 標(biāo)簽：轉(zhuǎn)換器電感器 asic 1.6k 0

賽靈思ASIC級(jí)UltraScale架構(gòu)要素及相關(guān)說明

ASIC級(jí)UltraScale架構(gòu)要素包括海量數(shù)據(jù)流、高度優(yōu)化的關(guān)鍵路徑、增強(qiáng)型DSP子系統(tǒng)、3D IC芯片間帶寬、海量I/O和存儲(chǔ)器帶寬、多區(qū)域類似A...

2013-07-09 標(biāo)簽：ASIC 電源管理賽靈思 1.6k 0

ASIC設(shè)計(jì)約束與SDC命令

根據(jù)ASIC邏輯設(shè)計(jì)，優(yōu)化的約束是速度和面積。在物理設(shè)計(jì)中，我們需要對(duì)面積、速度和功率進(jìn)行優(yōu)化設(shè)計(jì)。根據(jù)所需的技術(shù)節(jié)點(diǎn)和策略進(jìn)行更好的功耗規(guī)劃，總是有助...

2023-07-09 標(biāo)簽：asic 數(shù)字IC SDC 1.6k 0

通過無引腳MicroPak和有引腳PicoGate邏輯封裝實(shí)現(xiàn)邏輯器件微型化

微型邏輯器件封裝的尺寸只有傳統(tǒng)SO封裝的1/15，在空間受限的移動(dòng)應(yīng)用中大幅縮小了占位面積，現(xiàn)在也可用于汽車應(yīng)用。

2023-02-10 標(biāo)簽：asic 逆變器邏輯器件 1.6k 0

具有高級(jí)輸入和負(fù)載保護(hù)的10A μModule降壓型穩(wěn)壓器

總線電壓浪涌不僅對(duì) DC/DC 轉(zhuǎn)換器造成危險(xiǎn)，而且對(duì)負(fù)載也構(gòu)成危險(xiǎn)。涉及保險(xiǎn)絲的傳統(tǒng)過壓保護(hù)方案不一定足夠快，也不夠可靠，無法保護(hù)FPGA、ASIC和...

2023-04-19 標(biāo)簽：轉(zhuǎn)換器 ASIC 微處理器 1.6k 0

基于ASIC和VHDL語言實(shí)現(xiàn)成／解幀電路的設(shè)計(jì)

符合G.704 標(biāo)準(zhǔn)的E1 幀結(jié)構(gòu)如圖1 所示，每基本幀由32 個(gè)路時(shí)隙（ts0“ts31）組成，分別分配給30 個(gè)話音數(shù)據(jù)流和相應(yīng)輔助信息。每個(gè)路時(shí)隙...

2020-09-25 標(biāo)簽：asic 脈沖 vhdl 1.6k 0

224G 系統(tǒng)需要多大的 ASIC 封裝尺寸？

隨著電子設(shè)備越來越先進(jìn)，集成電路封裝尺寸也變得越來越小，但這不僅僅是為了提高引腳密度。較高的引腳密度對(duì)于具有許多互連的高級(jí)系統(tǒng)非常重要，但在更高級(jí)的網(wǎng)絡(luò)...

2024-05-25 標(biāo)簽：集成電路 asic 封裝 1.6k 0

IC設(shè)計(jì)中多時(shí)鐘域設(shè)計(jì)常用方法及其問題

假如考慮處理器和存儲(chǔ)器的工作頻率為500MHz，帶有存儲(chǔ)器控制器的浮點(diǎn)引擎的工作頻率為666.66MHz，總線接口和高速接口工作頻率為250MHz，則該...

2022-08-01 標(biāo)簽：處理器 fpga asic 1.6k 0

FPGA芯片結(jié)構(gòu)介紹及工作原理解析

由于FPGA需要被反復(fù)燒寫，它實(shí)現(xiàn)組合邏輯的基本結(jié)構(gòu)不可能像ASIC那樣通過固定的與非門來完成，而只能采用一種易于反復(fù)配置的結(jié)構(gòu)。

2022-12-27 標(biāo)簽：fpga asic sram 1.6k 0

專用集成電路技術(shù)有哪些特點(diǎn)

專用集成電路（Application-specific integrated circuit，簡(jiǎn)稱ASIC）是指按照特定應(yīng)用需求進(jìn)行設(shè)計(jì)和制造的集成電路...

2024-04-21 標(biāo)簽：asic 電子設(shè)備輸入信號(hào) 1.6k 0

帶相位擴(kuò)展器的VID控制器實(shí)現(xiàn)更高的輸出電流

FPGA、ASIC和處理器為高性能服務(wù)器、網(wǎng)絡(luò)和計(jì)算系統(tǒng)消耗的電流持續(xù)上升，100A或更高的負(fù)載電流正變得越來越普遍。同時(shí)，隨著電壓調(diào)節(jié)要求的更嚴(yán)格，芯...

2023-04-23 標(biāo)簽：處理器 fpga asic 1.6k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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識(shí)別

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語音交互

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PCB封裝庫(kù)

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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