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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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我們使用3x3模板進(jìn)行邊界提取,所以當(dāng)3x3九個(gè)點(diǎn)都是‘1’的時(shí)候,輸出為‘1’,當(dāng)九個(gè)點(diǎn)都是‘0’的時(shí)候,輸出為‘1’,其他情況輸出均為‘0’。
2018-03-26 標(biāo)簽:fpga 4.2k 0
基于FPGA器件和PCI9052芯片實(shí)現(xiàn)ARINC429數(shù)據(jù)接口卡的設(shè)計(jì)
在現(xiàn)代軍、民用飛機(jī)和導(dǎo)彈上,系統(tǒng)間需要傳輸大量信息,隨著數(shù)字技術(shù)的發(fā)展和微型電子計(jì)算機(jī)的出現(xiàn),越來越多的航空電子設(shè)備已經(jīng)采用航空數(shù)據(jù)總線進(jìn)行通訊。其中A...
40-nm FPGA的性能和8.5 Gbps收發(fā)器的具備功能
在這一4分鐘的視頻演示中,您將看到Altera新的40-nm FPGA展示其性能達(dá)到1.5-Gbps的LVDS以及具有優(yōu)異信號(hào)完整性的8.5-Gbps收...
信號(hào)在FPGA器件中通過邏輯單元連線時(shí),一定存在延時(shí)。延時(shí)的大小不僅和連線的長短和邏輯單元的數(shù)目有關(guān),而且也和器件的制造工藝、工作電壓、溫度等有關(guān)。
基于FPGA的高速嵌入式通信系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
針對CPCI架構(gòu)通用信號(hào)處理平臺(tái)上利用系統(tǒng)自身以太網(wǎng)絡(luò)接口實(shí)現(xiàn)數(shù)據(jù)傳輸效率低、擴(kuò)展性差等問題, 提出一種采用高速Link口基于FPGA上硬核PowerP...
如何通過FPGA和EPP技術(shù)對圖像傳感器進(jìn)行數(shù)據(jù)采集
圖1為基于FPGA和EPP技術(shù)對OV7620CMOS圖像傳感器的高速數(shù)據(jù)采集系統(tǒng)原理框圖,它主要由三部分組成:OV7620的參數(shù)配置電路、圖像采樣電路以...
2018-10-08 標(biāo)簽:傳感器fpga數(shù)據(jù)采集 4.2k 0
EEVBlog拆解:Rigol DL3021可編程直流電子負(fù)載
想必大家對EEVBlog已經(jīng)不陌生了,有著豐富電子開發(fā)經(jīng)驗(yàn)的工程師Dave Jones在該網(wǎng)站上發(fā)布各種電子設(shè)備的拆解視頻,并對設(shè)計(jì)的一些優(yōu)點(diǎn)和缺點(diǎn)給出...
在雷達(dá)信號(hào)處理中,為了對低速運(yùn)動(dòng)雜波進(jìn)行有效的抑制,研究了一種雜波速度譜圖的建立方法。此雜波速度譜圖的建立在FPGA中實(shí)現(xiàn),通過對雷達(dá)實(shí)際回波數(shù)據(jù)在FP...
基于FPGA的視頻圖像畫面分割器的軟硬件設(shè)計(jì)與實(shí)現(xiàn)
隨著計(jì)算機(jī)、DSP、超大規(guī)模集成電路等技術(shù)的發(fā)展,畫面分割器開始采用硬件設(shè)計(jì)。首先,將各路視頻信號(hào)轉(zhuǎn)換成數(shù)字視頻信號(hào);然后,在數(shù)字領(lǐng)域?qū)Ω髀芬曨l信號(hào)進(jìn)行...
本故障排除指南并未窮盡所有可能,但為使用JESD204B鏈路以及希望了解更多信息的工程師提供了一個(gè)很好的基本框架。
2022-01-10 標(biāo)簽:fpga發(fā)射器數(shù)據(jù)接口 4.2k 0
基于FPGA的數(shù)碼管動(dòng)態(tài)顯示
8個(gè)數(shù)碼管顯示從十進(jìn)制0開始計(jì)數(shù),每0.1s加1,一直加到十進(jìn)制數(shù)9999_9999,然后回到0重新計(jì)數(shù)。
基于FPGA乘法器的FIR 低通濾波器整體設(shè)計(jì)
針對傳統(tǒng)的FIR 濾波器的缺點(diǎn),介紹了一種基于FPGA 乘法器的FIR 濾波器設(shè)計(jì)方法,該濾波器利用FPGA 自帶的18位乘法器MULT18 × 18S...
以FPGA系統(tǒng)為核心的1553B總線接口設(shè)計(jì)
在總線接口模塊中,曼徹斯特編解碼是實(shí)現(xiàn)功能的核心部分,所以編碼數(shù)據(jù)和解碼數(shù)據(jù)是進(jìn)行功能驗(yàn)證時(shí)觀察的重點(diǎn)。為了觀察曼徹斯特編解碼是否正確,這里采用Xili...
基于PXI總線與FPGA器件實(shí)現(xiàn)雙通道高速數(shù)字化儀模塊的設(shè)計(jì)
PXI總線是NI公司在計(jì)算機(jī)外設(shè)總線PCI的基礎(chǔ)上實(shí)現(xiàn)的新一代儀器總線,已經(jīng)成為業(yè)界開放式總線的標(biāo)準(zhǔn),基于PXI總線的數(shù)字化儀模塊是現(xiàn)代測試系統(tǒng)中重要的...
2018-12-18 標(biāo)簽:fpga計(jì)算機(jī)總線 4.2k 0
FPGA數(shù)字變換器控制電路設(shè)計(jì)攻略 —電路圖天天讀(102)
以FPGA為控制核心,開展數(shù)字量變換器測試系統(tǒng)設(shè)計(jì),系統(tǒng)通過USB 實(shí)現(xiàn)與計(jì)算機(jī)的通信,能夠產(chǎn)生計(jì)算機(jī)字信號(hào)及相應(yīng)移位脈沖信號(hào)、勤務(wù)信號(hào)和128路指令信...
2015-02-03 標(biāo)簽:FPGA控制電路數(shù)字信號(hào)處理器 4.2k 0
FPGA 的 TLS 處理功能是 TCP 卸載引擎的擴(kuò)展,其中 TCP 有效載荷的加密與解密在 FPGA 中執(zhí)行。TSL 會(huì)話的發(fā)起與認(rèn)證在軟件中執(zhí)行(...
毫無疑問,隨著無線基礎(chǔ)設(shè)施發(fā)展到5G,它將變得更加普遍,并與我們?nèi)粘I畹姆椒矫婷嫱耆跒橐惑w。它將支持我們更高的帶寬需求,并擴(kuò)展到更多設(shè)備和應(yīng)用場景。
快手基于Alveo優(yōu)化大規(guī)模網(wǎng)絡(luò)直播和短視頻自動(dòng)語音識(shí)別服務(wù)
自動(dòng)語音識(shí)別(ASR)是電子商務(wù)、短視頻、直播等眾多應(yīng)用的核心技術(shù)之一。ASR 在快手有許多的應(yīng)用場景,是快手 APP、直播、風(fēng)控、游戲等眾多業(yè)務(wù)的核心...
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