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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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設(shè)備 IO 結(jié)構(gòu)中一個(gè)經(jīng)常被忽視的功能是 IDELAY2 和 ODELAY2 原語。這些原語為開發(fā)人員提供了一個(gè)由 32 個(gè)抽頭組成的可編程延遲線,可提...
Hello,大家好,之前給大家分享了大約一百多個(gè)關(guān)于FPGA的開源項(xiàng)目,涉及PCIe、網(wǎng)絡(luò)、RISC-V、視頻編碼等等,這次給大家?guī)淼氖遣豢菰锏膴蕵讽?xiàng)...
FPGA產(chǎn)業(yè)發(fā)展現(xiàn)狀分析
現(xiàn)場可編程門陣列 (FPGA) 是提供適應(yīng)性強(qiáng)且可更改的硬件功能的半導(dǎo)體。它們包含各種可變邏輯單元和可編程連接,允許個(gè)人制作和執(zhí)行個(gè)性化數(shù)字電路,而無需...
在Altera系列芯品上實(shí)現(xiàn)時(shí)間數(shù)字轉(zhuǎn)換電路的設(shè)計(jì)
早期 TDC電路通常由印刷線路板(PCB)上的分立元件組成,且通常是模擬-數(shù)字混合電路,因此功耗和體積較大、電路的一致性較差。超大規(guī)模集成電路(VLSI...
FPGA實(shí)現(xiàn)OFDM通信——FFT與IFFT應(yīng)用實(shí)現(xiàn)
HLS需要bit-reverse命令數(shù)據(jù)塊后端,所說的自然順序和一個(gè)O (N)轉(zhuǎn)換適用于FFT輸出提取的頻譜數(shù)據(jù)N-point真實(shí)數(shù)據(jù)集。注意,第一個(gè)輸...
FPGA_soc學(xué)習(xí)教程:使用DS-5編寫和調(diào)試SOC的Linux應(yīng)用程序
小梅哥最新款FPGA_SOC
2019-09-02 標(biāo)簽:fpgasoc應(yīng)用程序 3.1k 0
基于低成本FPGA開發(fā)板的Oberon系統(tǒng)介紹
由瑞士聯(lián)邦理工學(xué)院(ETH)Niklaus Wirth教授(已退休)撰寫 (節(jié)選自Xcell Journal最新期刊) 1998年,我和Jürg Gut...
2018-06-30 標(biāo)簽:fpga 3.1k 0
關(guān)于為FPGA應(yīng)用設(shè)計(jì)一個(gè)好的電源管理解決方案,已經(jīng)有很多技術(shù)討論,因?yàn)樗皇且患菀椎氖隆_@項(xiàng)任務(wù)的一個(gè)方面涉及找到正確的解決方案并選擇最合適的電源管...
2023-01-03 標(biāo)簽:電源fpga轉(zhuǎn)換器 3.1k 0
數(shù)字設(shè)計(jì)FPGA應(yīng)用:硬件描述語言與VIVADO
本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語言及VIVADO的應(yīng)用,并循序漸進(jìn)...
2019-12-05 標(biāo)簽:fpgaverilog hdlvivado 3.1k 0
24歲創(chuàng)業(yè),憑借基于賽靈思 FPGA 的深度學(xué)習(xí)方案,僅1年就融資數(shù)億的國內(nèi) AI 芯片初創(chuàng)公司深鑒科技(Deephi Tech)公司, 其創(chuàng)始人兼 C...
2018-06-26 標(biāo)簽:fpga深度學(xué)習(xí) 3.1k 0
基于PLX965芯片和EP2S60F1020器件實(shí)現(xiàn)柔性基線測量系統(tǒng)的設(shè)計(jì)
針對(duì)雙天線干涉SAR 基線測量系統(tǒng)數(shù)據(jù)量大、實(shí)時(shí)性要求高和體積小的特點(diǎn),設(shè)計(jì)并實(shí)現(xiàn)了一種基于FPGA + PCI 的實(shí)時(shí)數(shù)據(jù)采集存儲(chǔ)系統(tǒng)。 系統(tǒng)基于PC...
? 一、 軟件預(yù)設(shè)置 二、新建工程 三、添加源文件 四、添加管腳約束 五、添加GPIO 六、 PLL設(shè)置 七、IPM添加IP 八、 添加debug 九、...
2024-10-21 標(biāo)簽:FPGA 3.1k 0
基于FPGA和處理器實(shí)現(xiàn)單頻網(wǎng)適配器的應(yīng)用方案
作為地面數(shù)字電視的組網(wǎng)方式之一,單頻網(wǎng)(SingleFrequendy Network,SFN)具有節(jié)省頻率資源和能實(shí)現(xiàn)大范圍無線覆蓋的特點(diǎn),在世界各地...
基于FPGA器件EPXA10實(shí)現(xiàn)MPEG-2傳輸流解復(fù)用器的設(shè)計(jì)
隨著芯片技術(shù)的發(fā)展,F(xiàn)PGA的容量已經(jīng)達(dá)到上百萬門級(jí),從而使FPGA成為設(shè)計(jì)的選擇之一。Altera公司的FPGA芯片EPXA10應(yīng)用SOPC技術(shù),集高...
??set_input_delay屬于時(shí)序約束中的IO約束,我之前的時(shí)序約束教程中,有一篇關(guān)于set_input_delay的文章,但里面寫的并不是很詳...
對(duì)于實(shí)用性指紋識(shí)別模塊設(shè)計(jì)方案的詳細(xì)解析和應(yīng)用
項(xiàng)目背景及可行性分析 本項(xiàng)目名稱是:基于FPGA的指紋識(shí)別模塊設(shè)計(jì)。 主要內(nèi)容為:本模塊采用xilinx公司的Spartan 3E系列XC3S500E型...
基于軟件的空間輻照下FPGA可靠性設(shè)計(jì)方法
針對(duì)空間輻照效應(yīng)影響的高可靠性設(shè)計(jì),將越來越成為FPGA軟硬件設(shè)計(jì)的難點(diǎn)和重點(diǎn)。根據(jù)飛行器空間軌道的不同、輻射總劑量的差異,從硬件上,可以通過加厚屏蔽層...
基于單片機(jī)的車流量計(jì)數(shù)電路測試介紹
如圖所示為本設(shè)計(jì)的城市交叉路口智能交通控制系統(tǒng)示意圖,交叉路口的交通分為東西方向和南北方向,其中南北方向?yàn)榻煌ㄖ鞲傻?,東西方向?yàn)榻煌ǜ备傻?。不管南北方?..
2020-08-10 標(biāo)簽:fpga控制系統(tǒng)檢測器 3.1k 0
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