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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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深入淺出玩轉(zhuǎn)FPGA視頻:256色VGA顯示實(shí)驗(yàn)
VGA(Video Graphics Array)接口,也叫D-Sub接口。雖然液晶顯示器可以直接接收數(shù)字信號(hào),但很多低端產(chǎn)品為了與VGA接口顯卡相匹配...
深入淺出玩轉(zhuǎn)FPGA視頻:基于M4K塊的移位寄存器配置仿真實(shí)驗(yàn)
移位寄存器是一種在若干相同時(shí)間脈沖下工作的以觸發(fā)器為基礎(chǔ)的器件,數(shù)據(jù)以并行或串行的方式輸入到該器件中,然后每個(gè)時(shí)間脈沖依次向左或右移動(dòng)一個(gè)比特,在輸出端...
正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:CAN通信實(shí)驗(yàn)
CAN總線采用了多主競(jìng)爭(zhēng)式總線結(jié)構(gòu),具有多主站運(yùn)行和分散仲裁的串行總線以及廣播通信的特點(diǎn)。CAN總線上任意節(jié)點(diǎn)可在任意時(shí)刻主動(dòng)地向網(wǎng)絡(luò)上其它節(jié)點(diǎn)發(fā)送信息...
深入淺出玩轉(zhuǎn)FPGA視頻:基于FIFO的串口發(fā)送機(jī)設(shè)計(jì)
FIFO存儲(chǔ)器是一個(gè)先入先出的雙口緩沖器,即第一個(gè)進(jìn)入其內(nèi)的數(shù)據(jù)第一個(gè)被移出,其中一個(gè)是存儲(chǔ)器的輸入口,另一個(gè)口是存儲(chǔ)器的輸出口。對(duì)于單片F(xiàn)IFO來(lái)說(shuō),...
深入淺出玩轉(zhuǎn)FPGA視頻:基于SDRAM讀寫(xiě)的串口調(diào)試實(shí)驗(yàn)
SDRAM是多Bank結(jié)構(gòu),例如在一個(gè)具有兩個(gè)Bank的SDRAM的模組中,其中一個(gè)Bank在進(jìn)行預(yù)充電期間,另一個(gè)Bank卻馬上可以被讀取,這樣當(dāng)進(jìn)行...
深入淺出玩轉(zhuǎn)FPGA視頻:如何使用Time Quest
TimeQuest時(shí)序約束是作用在門級(jí)網(wǎng)表上的,因此在進(jìn)行時(shí)序約束前應(yīng)該首先編譯一邊工程,之后進(jìn)行時(shí)序約束并再次編譯進(jìn)行時(shí)序分析,直至無(wú)時(shí)序錯(cuò)誤為止,之...
鋯石FPGA A4_Nano開(kāi)發(fā)板視頻:紅外IP核的定制
根據(jù)IP使用的劃分,IP建立者可按下列三種形式設(shè)計(jì)IP:可再用、可重定目標(biāo)以及可配置??稍儆肐P是著眼于按各種再使用標(biāo)準(zhǔn)定義的格式和快速集成的要求而建立...
2019-10-08 標(biāo)簽:fpga開(kāi)發(fā)板ip核 1.8k 0
鋯石FPGA A4_Nano開(kāi)發(fā)板視頻:PS/2外設(shè)IP核的定制
PS/2接口是輸入裝置接口,而不是傳輸接口。所以PS2口根本沒(méi)有傳輸速率的概念,只有掃描速率。在Windows環(huán)境下,ps/2鼠標(biāo)的采樣率默認(rèn)為60次/...
FPGA視頻教程:SF-EP1C開(kāi)發(fā)板-DIY數(shù)碼相框
數(shù)碼相框外觀采用普通相框的造型,把原來(lái)相框中間的照片部分換成液晶顯示屏,配上電源,存儲(chǔ)介質(zhì)等,可以直接播放數(shù)碼照片,使得同一個(gè)相框內(nèi)可以循環(huán)播放照片,比...
數(shù)字設(shè)計(jì)FPGA應(yīng)用:VGA顯示的基本原理分析
本課程以目前流行的Xilinx 7系列FPGA的開(kāi)發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVADO的應(yīng)用,并循序漸進(jìn)...
鋯石FPGA A4_Nano開(kāi)發(fā)板視頻:AD IP核的定制
利用IP核設(shè)計(jì)電子系統(tǒng),引用方便,修改基本元件的功能容易。具有復(fù)雜功能和商業(yè)價(jià)值的IP核一般具有知識(shí)產(chǎn)權(quán),盡管IP核的市場(chǎng)活動(dòng)還不規(guī)范,但是仍有許多集成...
2019-12-19 標(biāo)簽:fpga開(kāi)發(fā)板ip核 2.4k 0
FPGA_soc學(xué)習(xí)教程:應(yīng)用驅(qū)動(dòng)程序的編寫(xiě)
小梅哥最新款FPGA_SOC
2019-09-02 標(biāo)簽:fpgasoc驅(qū)動(dòng)程序 2.8k 0
FPGA_soc學(xué)習(xí)教程:Linux應(yīng)用程序的驅(qū)動(dòng)/編寫(xiě)與編譯
小梅哥最新款FPGA_SOC
2019-09-02 標(biāo)簽:fpgalinux應(yīng)用程序 2k 0
鋯石FPGA A4_Nano開(kāi)發(fā)板視:PS/2外設(shè)IP核的應(yīng)用
IP核有三種不同的存在形式:HDL語(yǔ)言形式,網(wǎng)表形式、版圖形式。分別對(duì)應(yīng)我們常說(shuō)的三類IP內(nèi)核:軟核、固核和硬核。這種分類主要依據(jù)產(chǎn)品交付的方式,而這三...
基于FPGA器件的VGA顯示設(shè)計(jì)與實(shí)現(xiàn)
中國(guó)大學(xué)MOOC 本課程以目前流行的Xilinx 7系列FPGA的開(kāi)發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVAD...
時(shí)序邏輯:FPGA/ASIC電路結(jié)構(gòu)
FPGA采用了邏輯單元陣列LCA(Logic Cell Array)這樣一個(gè)概念,內(nèi)部包括可配置邏輯模塊CLB(Configurable Logic B...
深入淺出玩轉(zhuǎn)fpga視頻教程:課程概述與如何學(xué)好FPGA技術(shù)
FPGA的工作頻率由FPGA芯片以及設(shè)計(jì)決定,可以通過(guò)修改設(shè)計(jì)或者更換更快的芯片來(lái)達(dá)到某些苛刻的要求(當(dāng)然,工作頻率也不是無(wú)限制的可以提高,而是受當(dāng)前的...
FPGA設(shè)計(jì)的主要難點(diǎn)是熟悉硬件系統(tǒng)以及內(nèi)部資源,保證設(shè)計(jì)的語(yǔ)言能夠?qū)崿F(xiàn)元器件之間的有效配合,提高程序的可讀性以及利用率。這也對(duì)設(shè)計(jì)人員提出了比較高的要...
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