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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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鋯石FPGA A4_Nano開發(fā)板視頻:讓你的Qsys系統(tǒng)上電自啟動(dòng)
QSYS是SoPC Builder的新一代產(chǎn)品。QSYS系統(tǒng)集成工具自動(dòng)生成互聯(lián)邏輯,連接IP和子系統(tǒng)QSYS的設(shè)計(jì)理念是提高設(shè)計(jì)抽象級(jí),從而使機(jī)器...
鋯石FPGA A4_Nano開發(fā)板視頻:NiOS II硬件框架結(jié)構(gòu)深入剖析(1)
Nios Ⅱ處理器具有完善的軟件開發(fā)套件,包括編譯器、集成開發(fā)環(huán)境(IDE)、JTAG調(diào)試器、實(shí)時(shí)操作系統(tǒng)(RTOS)和TCP/IP協(xié)議棧。
鋯石FPGA A4_Nano開發(fā)板視頻:Avalon總線規(guī)范的講解
Nios系統(tǒng)的所有外設(shè)都是通過(guò)Avalon總線與Nios CPU相接的,Avalon總線是一種協(xié)議較為簡(jiǎn)單的片內(nèi)總線,Nios通過(guò)Avalon總線與外界...
鋯石FPGA A4_Nano開發(fā)板視頻:內(nèi)置IP核UART的理論原理講解
UART將要傳輸?shù)馁Y料在串行通信與并行通信之間加以轉(zhuǎn)換。作為把并行輸入信號(hào)轉(zhuǎn)成串行輸出信號(hào)的芯片,UART通常被集成于其他通訊接口的連結(jié)上。
鋯石FPGA A4_Nano開發(fā)板視頻:內(nèi)置IP核SPI的理論原理講解
SPI是串行外設(shè)接口(Serial Peripheral Interface)的縮寫,是一種高速的,全雙工,同步的通信總線,并且在芯片的管腳上只占用四根...
鋯石FPGA A4_Nano開發(fā)板視頻:NiOS II軟件框架結(jié)構(gòu)深入剖析
Nios Ⅱ處理器核 Nios Ⅱ處理器系列由三個(gè)不同的內(nèi)核組成,可以靈活地控制成本和性能,從而擁有廣泛的應(yīng)用空間。
鋯石FPGA A4_Nano開發(fā)板視頻:定制最基本LED的IP核
IP主要分為軟IP、固IP和硬IP。軟IP是用Verilog/VHDL等硬件描述語(yǔ)言描述的功能塊,但是并不涉及用什么具體電路元件實(shí)現(xiàn)這些功能。固IP是完...
鋯石FPGA A4_Nano開發(fā)板視頻:VGA PIO的應(yīng)用
PIO,為parts in one 的簡(jiǎn)稱,即可自由組裝成一體電腦的新型準(zhǔn)電腦,它把顯示器、機(jī)箱、電源、光驅(qū)和鍵鼠融為一體,需自由購(gòu)買CPU 、主板、硬...
鋯石FPGA A4_Nano開發(fā)板視頻:蜂鳴器IP核的定制
蜂鳴器是一種一體化結(jié)構(gòu)的電子訊響器,采用直流電壓供電,廣泛應(yīng)用于計(jì)算機(jī)、打印機(jī)、復(fù)印機(jī)、報(bào)警器、電子玩具、汽車電子設(shè)備、電話機(jī)、定時(shí)器等電子產(chǎn)品中作發(fā)聲器件。
鋯石FPGA A4_Nano開發(fā)板視頻:DA PIO的應(yīng)用
DA指數(shù)模轉(zhuǎn)換(Digital to Analog),顧名思義,就是把數(shù)字信號(hào)轉(zhuǎn)換成模擬信號(hào)。與DA相對(duì)應(yīng),AD是把模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào),便于計(jì)算機(jī)等...
鋯石FPGA A4_Nano開發(fā)板視頻:Avalon總線規(guī)范的講解(2)
Nios系統(tǒng)的所有外設(shè)都是通過(guò)Avalon總線與Nios CPU相接的,Avalon總線是一種協(xié)議較為簡(jiǎn)單的片內(nèi)總線,Nios通過(guò)Avalon總線與外界...
鋯石FPGA A4_Nano開發(fā)板視頻:DA外設(shè)IP核定制
IP核有三種不同的存在形式:HDL語(yǔ)言形式,網(wǎng)表形式、版圖形式。分別對(duì)應(yīng)我們常說(shuō)的三類IP內(nèi)核:軟核、固核和硬核。這種分類主要依據(jù)產(chǎn)品交付的方式,而這三...
鋯石FPGA A4_Nano開發(fā)板視頻:LED的IP核應(yīng)用
利用IP核設(shè)計(jì)電子系統(tǒng),引用方便,修改基本元件的功能容易。具有復(fù)雜功能和商業(yè)價(jià)值的IP核一般具有知識(shí)產(chǎn)權(quán),盡管IP核的市場(chǎng)活動(dòng)還不規(guī)范,但是仍有許多集成...
鋯石FPGA A4_Nano開發(fā)板視頻:DA外設(shè)IP核制作
IP主要分為軟IP、固IP和硬IP。軟IP是用Verilog/VHDL等硬件描述語(yǔ)言描述的功能塊,但是并不涉及用什么具體電路元件實(shí)現(xiàn)這些功能。固IP是完...
數(shù)字設(shè)計(jì)FPGA應(yīng)用:7系列FPGA及7a35tftg256-1特性
本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVADO的應(yīng)用,并循序漸進(jìn)...
數(shù)字設(shè)計(jì)FPGA應(yīng)用:FPGA的基本實(shí)踐
本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVADO的應(yīng)用,并循序漸進(jìn)...
數(shù)字設(shè)計(jì)FPGA應(yīng)用:硬件描述語(yǔ)言與VIVADO
本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVADO的應(yīng)用,并循序漸進(jìn)...
2019-12-05 標(biāo)簽:fpgaverilog hdlvivado 3.1k 0
數(shù)字設(shè)計(jì)FPGA應(yīng)用:74x163回顧
本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVADO的應(yīng)用,并循序漸進(jìn)...
數(shù)字設(shè)計(jì)FPGA應(yīng)用:時(shí)序邏輯電路FPGA的實(shí)現(xiàn)
本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVADO的應(yīng)用,并循序漸進(jìn)...
FPGA視頻教程:SF-EP1C開發(fā)板-基于M4K塊的單口RAM配置仿真實(shí)驗(yàn)
隨機(jī)存取存儲(chǔ)器(RAM)既可向指定單元存入信息又可從指定單元讀出信息。任何RAM中存儲(chǔ)的信息在斷電后均會(huì)丟失,所以RAM是易失性存儲(chǔ)器。ROM為只讀存儲(chǔ)...
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