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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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串行背板技術(shù)面臨新挑戰(zhàn) Xilinx推出串行背板解決方案
盡管串行技術(shù)的應(yīng)用已日益普遍,但許多設(shè)計(jì)挑戰(zhàn)依然橫亙在設(shè)計(jì)人員面前。背板子系統(tǒng)是整個(gè)系統(tǒng)的“心臟”,它必須能夠在板卡間提供可靠的信號傳輸。因此,在背板設(shè)...
采用FPGA實(shí)現(xiàn)的紅外密集度光電立靶測試系統(tǒng)
光電靶的基本原理是:當(dāng)光幕內(nèi)的光通量發(fā)生足夠大的變化時(shí),光電傳感器會(huì)響應(yīng)這種變化而產(chǎn)生電信號。##電路原理。
最近幾年,F(xiàn)PGA這個(gè)概念越來越多地出現(xiàn)。例如,比特幣挖礦,就有使用基于FPGA的礦機(jī)。還有,之前微軟表示,將在數(shù)據(jù)中心里,使用FPGA“代替”CPU,...
基于Feature架構(gòu)設(shè)計(jì)的百兆以太網(wǎng)交換機(jī)項(xiàng)目
第二代交換機(jī)有更豐富的feature,更貼近真正使用的功能,除rtl代碼,詳細(xì)設(shè)計(jì)文檔外,還會(huì)包括驗(yàn)證環(huán)境、驗(yàn)證代碼,最后項(xiàng)目完成后,會(huì)全部開源供大家學(xué)...
深度剖析FPGA實(shí)現(xiàn)ARM系統(tǒng)處理的解決方案
基于FPGA的單芯片實(shí)現(xiàn)方法具有低成本和快速面市等優(yōu)點(diǎn),是多芯片和ASICSoC非常有吸引力的替代方案
采用FPGA與嵌入式CPU大容量數(shù)據(jù)存儲(chǔ)實(shí)現(xiàn)航空視頻采集記錄系統(tǒng)設(shè)計(jì)
在航空視頻采集記錄系統(tǒng)中,攝像頭把載機(jī)任務(wù)系統(tǒng)的實(shí)時(shí)畫面視頻數(shù)據(jù)按預(yù)定格式組幀,通過LVDS信號總線傳輸給視頻采集模塊;經(jīng)過視頻采集模塊對LVDS信號電...
Zynq及Vitis HLS助力面向聲音合成和聲學(xué)控制的低時(shí)延技術(shù)
從音頻輸入到輸出,現(xiàn)有的實(shí)時(shí)數(shù)字音頻系統(tǒng)很難實(shí)現(xiàn)低于 1ms 的時(shí)延。實(shí)際上,200μs 是到目前為止可實(shí)現(xiàn)的最佳時(shí)延。
人們對電池供電的便攜式小工具和器件的需求量大增,數(shù)字電路的能耗成為一個(gè)重要的關(guān)注點(diǎn)。計(jì)算和處理變得越來越復(fù)雜,需要速度更快的器件,例如現(xiàn)場可編程門陣列(...
FPGA延時(shí)Verilog HDL實(shí)現(xiàn)
可以在任意時(shí)刻啟動(dòng),可以重復(fù)啟動(dòng),延時(shí)時(shí)長可調(diào),單位可切換(ms/us),在50MHz時(shí)鐘下的延時(shí)范圍是1ms-85899ms/1us-85899us。
89C51單片機(jī)和FPGA為控制核心的程控濾波器設(shè)計(jì)
濾波器是一種用來消除干擾雜訊的器件,可用于對特定頻率的頻點(diǎn)或該頻點(diǎn)以外的頻率進(jìn)行有效濾除。它在電子領(lǐng)域中占有很重要的地位,在信號處理、抗干擾處理、電力系...
2020-01-25 標(biāo)簽:fpga89C51單片機(jī)程控濾波器 1.5k 0
利用中端FPGA實(shí)現(xiàn)低成本網(wǎng)絡(luò)
從網(wǎng)絡(luò)的核心模塊到邊緣設(shè)備,都在經(jīng)歷著巨大的變革。無線市場與其數(shù)千萬的“永遠(yuǎn)在線”連接、下一代回程通信的巨大傳輸壓力,以及各種為使用現(xiàn)有有線通信基礎(chǔ)設(shè)施...
偶數(shù)倍分頻器的實(shí)現(xiàn)非常簡單,只需要一個(gè)計(jì)數(shù)器進(jìn)行計(jì)數(shù)就能實(shí)現(xiàn)。如需要N分頻器(N為偶數(shù)),就可以由待分頻的時(shí)鐘觸發(fā)計(jì)數(shù)器進(jìn)行計(jì)數(shù),當(dāng)計(jì)數(shù)器從0計(jì)數(shù)到N/...
偶數(shù)倍分頻器的實(shí)現(xiàn)非常簡單,只需要一個(gè)計(jì)數(shù)器進(jìn)行計(jì)數(shù)就能實(shí)現(xiàn)。如需要N分頻器(N為偶數(shù)),就可以由待分頻的時(shí)鐘觸發(fā)計(jì)數(shù)器進(jìn)行計(jì)數(shù),當(dāng)計(jì)數(shù)器從0計(jì)數(shù)到N/...
電源抑制比 (PSRR) 用于衡量 LDO 清除或抑制由上游其他元件傳入噪聲的能力。對于高端 ADC,為了更大限度地減少位錯(cuò)誤,輸入電源噪聲要求不斷提高。
2022-03-09 標(biāo)簽:fpgaldo數(shù)據(jù)轉(zhuǎn)換器 1.5k 0
電路設(shè)計(jì)常見的八個(gè)誤區(qū):現(xiàn)象一:這板子的PCB設(shè)計(jì)要求不高,就用細(xì)一點(diǎn)的線,自動(dòng)布吧;現(xiàn)象二:這些總線信號都用電阻拉一下,感覺放心些;現(xiàn)象三:CPU和F...
2016-12-28 標(biāo)簽:fpgaPCB電路設(shè)計(jì) 1.5k 0
FPGA系統(tǒng)中有源電容放電電路設(shè)計(jì)需注意哪些問題
電信設(shè)備,服務(wù)器和數(shù)據(jù)中心的FPGA具有多個(gè)電源軌,需要正確排序才能安全地為這些系統(tǒng)上下供電。高可靠性DC-DC穩(wěn)壓器和FPGA電源管理的設(shè)計(jì)人員需要一...
使用傳統(tǒng)的Verilog和VHDL設(shè)計(jì)流程支持這些特性的實(shí)現(xiàn),仍然會(huì)繼續(xù)主導(dǎo)FPGA設(shè)計(jì)流程。但是,還有其他設(shè)計(jì)流程。OpenCL是GP-GPU編程人員...
系統(tǒng)設(shè)計(jì)日益復(fù)雜 要求高性能FPGA的設(shè)計(jì)與PCB設(shè)計(jì)并行進(jìn)行
復(fù)雜度日益增加的系統(tǒng)設(shè)計(jì)要求高性能FPGA的設(shè)計(jì)與PCB設(shè)計(jì)并行進(jìn)行。通過整合FPGA和PCB設(shè)計(jì)工具以及采用高密度互連(HDI)等先進(jìn)的制造工藝,這種...
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