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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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JPEG2000 MQ編碼算法的優(yōu)化和FPGA實(shí)現(xiàn)
MQ編碼是一種無損數(shù)據(jù)壓縮技術(shù),已被JPEG2000標(biāo)準(zhǔn)采用,其高復(fù)雜度成為JPEG2000系統(tǒng)實(shí)現(xiàn)的速度瓶頸。本文在分析MQ編碼算法軟件流程的基礎(chǔ)上...
AMP或SMP: Zynq SoC操作系統(tǒng)在無線應(yīng)用中應(yīng)考慮的因素
使用Zynq SoC器件可以有效地實(shí)現(xiàn)包括無線電和無線回程在內(nèi)的比較主要的無線應(yīng)用,而廣播無線電的應(yīng)用尤為如此。在該應(yīng)用中,Zynq SoC器件的片上處...
在FPGA中實(shí)現(xiàn)嵌入式TCP/IP通信協(xié)議棧
研究了嵌入式TCP/IP通信協(xié)議棧在Xilinx FPGA上的實(shí)現(xiàn),介紹了其軟硬件的系統(tǒng)組成和原理,提出一種實(shí)時(shí)操作系統(tǒng)上TCP/IP協(xié)議棧的高效工作模...
搭配最佳供電序列方案 FPGA系統(tǒng)電源管理效率大增
設(shè)計(jì)現(xiàn)場(chǎng)可編程閘極數(shù)組(FPGA)時(shí),供電序列為重要考慮因素。由于設(shè)計(jì)需求可能介于三軌至十軌以上,F(xiàn)PGA廠商通常會(huì)明定電源序列要求。若遵循建議的電源序...
2017-11-17 標(biāo)簽:fpga 1.5k 0
運(yùn)用示波器和用戶可定義的FPGA提高測(cè)量質(zhì)量與速度
示波器的需求急速成長,同時(shí)新的研究和測(cè)試應(yīng)用也需要更多、更快、更復(fù)雜的訊號(hào)。 這會(huì)需要更具智能功能的測(cè)試設(shè)備,才能準(zhǔn)確偵測(cè)特定的訊號(hào)狀況并避免空滯時(shí)間、...
Petalinux的網(wǎng)絡(luò)數(shù)據(jù)傳輸性能測(cè)試
介紹一種針對(duì)MicroBlaze軟核處理器特別開發(fā)的嵌入式操作系統(tǒng)Petalinux,成功地實(shí)現(xiàn)了其在ML507開發(fā)板上的移植,并且通過LabVIEW軟...
2017-11-17 標(biāo)簽:fpga 2.9k 0
基于FPGA的智能卡驗(yàn)證平臺(tái)設(shè)計(jì)
隨著集成電路設(shè)計(jì)技術(shù)的發(fā)展和芯片集成度的提高,驗(yàn)證已經(jīng)成為芯片設(shè)計(jì)流程中的主要瓶頸。本文設(shè)計(jì)了一個(gè)基于FPGA的智能卡驗(yàn)證平臺(tái),并對(duì)驗(yàn)證方法做了詳細(xì)闡述...
2017-11-17 標(biāo)簽:fpga 1.5k 0
ZYNQ7000與傳統(tǒng)FPGA有著巨大的差異,它將自己定位為一款A(yù)ll Programmable Soc(軟硬件可編程片上系統(tǒng)),視其為以FPGA作為外...
基于FPGA的高精度同步時(shí)鐘系統(tǒng)設(shè)計(jì)
介紹了精密時(shí)鐘同步協(xié)議(PTP)的原理。本文精簡(jiǎn)了該協(xié)議,設(shè)計(jì)并實(shí)現(xiàn)了一種低成本、高精度的時(shí)鐘同步系統(tǒng)方案。該方案中,本地時(shí)鐘單元、時(shí)鐘協(xié)議模塊、發(fā)送緩...
基于FPGA的速度和位置測(cè)量板卡的設(shè)計(jì)與實(shí)現(xiàn)
針對(duì)增量式光電編碼器經(jīng)典速度測(cè)量算法M/T法低速采樣時(shí)間過長和位置測(cè)量算法精度不高的問題,本文基于定采樣周期M/T法設(shè)計(jì)實(shí)現(xiàn)了速度和位置測(cè)量板卡。采用X...
使用FPGA優(yōu)化視頻水印操作的OpenCL應(yīng)用
賽靈思SDAccel開發(fā)環(huán)境為內(nèi)存限制問題提供優(yōu)化方法.視頻流和下載通常會(huì)耗掉消費(fèi)者絕大部分互聯(lián)網(wǎng)流量,同時(shí)也是云計(jì)算技術(shù)發(fā)展的主要推動(dòng)力。對(duì)視頻流和下...
基于Xllinx Vivado HLS的小型無人機(jī)平衡儀設(shè)計(jì)
小型無人機(jī)在航拍、災(zāi)害救援、防火等領(lǐng)域得到廣泛運(yùn)用,但是無人機(jī)操作復(fù)雜,尤其是控制飛行姿態(tài)平穩(wěn)、航線準(zhǔn)確和降落平滑,對(duì)地面人員的操作水平要求較高。操作問...
本教程介紹了如何使用μC/ OS BSP建立在ZYNQ基本應(yīng)用程序?使用Vivado -7000 ? IDE和賽靈思? SDK。在本教程中,您將使用Vi...
FPGA開發(fā)之算法開發(fā)System Generator
現(xiàn)在的FPGA算法的實(shí)現(xiàn)有下面幾種方法: 1. Verilog/VHDL 語言的開發(fā) ; 2. system Generator; 3. ImpulsC...
智能城市利用信息和通信網(wǎng)絡(luò)以及互聯(lián)網(wǎng)技術(shù)來解決城市難題,旨在大幅改善宜居性和資源可持續(xù)性。預(yù)測(cè)顯示[1],全球智能城市產(chǎn)業(yè)到 2020年市值將超過 40...
優(yōu)化基于FPGA的深度卷積神經(jīng)網(wǎng)絡(luò)的加速器設(shè)計(jì)
CNN已經(jīng)廣泛用于圖像識(shí)別,因?yàn)樗苣7律镆曈X神經(jīng)的行為獲得很高識(shí)別準(zhǔn)確率。最近,基于深度學(xué)習(xí)算法的現(xiàn)代應(yīng)用高速增長進(jìn)一步改善了研究和實(shí)現(xiàn)。特別地,多...
基于FPGA的軟件無線電載波同步技術(shù)設(shè)計(jì)與實(shí)現(xiàn)
同步系統(tǒng)工作的好壞,在很大程度上決定了通信系統(tǒng)的質(zhì)量。GPS接收機(jī)將天線接收到的衛(wèi)星信號(hào)經(jīng)射頻前端處理后變成了數(shù)字中頻信號(hào),接收機(jī)對(duì)GPS衛(wèi)星的信號(hào)處理...
云中的機(jī)器學(xué)習(xí):FPGA上的深度神經(jīng)網(wǎng)絡(luò)
憑借出色的性能和功耗指標(biāo),賽靈思 FPGA 成為設(shè)計(jì)人員構(gòu)建卷積神經(jīng)網(wǎng)絡(luò)的首選。新的軟件工具可簡(jiǎn)化實(shí)現(xiàn)工作。人工智能正在經(jīng)歷一場(chǎng)變革,這要得益于機(jī)器學(xué)習(xí)...
2017-11-17 標(biāo)簽:fpga深度神經(jīng)網(wǎng)絡(luò) 1.8k 0
基于圖像增強(qiáng)的去霧快速算法的FPGA實(shí)現(xiàn)
本文提出了一種使用亮度映射的圖像去霧快速算法。此算法通過調(diào)整室外多霧場(chǎng)景圖像的對(duì)比度,提高了霧中物體的辨識(shí)度。算法的復(fù)雜度低、處理延遲小,實(shí)時(shí)性高,利于...
2017-11-17 標(biāo)簽:fpga快速算法圖像增強(qiáng) 6k 0
基于SRIO的FPGA間數(shù)據(jù)交互系統(tǒng)設(shè)計(jì)與應(yīng)用
基于時(shí)分長期演進(jìn)(timedivision- longtermevolution,TD-LTE)射頻一致性測(cè)試系統(tǒng)中數(shù)據(jù)交互的分析研究,為了很好地滿足現(xiàn)...
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