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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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利用LabVIEW FPGA模塊構(gòu)建靈活的發(fā)動(dòng)機(jī)仿真器
"利用LabVIEW FPGA模塊在NI PXI-7831R可重配置I/O板卡的FPGA上編程,不但使我們的系統(tǒng)性能超過了規(guī)格要求,還節(jié)省了90%的硬件...
利用中間件可將Zynq SoC轉(zhuǎn)變?yōu)閯?dòng)態(tài)再分配處理平臺(tái)
過去三十多年來,F(xiàn)PGA 技術(shù)已從最初帶有少量寄存器的可編程邏輯陣列演變?yōu)槿缃裎覀兯吹降母呒?jí)集成式系統(tǒng)器件。大約在十多年前,各大廠商首次開始在他們的F...
工程設(shè)計(jì)項(xiàng)目中最令人振奮的時(shí)刻之一就是第一次將硬件移到實(shí)驗(yàn)室準(zhǔn)備開始集成測試的時(shí)候。開發(fā)過程中的這個(gè)階段通常需要很長時(shí)間,也會(huì)對(duì)所有的項(xiàng)目工程師造成很大...
2017-11-18 標(biāo)簽:fpga 795 0
如何使用gprof對(duì)軟件做profiling (一)
Xilinx推出的Zynq-7000系列芯片很好的解決了這一問題。它內(nèi)含硬化好的CPU核和常見的外設(shè)(DRAM控制器,千兆以太網(wǎng),USB 2.0 OTG...
2017-11-18 標(biāo)簽:fpga 3.1k 0
用Zynq SoC實(shí)現(xiàn)Red Pitaya開源儀器
最新Red Pitaya計(jì)劃有助于從一個(gè)平臺(tái)輕松、低成本地開發(fā)出眾多不同版本的儀器。在電子工業(yè)的早期,示波器、信號(hào)發(fā)生器等測試測量設(shè)備功能固定,只能執(zhí)行...
Zynq SoC構(gòu)建LTE小型蜂窩基站的設(shè)計(jì)基礎(chǔ)
Zynq SoC的高性能可編程邏輯和ARM處理器可讓客戶打造出能夠滿足當(dāng)前及新一代無線設(shè)備不斷提高的傳輸帶寬需求的設(shè)計(jì)方案。設(shè)計(jì)團(tuán)隊(duì)可在Zynq SoC...
Virtex-7 FPGA Gen3 Integrated Block 的 TAG 管理
在 PCIE 系統(tǒng)里面,TAG 管理是一個(gè)重要的問題。用戶邏輯依賴于 TAG 來定位 completion對(duì)應(yīng)于哪個(gè) Non-Posted 事務(wù)。所以,...
2017-11-18 標(biāo)簽:fpga 2.1k 0
基于FPGA的高幀頻面陣CCD驅(qū)動(dòng)控制設(shè)計(jì)
針對(duì)面陣CCD KAI-1020 在高幀頻工作模式下的驅(qū)動(dòng)要求,以FPGA 作為控制單元及時(shí)序發(fā)生器,完成CCD 高幀頻工作模式下的硬件及軟件設(shè)計(jì),仿真...
基于89c54的遠(yuǎn)程動(dòng)態(tài)可重構(gòu)技術(shù)原理及實(shí)現(xiàn)方法
提出了一種FPGA 遠(yuǎn)程動(dòng)態(tài)重構(gòu)的方法,結(jié)合FPGA動(dòng)態(tài)重構(gòu)技術(shù)和GSM通信技術(shù)來實(shí)現(xiàn)。利用GSM技術(shù)實(shí)現(xiàn)配置數(shù)據(jù)的無線傳輸,在單片機(jī)控制下將數(shù)據(jù)存儲(chǔ)于...
2017-11-18 標(biāo)簽:fpga 2k 0
一種基于FPGA嵌入式系統(tǒng)的雷達(dá)信號(hào)模擬器的實(shí)現(xiàn)
提出了一種基于FPGA的雷達(dá)回波實(shí)時(shí)模擬器的實(shí)現(xiàn)方法。該模擬器采用cPCI 標(biāo)準(zhǔn)總線,以FPGA 為核心計(jì)算單元,配有高速數(shù)模、模數(shù)轉(zhuǎn)換模塊,可實(shí)現(xiàn)雷達(dá)...
2017-11-18 標(biāo)簽:fpgaadc08d1500ad9736 3.6k 0
高速高精度的數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
設(shè)計(jì)了基于FPGA與ARM 芯片的數(shù)據(jù)采集系統(tǒng),F(xiàn)PGA 負(fù)責(zé)控制A/D轉(zhuǎn)換器,保證了采樣精度與處理速度,ARM負(fù)責(zé)邏輯控制及與上位機(jī)交互的實(shí)現(xiàn),并將采...
一種基于FPGA的SDRAM設(shè)計(jì)與邏輯時(shí)序分析
由于同步動(dòng)態(tài)隨機(jī)存儲(chǔ)器SDRAM內(nèi)部結(jié)構(gòu)原因?qū)е缕淇刂七壿嫳容^復(fù)雜。現(xiàn)場可編程邏輯門陣列FPGA作為一種半定制電路具有速度快、內(nèi)部資源豐富、可重構(gòu)等優(yōu)點(diǎn)...
基于Zedboard FPGA的VGA圖像信號(hào)采集系統(tǒng)的設(shè)計(jì)
根據(jù)VGA(Video Graphic Array)的原理,采用VHDL硬件描述語言,設(shè)計(jì)了一種基于Zedboard FPGA板卡的圖像顯示方案。實(shí)驗(yàn)結(jié)...
設(shè)計(jì)了一款面向嵌入式控制領(lǐng)域的16位堆棧處理器,該處理器包含兩個(gè)堆棧:執(zhí)行數(shù)學(xué)表達(dá)式的數(shù)據(jù)堆棧和支持子程序調(diào)用的返回堆棧,其指令集含35條堆棧指令.詳細(xì)...
在FPGA中,隨著信號(hào)處理的層次加深,對(duì)信號(hào)進(jìn)行乘、累加、濾波等運(yùn)算后,可能輸入時(shí)僅為8位位寬的信號(hào)會(huì)擴(kuò)展成幾十位位寬,位寬越寬,占用的硬件資源就越多,...
基于FPGA的視覺導(dǎo)航小車設(shè)計(jì)與實(shí)現(xiàn)
視覺導(dǎo)航作為新興起的技術(shù),受眾多研究者的青睞.設(shè)計(jì)了以現(xiàn)場可編程門列陣(FPGA)為控制核心的自主導(dǎo)航小車,采用一種新穎的自適應(yīng)路徑識(shí)別算法實(shí)現(xiàn)路徑的識(shí)...
在L波段數(shù)字航空通信系統(tǒng)(L-DACS1 )中,不同類型的數(shù)據(jù)采用不同速率傳輸,為了降低信道的噪聲和畸變與多普勒頻移的影響,采用具有良好差錯(cuò)控制能力的多...
通常基于傳統(tǒng)處理器的C是串行執(zhí)行,本文介紹Xilinx Vivado-HLS基于FPGA與傳統(tǒng)處理器對(duì)C編譯比較,差別。對(duì)傳統(tǒng)軟件工程師看來C是串行執(zhí)行...
光開關(guān)模塊控制電路工作時(shí)序的FPGA實(shí)現(xiàn)方法
本文提出一種光開關(guān)模塊控制電路的FPGA設(shè)計(jì)方法。通過硬件設(shè)置通道,由FPGA 讀入通道信息后對(duì)其進(jìn)行譯碼,并送到光開關(guān)的驅(qū)動(dòng)電路。光開關(guān)通道切換成功標(biāo)...
一種基于FPGA的數(shù)字秒表設(shè)計(jì)方法
文中介紹了一種基于FPGA的數(shù)字秒表設(shè)計(jì)方法。采用VHDL硬件描述語言,運(yùn)用ModelSim等EDA仿真工具。該設(shè)計(jì)具有外圍電路少、集成度高、可靠性強(qiáng)等...
2017-11-18 標(biāo)簽:fpga數(shù)字集成電路 1.1萬 0
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