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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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這篇文章是俄國人Sergei P.Skorobogatov就讀英吉利劍橋大學(xué)之博士論文,講解了各種MCU的攻防技術(shù),堪稱一部小百科全書。對于志在研究MC...
JESD204B標(biāo)準(zhǔn)的ADC與FPGA的接口
與現(xiàn)有接口格式和協(xié)議相比,JESD204B接口更復(fù)雜、更微妙,必須克服一些困難才能實(shí)現(xiàn)其優(yōu)勢。像其他標(biāo)準(zhǔn)一樣,要使該接口比單倍數(shù)據(jù)速率或雙倍數(shù)據(jù)速率CM...
2022-04-21 標(biāo)簽:fpga轉(zhuǎn)換器adc 6.3k 0
FPGA中并行計(jì)算的流水線計(jì)算和交替計(jì)算
用過FPGA的人應(yīng)該都知道,在FPGA中,邏輯是并行地運(yùn)行的,各個(gè)狀態(tài)機(jī)同時(shí)都在工作,狀態(tài)機(jī)之間可能會有信號交互,也可能毫無關(guān)系、各管各地工作。
匯總DC/DC轉(zhuǎn)換器內(nèi)部開發(fā)的誤區(qū)
復(fù)雜的現(xiàn)代電路通常包含大量元器件,例如微控制器、IC、DSP 和 FPGA 等。每個(gè)元器件均具有特定的供電電壓要求。由共享中央電源和大量局部轉(zhuǎn)換器模塊構(gòu)...
淺談機(jī)器視覺在工業(yè)自動(dòng)化中的應(yīng)用
視覺的使用并不僅僅在工業(yè)自動(dòng)化領(lǐng)域;我們也看到了相機(jī)在日常生活中的大量應(yīng)用,例如用于計(jì)算機(jī)、移動(dòng)設(shè)備,特別是在汽車中。
電源轉(zhuǎn)換芯片電路設(shè)計(jì)及上電順序設(shè)計(jì)
作為一個(gè)硬件設(shè)計(jì)的小菜鳥,在畫項(xiàng)目電源設(shè)計(jì)部分的原理圖時(shí),遇到許多問題,現(xiàn)在對遇到的問題和解決心得做個(gè)總結(jié)分析,以供參考。 我進(jìn)行電源部分的原理圖設(shè)計(jì)一...
2020-09-14 標(biāo)簽:fpgaIC器件電源轉(zhuǎn)換芯片 6.3k 0
FPGA的時(shí)鐘設(shè)計(jì):如何建立時(shí)間與保持時(shí)間
時(shí)鐘是整個(gè)電路最重要、最特殊的信號,系統(tǒng)內(nèi)大部分器件的動(dòng)作都是在時(shí)鐘的跳變沿上進(jìn)行, 這就要求時(shí)鐘信號時(shí)延差要非常小, 否則就可能造成時(shí)序邏輯狀態(tài)出錯(cuò)。
FPGA開源項(xiàng)目:UDP千兆以太網(wǎng)光通信
接口選擇 Internal ,因?yàn)樵揑P核通過GMII接口與“1G/2.5G Ethernet PCS/PMA or SGMII”通信,不需要產(chǎn)生外部物理接口
大家好,又到了每日學(xué)習(xí)的時(shí)間了,今天我們來聊一聊FPGA中不可綜合語句 相關(guān)知識。 (1)所有綜合工具都支持的結(jié)構(gòu):always,assign,begi...
2018-05-21 標(biāo)簽:FPGA 6.3k 0
FPGA圖像處理—VESA標(biāo)準(zhǔn)與視頻流介紹
VESA 視頻標(biāo)準(zhǔn)同步信號產(chǎn)生器,是從事FPGA圖像領(lǐng)域工程師經(jīng)常使用到的模塊。
TEWS科技的TXMC638型號24通道,16位,每通道5M樣本/秒采樣率的XMC卡將24個(gè)ADC通道 (采用凌力爾特LTC2323-16 模數(shù)轉(zhuǎn)換芯片...
2017-12-23 標(biāo)簽:fpga采集系統(tǒng)vivado 6.3k 0
【ZYNQ Ultrascale+ MPSOC FPGA教程】第八章FPGA片內(nèi)FIFO讀寫測試實(shí)驗(yàn)
FIFO: First in, First out代表先進(jìn)的數(shù)據(jù)先出,后進(jìn)的數(shù)據(jù)后出。Xilinx在VIVADO里為我們已經(jīng)提供了FIFO的IP核, 我...
基于FPGA的全高清視頻采集顯示系統(tǒng)設(shè)計(jì)方案
0 引言 隨著視頻顯示技術(shù)的發(fā)展,視頻信號從之前的標(biāo)清發(fā)展到高清,再發(fā)展到全高清,其分辨越來越高,數(shù)據(jù)量也成倍增加,這就推進(jìn)了顯示接口技術(shù)的高速發(fā)展,顯...
基于DSP和FPGA組合的嵌入式圖像處理平臺的實(shí)時(shí)多目標(biāo)識別算法
硬件平臺由DSP處理器+FPGA及其外圍器件組成的高速運(yùn)算電路共同實(shí)現(xiàn)[2],它為軟件編程、各類數(shù)據(jù)流控制及復(fù)雜對象的識別算法提供基礎(chǔ)保證。多目標(biāo)識別算...
用FPGA器件與VHDL語言實(shí)現(xiàn)曼徹斯特碼編解碼器的設(shè)計(jì)
曼徹斯特碼編碼、解碼器是1553B總線接口中不可缺少的重要組成部分。曼徹斯特碼編解碼器設(shè)計(jì)的好壞直接影響總線接口的性能。本文介紹的是MIL-STD-15...
FPGA學(xué)習(xí)算法系列:彩色轉(zhuǎn)灰度
大家好,又到了每日學(xué)習(xí)的時(shí)間了,今天我們來聊一聊FPGA學(xué)習(xí)中可以遇到的一些算法,今天就聊一聊彩色轉(zhuǎn)灰度的算法。 一、基礎(chǔ) 對于彩色轉(zhuǎn)灰度,有一個(gè)很著名...
2018-10-26 標(biāo)簽:FPGA 6.3k 0
S2C公司發(fā)布超大規(guī)模設(shè)計(jì)的FPGA原型系統(tǒng)
此方案可簡化,無電纜的設(shè)計(jì)分割,最多允許四個(gè)用戶同時(shí)使用。S2C公司,業(yè)內(nèi)領(lǐng)先的 FPGA 快速原型驗(yàn)證系統(tǒng)供應(yīng)商,發(fā)布了適用于超大規(guī)模設(shè)計(jì)的基于賽靈思...
如何在FPGA中正確處理浮點(diǎn)數(shù)運(yùn)算
使用插值算法實(shí)現(xiàn)圖像縮放是數(shù)字圖像處理算法中經(jīng)常遇到的問題。我們經(jīng)常會將某種尺寸的圖像轉(zhuǎn)換為其他尺寸的圖像,如放大或者縮小圖像。由于在縮放的過程中會遇到...
2022-03-18 標(biāo)簽:fpga計(jì)算機(jī)數(shù)字圖像處理 6.3k 0
只有在腦海中建立了一個(gè)個(gè)邏輯模型,理解FPGA內(nèi)部邏輯結(jié)構(gòu)實(shí)現(xiàn)的基礎(chǔ),才能明白為什么寫Verilog和寫C整體思路是不一樣的,才能理解順序執(zhí)行語言和并行...
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