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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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在FPGA上如何使用non-blocking cache設(shè)計(jì)框架
帶寬是影響FPGA加速器的重要因素,因?yàn)榇罅康牟⑿杏?jì)算對數(shù)據(jù)量要求很大。如果加速器對數(shù)據(jù)的訪問是不規(guī)則的,那么cache miss就會大大影響加速器性能...
能在很短時(shí)間內(nèi)快速構(gòu)建任意波形的FPGA
DDS頻率合成器具有頻率分辨率高,輸出頻點(diǎn)多,可達(dá)2N個(gè)頻點(diǎn)(假設(shè)DDS相位累加器的字長是N);頻率切換速度快,可達(dá)us量級;頻率切換時(shí)相位連續(xù)的優(yōu)點(diǎn),...
基于FPGA的高速可靠數(shù)據(jù)傳輸系統(tǒng)的實(shí)現(xiàn)
在各種不同的場合中,人們需要將大批數(shù)據(jù)從一個(gè)設(shè)備無差錯(cuò)地傳輸?shù)搅硪粋€(gè)設(shè)備上。對于設(shè)備間距離較近的場合,可以選擇PCIE(典型距離是15~30cm)或者U...
兩種不推薦的異步時(shí)鐘域操作方法:一種是通過增加Buffer或者其他門延時(shí)來調(diào)整采樣;另一種是盲目使用時(shí)鐘正負(fù)沿調(diào)整數(shù)據(jù)采樣。
2018-07-12 標(biāo)簽:FPGA 5.9k 0
基于協(xié)議轉(zhuǎn)換芯片PCI9054與FPGA實(shí)現(xiàn)PCI通信接口的設(shè)計(jì)
PCI,外設(shè)組件互連標(biāo)準(zhǔn)(Peripheral Component Interconnection)是一種由Intel公司1991年推出的用于定義局部總...
采用FPGA頻譜分析儀系統(tǒng)電路設(shè)計(jì)詳解
該系統(tǒng)采用C8051系列單片機(jī)中的 C8051F121作為控制器,CvcloneⅢ系列EP3C40F484C8型FPGA為數(shù)字信號算法處理單元。
隨著FPGA的集成度越來越高,規(guī)模越來越大,設(shè)計(jì)越來越復(fù)雜,IC行業(yè)的競爭也越來越激烈,產(chǎn)品的交付周期越來越短,這與人類有限的設(shè)計(jì)能力形成了巨大矛盾。如...
FPGA學(xué)習(xí)系列:24. FIFO控制器的設(shè)計(jì)
設(shè)計(jì)背景: First Input First Output的縮寫,先入先出隊(duì)列,這是一種傳統(tǒng)的按序執(zhí)行方法,先進(jìn)入的指令先完成并引退,跟著才執(zhí)行第二條...
2018-08-07 標(biāo)簽:FPGA 5.9k 0
在現(xiàn)代數(shù)字信號處理(DSP)應(yīng)用中,F(xiàn)PGA(現(xiàn)場可編程門陣列)憑借其高度并行性、可定制性和靈活性,已成為加速信號處理任務(wù)的核心硬件平臺之一。
利用FPGA硬件處理速度性能實(shí)現(xiàn)HSDI高速數(shù)據(jù)接口的設(shè)計(jì)
MC270143 MAC是Freescale公司UWB網(wǎng)卡XSllO上的一部分。它直接與基帶控制器MC270123相連,當(dāng)和MC270123控制器以及M...
大家好,又到了每日學(xué)習(xí)時(shí)間了,學(xué)習(xí)過 verilog HDL 的各位都知道其和C語言有點(diǎn)類似,那今天我們來聊一聊C語言,來聊一聊個(gè)人對C語言的認(rèn)識以及理...
2018-06-11 標(biāo)簽:FPGA 5.9k 0
Verilog HDL是一種硬件描述語言,以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言,用它可以表示邏輯電路圖、邏輯表達(dá)式,還可以表示數(shù)字邏輯系統(tǒng)所完...
由 FPGA DIY開發(fā)板控制實(shí)現(xiàn)LED多樣顯示功能
實(shí)現(xiàn)了LED燈間斷亮滅、花樣流水、跑馬燈功能。
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