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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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基于DSP與FPGA的實(shí)時(shí)功率譜分析系統(tǒng)設(shè)計(jì)
設(shè)計(jì)了一套實(shí)時(shí)功率譜分析系統(tǒng),主要用于信號(hào)的實(shí)時(shí)功率譜分析。采用DSP 浮點(diǎn)芯片TMS32C6713 作為系統(tǒng)的主處理單元,負(fù)責(zé)進(jìn)行功率譜分析; FPG...
對(duì)于具有484個(gè)引腳的芯片,如果手動(dòng)一個(gè)一個(gè)設(shè)置引腳,必然是一場(chǎng)噩夢(mèng)。網(wǎng)上有使用Capture進(jìn)行自動(dòng)導(dǎo)入的帖子,不過(guò)沒(méi)有找到AD方面的帖子。本文使用p...
基于CompactRIO的家居監(jiān)控機(jī)器人
用NI CompactRIO作為機(jī)器人的“小腦”。NI CompactRIO是美國(guó)NI公司的工業(yè)級(jí)嵌入式控制器,集成以太網(wǎng)接口和RS232串行接口,具有...
FPGA中RocketIO GTP收發(fā)器的高速串行傳輸實(shí)現(xiàn)方案
提出了基于Xilinx公司Virtex-5系列FPGA中RocketIO GTP收發(fā)器設(shè)計(jì)的一個(gè)高速串行傳輸實(shí)現(xiàn)方案,詳細(xì)闡述了硬件設(shè)計(jì)要點(diǎn)和軟件實(shí)現(xiàn)概...
簡(jiǎn)析Zynq芯片中PS和PL之間的9個(gè)雙向讀寫的通信端口
Zynq芯片中,PS(ProcessorSystem)和PL(Programmable Logic)之間提供了一共9個(gè)雙向讀寫的通信端口,他們分別是: ...
低成本的采用FPGA實(shí)現(xiàn)SDH設(shè)備時(shí)鐘芯片技術(shù)
介紹一種采用FPGA(現(xiàn)場(chǎng)可編程門陣列電路)實(shí)現(xiàn)SDH(同步數(shù)字體系)設(shè)備時(shí)鐘芯片設(shè)計(jì)技術(shù),硬件主要由1 個(gè)FPGA 和1 個(gè)高精度溫補(bǔ)時(shí)鐘組成.通過(guò)該...
SDAccel 開(kāi)發(fā)環(huán)境運(yùn)用
賽靈思 FPGA 器件主要由可編程邏輯架構(gòu)組成,能讓應(yīng)用設(shè)計(jì)人員利用空間和時(shí)間并行性,最大化算法性能或大型應(yīng)用中關(guān)鍵內(nèi)核的性能。位于這種架構(gòu)核心的是由基...
Zynq SoC的特性及其設(shè)計(jì)實(shí)現(xiàn)
賽靈思 Zynq?-7000 All Programmable SoC 系列代表了嵌入式設(shè)計(jì)的新局面,為嵌入式系統(tǒng)工程設(shè)計(jì)群體帶來(lái)前所未有的高性能和靈活...
LabVIEW 8.6實(shí)時(shí)模塊中的新功能 - CompactRIO掃描模式
通過(guò)LabVIEW 8.6實(shí)時(shí)模塊中的新功能 - CompactRIO掃描模式,您可以在兩個(gè)方案中選擇其一:在無(wú)需對(duì)FPGA編程的情況下直接在LabVI...
2017-11-17 標(biāo)簽:fpgalabviewcompactrio 3.9k 0
水下激光距離選通成像中要對(duì)水下距離選通圖像進(jìn)行增強(qiáng)處理。水下圖像通常具有噪聲大、對(duì)比度差、照度不均勻的特點(diǎn)。通過(guò)分析水下圖像的成像特點(diǎn),針對(duì)引起圖像降質(zhì)...
2017-11-17 標(biāo)簽:fpga 4.6k 0
基于FPGA的PCI-I2S音頻系統(tǒng)設(shè)計(jì)
提出了一種基于FPGA實(shí)現(xiàn)的PCI-I2S音頻系統(tǒng)方法。通過(guò)在FPGA中將PCI軟核、FIFO以及設(shè)計(jì)的接口電路等相結(jié)合,在FPGA上實(shí)現(xiàn)了 PCI、I...
基于FPGA和IQ調(diào)制器的能量倍增器系統(tǒng)設(shè)計(jì)
介紹了基于可編程邏輯門陣列(FPGA)的能量倍增器(SLED)相位翻轉(zhuǎn)系統(tǒng)。該系統(tǒng)主要由微波IQ調(diào)制器、FPGA 和高速DAC 組成。在FPGA 的控制...
一個(gè)好的FPGA設(shè)計(jì)一定是包含兩個(gè)層面:良好的代碼風(fēng)格和合理的約束。時(shí)序約束作為FPGA設(shè)計(jì)中不可或缺的一部分,已發(fā)揮著越來(lái)越重要的作用。毋庸置疑,時(shí)序...
低功耗的賽靈思 FPGA 系列使總線供電的 USB 器件設(shè)計(jì)垂手可得 憑借在市場(chǎng)中數(shù)十億的端口數(shù)量,通用串行總線 (USB) 成為實(shí)現(xiàn)主機(jī)與外設(shè)之間千兆...
基于ZedBoard的SCA架構(gòu)的設(shè)計(jì)原理
ZedBoard是Xilinx公司首款融合了ARM Cortex A9雙核和7系列FPGA的全可編程片上系統(tǒng),兼具ARM和FPGA兩者的優(yōu)勢(shì),是小型化S...
使用VHDL語(yǔ)言設(shè)計(jì)的基于FPGA的實(shí)時(shí)NPR系統(tǒng)
在進(jìn)行非真實(shí)感渲染(NPR)處理時(shí)需要大量的計(jì)算,這對(duì)高幀率、高分辨率的視頻做實(shí)時(shí)的NPR渲染是一個(gè)難題。根據(jù)FPGA以并行運(yùn)算為主的特點(diǎn),對(duì)傳統(tǒng)的N...
基于DSP+FPGA的并行信號(hào)處理模塊設(shè)計(jì)
針對(duì)信號(hào)處理數(shù)據(jù)量大、實(shí)時(shí)性要求高的特點(diǎn),從實(shí)際應(yīng)用出發(fā),設(shè)計(jì)了以雙DSP+FPGA為核心的并行信號(hào)處理模塊。為了滿足不同的信號(hào)處理任務(wù)需求,F(xiàn)PGA可...
現(xiàn)場(chǎng)可編程邏輯門陣列(FPGA)應(yīng)用于圖像處理時(shí),需要對(duì)數(shù)據(jù)中的圖像信息進(jìn)行準(zhǔn)確的提取。設(shè)計(jì)中,F(xiàn)PGA中解壓縮功能需要對(duì)壓縮數(shù)據(jù)中的圖像信息進(jìn)行提取...
2017-11-17 標(biāo)簽:fpga狀態(tài)機(jī) 2.7k 0
借助FPGA技術(shù)和NI視覺(jué)開(kāi)發(fā)模塊,您可以對(duì)從相機(jī)采集的圖像進(jìn)行高速現(xiàn)場(chǎng)可編程門陣列(FPGA)處理。 FPGA處理尤其適用于要求圖像采集和處理之間具有...
基于FPGA 和 SoC創(chuàng)建時(shí)序和布局約束以及其使用
作時(shí)序和布局約束是實(shí)現(xiàn)設(shè)計(jì)要求的關(guān)鍵因素。本文是介紹其使用方法的入門讀物。 完成 RTL 設(shè)計(jì)只是 FPGA 設(shè)計(jì)量產(chǎn)準(zhǔn)備工作中的一部分。接下來(lái)的挑戰(zhàn)是...
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