versal

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Versal 產(chǎn)品組合基于臺(tái)積電（TSMC）的 7 nm FinFET 工藝技術(shù)，是第一個(gè)將軟件可編程性與特定領(lǐng)域硬件加速和靈活應(yīng)變能力相結(jié)合的平臺(tái)，這對(duì)于跟上當(dāng)今快速的創(chuàng)新步伐至關(guān)重要。

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versal技術(shù)

AMD Versal自適應(yīng)SoC GTM如何用XSIM仿真和觀察PAM4信號(hào)

PAM4(4-Level Pulse Amplitude Modulation) 的全稱(chēng)是四電平脈沖幅度調(diào)制，通過(guò)種不同的電平進(jìn)行信號(hào)傳輸，每個(gè)電平幅度...

2024-11-22 標(biāo)簽：amd 仿真信號(hào) 2.1k 0

AMD 通過(guò)第二代 Versal 器件為 AI 驅(qū)動(dòng)型嵌入式系統(tǒng)提供單芯片智能

隨著嵌入式 AI、視頻和控制應(yīng)用的爆炸式增長(zhǎng)，對(duì)異構(gòu)處理的需求越來(lái)越大，以便在狹小的區(qū)域和功率限制內(nèi)加速端到端計(jì)算。多芯片處理解決方案具有巨大的功耗、面...

2024-11-29 標(biāo)簽：amd 嵌入式系統(tǒng)單芯片 2.1k 0

AMD Versal自適應(yīng)SoC中eMMC燒錄/啟動(dòng)調(diào)試檢查表（上）

本篇博文提供了有關(guān) AMD Versal 自適應(yīng) SoC 中 eMMC 燒錄和啟動(dòng)設(shè)置的技巧和指南。它還可用于調(diào)試 eMMC 燒錄/啟動(dòng)失敗。提交服務(wù)申...

2026-03-09 標(biāo)簽：amd emmc 燒錄 2k 0

Versal HBM系列外部參考時(shí)鐘設(shè)計(jì)指南文章

Versal HBM ?？赏ㄟ^(guò)內(nèi)部 HSM0 參考時(shí)鐘來(lái)進(jìn)行時(shí)鐘設(shè)置，此參考時(shí)鐘是由 CIPS 或外部時(shí)鐘源生成的。

2023-06-05 標(biāo)簽：時(shí)鐘 NoC AXI 2k 0

在Versal VCK190評(píng)估套件上使用器件固件升級(jí)(DFU)執(zhí)行USB輔助啟動(dòng)模式測(cè)試

本文將演示如何在 Versal AI Core 系列 VCK190 評(píng)估套件上從 USB 輔助啟動(dòng)模式啟動(dòng) Linux

2023-07-10 標(biāo)簽：usb Linux JTAG 1.9k 0

AMD Versal自適應(yīng)SoC器件Advanced Flow概覽（下）

在 AMD Vivado Design Suite 2024.2 版本中，Advanced Flow 自動(dòng)為所有 AMD Versal 自適應(yīng) SoC ...

2025-01-23 標(biāo)簽：amd soc 命令 1.9k 0

AMD Versal自適應(yīng)SoC上的級(jí)聯(lián)模式示例

本篇博文主要講解在 PL 中如何使用 AXI Interrupt Controller (INTC) 的級(jí)聯(lián)模式，將 IP 核超過(guò) 32 個(gè)的中斷連接到...

2025-07-22 標(biāo)簽：amd soc 中斷 1.8k 0

AMD Versal自適應(yīng)SoC DDRMC如何使用Micron仿真模型進(jìn)行仿真

AMD Versal 自適應(yīng) SoC 器件上 DDR4 硬核控制器 DDRMC 跑仿真時(shí)，按照 IP 的默認(rèn)設(shè)置，在 IP wizard 中使能了“In...

2025-01-10 標(biāo)簽：amd 控制器 soc 1.8k 0

AMD Versal系列CIPS IP核建立示例工程

接著上一篇“AMD Versal系列CIPS IP核介紹”文章來(lái)進(jìn)一步講解如何來(lái)建立CIPS IP核示例工程。

2023-12-05 標(biāo)簽：amd 調(diào)試 IP核 1.8k 0

如何在IP集成器中將單工TX/RX核合并到多個(gè)Quad

要為 Versal 的多個(gè) Quad 創(chuàng)建收發(fā)器設(shè)置，建議從 Transceiver Bridge IP 開(kāi)始，在其中選擇所需的設(shè)置，然后交由 Viva...

2023-06-09 標(biāo)簽：收發(fā)器 Xilinx Quad 1.7k 0

AMD Versal自適應(yīng)SoC器件Advanced Flow概覽（上）

在最新發(fā)布的 AMD Vivado Design Suite 2024.2 中，引入的新特性之一是啟用了僅適用于 AMD Versal 自適應(yīng) SoC ...

2025-01-17 標(biāo)簽：amd soc 可編程邏輯 1.6k 0

異構(gòu)平臺(tái)設(shè)計(jì)方法探索賽靈思Versal ACAP設(shè)計(jì)方法論

身處智能時(shí)代，科技發(fā)展日新月異，伴隨數(shù)據(jù)中心、有線網(wǎng)絡(luò)、5G 無(wú)線和汽車(chē)等愈加豐富的場(chǎng)景，相應(yīng)的技術(shù)與功能也正經(jīng)歷飛速迭代，因此，單一計(jì)算架構(gòu)已難以應(yīng)對(duì)...

2022-08-02 標(biāo)簽：賽靈思異構(gòu)平臺(tái)Versal 1.4k 0

在Versal中通過(guò)NoC從PS-APU對(duì)AXI BRAM執(zhí)行基本讀寫(xiě)操作

本篇博文旨在演示如何通過(guò) NoC 從 Versal 應(yīng)用處理單元 (APU) 訪問(wèn) AXI BRAM。

2022-11-09 標(biāo)簽：NoC AXI Versal 1.3k 0

使用QEMU啟動(dòng)Versal VCK190 ACAP

本文涵蓋了有關(guān)使用 PetaLinux 命令行來(lái)對(duì) Versal? ACAP 的 PetaLinux BSP 運(yùn)行 QEMU 的信息

2023-07-07 標(biāo)簽：仿真器開(kāi)源 qemu 1.3k 0

Versal System Monitor(Sysmon)：過(guò)熱告警行為

在 CIPS GUI 中已對(duì) Versal System Monitor 過(guò)熱 (OT) 告警進(jìn)行了說(shuō)明

2023-07-10 標(biāo)簽：Xilinx GUI Versal 1.3k 0

Vivado 202x-Versal時(shí)鐘校準(zhǔn)去歪斜的時(shí)序問(wèn)題

使用“時(shí)鐘校準(zhǔn)去歪斜”時(shí)，在 Vivado 中會(huì)顯示下列消息以指明是否啟用該功能特性

2023-07-07 標(biāo)簽：時(shí)鐘 Vivado Versal 1.3k 0

Versal:JTAG TDO

本文則著重探討 JTAG TDO 用例

2023-07-07 標(biāo)簽：寄存器 JTAG 指令 1.3k 0

如何開(kāi)啟Versal的XilSEM功能

本文介紹了如何開(kāi)啟Versal最基本的XilSEM功能。

2023-07-07 標(biāo)簽：寄存器開(kāi)發(fā)板 Versal 1.2k 0

如何在Advanced IO Wizard(XPHY)中使用XPIO_VREF

SelectIO架構(gòu)手冊(cè) AM010 描述了如何使用 XPIO_VREF原語(yǔ)來(lái)調(diào)整 Internal Vref

2023-07-11 標(biāo)簽：接口 RTL Versal 1.2k 0

Versal Advanced IO Wizard-部分配置存在時(shí)序收斂問(wèn)題

在Versal Advanced IO Wizard中，所包含的PLL的去歪斜電路可能導(dǎo)致數(shù)據(jù)速率較高時(shí)出現(xiàn)建立時(shí)間

2023-07-07 標(biāo)簽：接口 pll 時(shí)序 1.1k 0

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高云半導(dǎo)體

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廣東高云半導(dǎo)體科技股份有限公司提供編程設(shè)計(jì)軟件、IP核、參考設(shè)計(jì)、演示板等服務(wù)的完整FPGA芯片解決方案。
Zedboard

Zedboard

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ZedBoard是基于Xilinx Zynq?-7000擴(kuò)展式處理平臺(tái)（EPP）的低成本開(kāi)發(fā)板。此板可以運(yùn)行基于Linux，Android，Windows?或其他OS/ RTOS的設(shè)計(jì)。
I2S

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I2S總線，又稱(chēng) 集成電路內(nèi)置音頻總線，是飛利浦公司為數(shù)字音頻設(shè)備之間的音頻數(shù)據(jù)傳輸而制定的一種總線標(biāo)準(zhǔn)，該總線專(zhuān)門(mén)用于音頻設(shè)備之間的數(shù)據(jù)傳輸，廣泛應(yīng)用于各種多媒體系統(tǒng)。
SoC FPGA

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簡(jiǎn)單PLD

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邏輯芯片

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邏輯芯片又叫可編程邏輯器件，英文全稱(chēng)為：programmable logic device 即 PLD。PLD是做為一種通用集成電路產(chǎn)生的，他的邏輯功能按照用戶(hù)對(duì)器件編程來(lái)確定。一般的PLD的集成度很高，足以滿(mǎn)足設(shè)計(jì)一般的數(shù)字系統(tǒng)的需要。
UltraScale

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16nm

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Samtec

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Samtec(申泰)公司是一家總部位于美國(guó)，致力于研發(fā)和生產(chǎn)高速數(shù)據(jù)通信連接器的供應(yīng)商，Samtec連接器使用100%液晶聚合物以及純磷青銅和鈹銅制造，擁有軍品級(jí)的技術(shù)參數(shù)，其產(chǎn)品包括各種通用標(biāo)準(zhǔn)的連接器以及通信線纜，并且為客戶(hù)提供解決方案。
HLS

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HLS（HTTP Live Streaming）是Apple的動(dòng)態(tài)碼率自適應(yīng)技術(shù)。主要用于PC和Apple終端的音視頻服務(wù)。包括一個(gè)m3u（8）的索引文件，TS媒體分片文件和key加密串文件。
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　　京微雅格（北京）科技有限公司致力于為系統(tǒng)制造商提供高集成度、高靈活性、高性?xún)r(jià)比的可編程邏輯器件、可重構(gòu)微處理器及相關(guān)軟件設(shè)計(jì)工具
智能魔鏡

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隨著物聯(lián)網(wǎng)技術(shù)的發(fā)展，搭載這一技術(shù)的家電也越來(lái)越多的出現(xiàn)，今年十分火熱的智能音箱就是物聯(lián)網(wǎng)技術(shù)和人工智能結(jié)合的代表，智能魔鏡這種基安防，終端，自動(dòng)化，人工智能的物聯(lián)網(wǎng)產(chǎn)品已經(jīng)成為了不可阻擋的趨勢(shì)，在未來(lái)，將更加全面、智能、便捷的走進(jìn)越來(lái)越多人們的生活。
Cyclone V

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iCE40

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　　為了滿(mǎn)足市場(chǎng)需求，萊迪思發(fā)布了iCE40 Ultra?產(chǎn)品系列。據(jù)萊迪思總裁兼CEO Darin G. Billerbeck介紹，相比競(jìng)爭(zhēng)對(duì)手的解決方案，iCE40 Ultra FPGA在提供5倍更多功能的同時(shí)減小了30%的尺寸。并且相比以前的器件，功耗降低高達(dá)75%。
空中客車(chē)

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空中客車(chē)公司（Airbus，又稱(chēng)空客、空中巴士），是歐洲一家飛機(jī)制造、研發(fā)公司，1970年12月于法國(guó)成立。空中客車(chē)公司的股份由歐洲宇航防務(wù)集團(tuán)公司（EADS）100%持有。
諧振變換器

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諧振變換器主要包括三種基本的類(lèi)型：串聯(lián)諧振變換器（SRC）、并聯(lián)諧振變換器（PRC）和串并聯(lián)諧振變換器（SPRC）。諧振變換器由開(kāi)關(guān)網(wǎng)絡(luò)Ns、諧振槽路NT、整流電路NR、低通濾波器NF等部分組成。
工業(yè)電機(jī)

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efpga

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eFPGA，全稱(chēng)為嵌入式FPGA（Embedded FPGA），顧名思義是將類(lèi)似于FPGA的可編程邏輯陣列“嵌入”到ASIC或SoC中。
圖像信號(hào)處理器

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UltraScale架構(gòu)

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數(shù)字秒表

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