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Vitis Model Composer 是一款 Xilinx 工具包，支持在 MATALB? 和 Simulink? 環(huán)境中進行快速設計探索和驗證，并加速 Xilinx 器件的量產(chǎn)。

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vitis技術(shù)

《基于“礦板”低成本學習Zynq系列》之八-定時器等外設測試

前面我們測試了DDR，片上memory，這一篇繼續(xù)測試片上外設，定時器等，以確認SOC是否正常。

2023-07-20 標簽：DDR soc 定時器 2.2k 0

如何獲取和使用Github上的Vitis開放資源

自從 Vitis 的發(fā)布，AMD 在 Github 上也開源了很多資源，方便開發(fā)者進行自己的設計，減少產(chǎn)品上市時間。所以我們來看一下如何獲取和使用 Gi...

2023-08-23 標簽：amd Xilinx 開源 2.2k 0

Vitis AI Library體驗之OCR識別

Vitis AI Library是一組高層次庫和 API，專為利用 DPU 高效執(zhí)行 AI 推斷而構(gòu)建。它是基于 Vitis AI運行時利用 Vitis...

2023-10-17 標簽：神經(jīng)網(wǎng)絡 AI OCR 2.1k 0

如何在AMD Vitis Unified 2024.2中連接到QEMU

在本篇文章我們將學習如何在 AMD Vitis Unified 2024.2 中連接到 QEMU。這是本系列的第 2 篇博文。要了解如何設置和使用 Q...

2025-08-06 標簽：amd 仿真 Unified 2k 0

Vitis AI工具概述

深度學習處理器 (DPU) 是一個專為深度神經(jīng)網(wǎng)絡而優(yōu)化的可編程引擎。它由一組可參數(shù)化的 IP 核組成

2023-07-07 標簽：處理器 AI DPU 2k 0

Vitis嵌入式Linux:Sysroot和庫的用法

本文演示了在Vitis? 中對 Linux 應用程序開發(fā)的過程中如何使用外部庫

2023-07-07 標簽：嵌入式 Linux SDK 2k 0

Vitis軟件平臺安裝

Vitis軟件平臺由適用于交互式工程開發(fā)的集成設計環(huán)境和適用于腳本化或手動應用開發(fā)的命令行工具組成

2023-07-07 標簽：WINDOWS 軟件平臺 Vitis 1.9k 0

如何在Vitis中把設置信息傳遞到底層的Vivado

在Vitis完成這個過程的底層，實際調(diào)用的是Vivado。Vitis會指定默認的Vivado策略來執(zhí)行綜合和實現(xiàn)的步驟。當默認的Vivado策略無法達到...

2022-08-02 標簽：Vivado Vitis 1.9k 0

Vitis IDE入門helloworld程序

第一個Xilinx Vitis IDE入門helloworld程序

2022-07-25 標簽：Xilinx IDE Vitis 1.9k 0

使用VVAS調(diào)用HLS生成硬件加速器的主要流程

本篇博客介紹 VVAS 框架所支持調(diào)用的 H/W(HLS) 內(nèi)核。 H/W 內(nèi)核指的是使用 HLS 工具生成的在 FPGA 部分執(zhí)行的硬件功能模塊。

2023-08-04 標簽：fpga amd 內(nèi)核 1.9k 0

使用VVAS開發(fā)軟件應用

Vitis 視頻分析 SDK 是在 AMD 平臺上構(gòu)建 AI 驅(qū)動的智能視頻分析解決方案的完整軟件棧。它從 USB/MIPI 攝像頭、視頻文件或者 RT...

2023-08-02 標簽：amd 接口攝像頭 1.9k 0

在Vitis中通過PSU DDR執(zhí)行MicroBlaze應用

MicroBlaze CPU 是可修改的拖入式預設 32 位/64 位 RISC 微處理器配置系列。

2023-06-21 標簽：cpu Xilinx 微處理器 1.9k 0

Vitis加速庫：廣泛且性能優(yōu)化的開源庫

Vitis 統(tǒng)一軟件平臺包括一組廣泛的、性能優(yōu)化的開源庫，這些庫提供了即開即用的加速功能，并且對現(xiàn)有應用實現(xiàn)最小化代碼更改或零更改。

2023-10-30 標簽：編程語言數(shù)據(jù)分析 Vitis 1.7k 0

如何在Vitis中把設置信息傳遞到底層的Vivado

本篇博文將繼續(xù)介紹在Vitis中把Settings信息傳遞到底層的Vivado。

2022-08-02 標簽：Vivado Vitis 1.6k 0

如何優(yōu)化HLS仿真腳本運行時間

需求：由于自己目前一個 HLS 仿真腳本需要運行 1個多小時，先打算通過打印時間戳的方式找出最耗時的部分，然后想辦法優(yōu)化。

2024-02-23 標簽：函數(shù)C++代碼 1.6k 0

Vitis HLS相關(guān)問答詳解

需要手工在 C++ 代碼里明確指定可并行執(zhí)行的任務（用 task，添加頭文件 hls_task.h)，同時可并行執(zhí)行的 task 接口（對應 C++ 函...

2023-08-11 標簽：amd Verilog 函數(shù) 1.5k 0

使用AXI4-Lite將Vitis HLS創(chuàng)建的IP連接到PS

在 AXI 基礎第 6 講 - Vitis HLS 中的 AXI4-Lite 簡介中，使用 C 語言在 HLS 中創(chuàng)建包含 AXI4-Lite 接口的 ...

2022-08-02 標簽：AXI4 Vivado Vitis 1.4k 0

如何在Vitis中設定Kernel的頻率

在Vitis 統(tǒng)一軟件平臺中使用Alveo系列開發(fā)板設計加速Kernel時，系統(tǒng)會自動為Kernel的時鐘設置默認頻率。以 xilinx_u200_qd...

2022-08-02 標簽：Kernel Vitis 1.3k 0

自動刪除SDK/Vitis下驅(qū)動程序的舊版本的Linux腳本

Xilinx的開發(fā)工具SDK/Vitis都可以自動根據(jù)Vivado設計，創(chuàng)建軟件工程，自動配置各個外部設備的驅(qū)動程序。為了兼容舊版本工程，SDK/Vit...

2022-08-02 標簽：Linux Xilinx 驅(qū)動程序 1.2k 0

如何在應用程序調(diào)試期間分析棧和堆使用情況

隨著 AMD Vitis 統(tǒng)一軟件平臺 2021.2 的發(fā)布，Vitis 引入了一個 Tcl 腳本，用于在應用程序運行的特定時間點協(xié)助查找棧和堆的內(nèi)存使...

2025-10-24 標簽：amd 內(nèi)存應用程序 1.1k 0

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