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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核。
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KWSoftware公司的基于Zynq-7000對(duì)可編程邏輯控制器演示
此視頻演示重點(diǎn)演示了一個(gè)基于Zynq-7000 All Programmable SoC配置成的嵌入式PLC,用于通過(guò)PowerLink以太網(wǎng)管理設(shè)備。...
Zynq-7000 AP SoC 在多種應(yīng)用領(lǐng)域中的演示
Xilinx公司介紹:Zynq-7000 AP SoC 在多種應(yīng)用領(lǐng)域中的演示。
如何使用XILINX方案提高馬達(dá)控制驅(qū)動(dòng)性能
使用XILINX方案提高馬達(dá)控制驅(qū)動(dòng)性能
2018-05-24 標(biāo)簽:驅(qū)動(dòng)xilinx馬達(dá)控制 5.9k 0
Vivado是Xilinx推出的可編程邏輯設(shè)備(FPGA)軟件開(kāi)發(fā)工具套件,提供了許多TCL命令來(lái)簡(jiǎn)化流程和自動(dòng)化開(kāi)發(fā)。本文將介紹在Vivado中常用的...
關(guān)于Xilinx FPGA如何獲取FPGA的Device DNA
作者:Evening Xilinx每一個(gè)FPGA都有一個(gè)獨(dú)特的ID,也就是Device DNA,這個(gè)ID相當(dāng)于我們的身份證,在FPGA芯片生產(chǎn)的時(shí)候就已...
Xilinx FPGA底層資源架構(gòu)與設(shè)計(jì)規(guī)范
這一次給大家分享的內(nèi)容主要涉及Xilinx FPGA內(nèi)的CLBs,SelectIO和Clocking資源,適合對(duì)FPGA設(shè)計(jì)有時(shí)序要求,卻還沒(méi)有足夠了解...
很多工程師在使用Xilinx開(kāi)發(fā)板時(shí)都注意到了一個(gè)問(wèn)題,就是開(kāi)發(fā)板中將LVDS的時(shí)鐘輸入(1.8V電平)連接到了VCCO=2.5V或者3.3V的Bank...
Xilinx汽車(chē)工業(yè)應(yīng)用的CAN FD IP核主要性能和優(yōu)勢(shì)
Xilinx CAN FD IP 核是汽車(chē)及工業(yè)應(yīng)用的理想選擇,非常適合汽車(chē)網(wǎng)關(guān)、車(chē)身控制單元、域控制器以及要求數(shù)據(jù)速率高于常規(guī) CAN 網(wǎng)絡(luò)的工業(yè)網(wǎng)絡(luò)等。
全球第一款28nm產(chǎn)品— Kintex-7 FPGA的 10Gbps 眼圖演示
Kintex-7 器件將同賽靈思 ISE? 13 設(shè)計(jì)套件、AMBA? 4 高級(jí)可擴(kuò)展接口 (AXI?)總線協(xié)議兼容 IP 和目標(biāo)參考設(shè)計(jì)一并提供,所有...
XILINX FPGA IP之AXI Traffic Generator
AXI Traffic Generator IP 用于在AXI4和AXI4-Stream互連以及其他AXI4系統(tǒng)外設(shè)上生成特定序列(流量)。它根據(jù)IP的...
模塊劃分,顧名思義是指模塊的劃分。但是,明德?lián)P至簡(jiǎn)設(shè)計(jì)法提出的模塊劃分,是廣義的“模塊劃分”。后續(xù)所提及的“模塊劃分”,不單單指模塊的劃分,還包括模塊劃...
以上是一個(gè)比較經(jīng)典的時(shí)鐘切換電路。 根據(jù)實(shí)際使用場(chǎng)景的不同,時(shí)鐘切換有很多不同的實(shí)現(xiàn)方法,都可以做得非常經(jīng)典。 時(shí)鐘,復(fù)位,是數(shù)字設(shè)計(jì)里最最基本的電路,...
基于PCIE(mcap)的部分可重構(gòu)實(shí)現(xiàn)方案
本博文主要是對(duì)基于PCIE(mcap)的部分可重構(gòu)實(shí)現(xiàn)的步驟做一個(gè)簡(jiǎn)單的演示,如有錯(cuò)誤之處,歡迎批評(píng)指正。值得說(shuō)明的是,基于PCIE的部分可重構(gòu)需在ul...
為何要選擇Zynq-7000 All Programmable SoC
Zynq-7000 AP SoC作為業(yè)界第一款SoC產(chǎn)品,完美集成了雙核ARM Cortex-A9處理器與賽靈思28 nm FPGA。本視頻向您展示了Z...
Xilinx Ten Giga Sub System IP生成詳細(xì)步驟
IP核描述 10 Giga Ethernet Sub System , 參考文檔PG157: https://www.xilinx.com/suppor...
使用git工具下載源碼,如果沒(méi)有安裝git工具,可以使用sudo apt-get install git進(jìn)行安裝
Vivado使用技巧分享:OOC綜合技術(shù)運(yùn)行流程
創(chuàng)建綜合運(yùn)行 一個(gè)“運(yùn)行(run)”是指定義和配置設(shè)計(jì)在綜合過(guò)程中的各方面,包括:使用 的Xilinx器件、應(yīng)用的約束集、啟動(dòng)單個(gè)或多個(gè)綜合的選項(xiàng)、控制...
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