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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核。
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關(guān)于Xilinx中DDS IP的運(yùn)用與講解
本次項(xiàng)目我們主要是為了講解DDS,所以我們使用了混頻這個(gè)小項(xiàng)目來講解。DDS自己手寫是比較簡單且靈活,但是Xilinx給我們提供了相應(yīng)的IP核,那么這次...
Xilinx推出Kria自適應(yīng)系統(tǒng)模塊產(chǎn)品組合,在邊緣加速創(chuàng)新和AI應(yīng)用
可量產(chǎn)化嵌入式板卡和低成本開發(fā)套件可加快設(shè)計(jì)周期,從而實(shí)現(xiàn)快速部署;初代產(chǎn)品面向智慧城市和智能工廠中的視覺 AI 應(yīng)用.
在Vivado中使用SRIO高速串行協(xié)議的IP演示官方例程
在FPGA開發(fā)過程中不可避免的要使用到一些IP,有些IP是很復(fù)雜的,且指導(dǎo)手冊(cè)一般是很長的英文,僅靠看手冊(cè)和網(wǎng)絡(luò)的一些搜索,對(duì)于復(fù)雜IP的應(yīng)用可能一籌莫...
Xilinx將可能以哪種方式影響AMD的未來業(yè)務(wù)和戰(zhàn)略?
作為去年的重大收購之一,AMD收購Xilinx將對(duì)電子行業(yè)的合并產(chǎn)生重大影響。在閱讀他們關(guān)于合并的介紹時(shí),AMD似乎在深入挖掘,以為收購Xilinx可以...
Enclustra瑞蘇盈科:航天發(fā)射數(shù)據(jù)記錄儀
在這種情況下,基于FPGA的解決方案的優(yōu)點(diǎn)(如固有的并行性、極高的帶寬、靈活性、對(duì)廣泛接口的支持以及集成的CPU)就發(fā)揮了作用。
2020 年 5 月,賽靈思研究實(shí)驗(yàn)室的論文《FINN-R:快速探索量化神經(jīng)網(wǎng)絡(luò)的端到端深度學(xué)習(xí)框架》獲得了計(jì)算機(jī)協(xié)會(huì) (ACM) 可重構(gòu)技術(shù)和系統(tǒng)匯刊...
2021-04-08 標(biāo)簽:神經(jīng)網(wǎng)絡(luò)Xilinx機(jī)器學(xué)習(xí) 2.2k 0
Cadence推出下一代Palladium Z2和Protium X2系統(tǒng),革命性提升硅前硬件糾錯(cuò)及軟件驗(yàn)證速度
Cadence擁有最完整的IP與SoC驗(yàn)證、硬件與軟件回歸測(cè)試及早期軟件開發(fā)的全系列解決方案。
基于Xilinx FPGA的SDK端的深度學(xué)習(xí)開發(fā)工具包
Neural Network Runtime (N2Cube), 神經(jīng)網(wǎng)絡(luò)運(yùn)行,運(yùn)行時(shí)支持環(huán)境,神經(jīng)網(wǎng)絡(luò)的加載,資源管理,調(diào)度。N2Cube核心組件包括...
2021-03-30 標(biāo)簽:神經(jīng)網(wǎng)絡(luò)Xilinx驅(qū)動(dòng)程序 4.1k 0
Xilinx Zynq系列FPGA實(shí)現(xiàn)神經(jīng)網(wǎng)絡(luò)中相關(guān)資源評(píng)估
集成在FPGA fabric模塊中的RAM,每個(gè)xilinx的FPGA中集成有多個(gè)這樣的BRAM??梢员划?dāng)作有以下特性的cache:1.不支持像處理器c...
2021-03-30 標(biāo)簽:fpga神經(jīng)網(wǎng)絡(luò)Xilinx 2.3k 0
從技術(shù)歷史的角度來看,Xilinx的收購標(biāo)志著1980年代末開始的FPGA時(shí)代走向了新階段。當(dāng)時(shí),F(xiàn)PGA的概念吸引了數(shù)字設(shè)計(jì)師(以及風(fēng)險(xiǎn)投資家的懷抱)...
如何注冊(cè)Xilinx賬戶以及申請(qǐng)IP核license
這篇文章原名為《最新 Xilinx vivado IP許可申請(qǐng)》,在很久之前發(fā)布于博客園和CSDN上發(fā)布了,后來被某公眾號(hào)博主盜取發(fā)布為自己的原創(chuàng),現(xiàn)在...
2021-03-29 標(biāo)簽:Xilinx 2.0萬 0
Xilinx以成本優(yōu)化型UltraScale+產(chǎn)品組合拓展新應(yīng)用,實(shí)現(xiàn)超緊湊、高性能邊緣計(jì)算
對(duì)緊湊型智能邊緣應(yīng)用的需求正推升對(duì)處理和帶寬引擎的需求。這些引擎不僅要提供更高的性能,還要提供更高級(jí)別的計(jì)算密度,以支持最小尺寸的系統(tǒng)。
2021-03-23 標(biāo)簽:fpgaXilinxUltraScale 5.1k 0
Xilinx 7系列中FPGA架構(gòu)豐富的時(shí)鐘資源介紹
引言:7系列FPGA具有多個(gè)時(shí)鐘路由資源,以支持各種時(shí)鐘方案和要求,包括高扇出、短傳播延遲和極低的偏移。為了最好地利用時(shí)鐘路由資源,必須了解如何從PCB...
引言:本文我們介紹一下全局時(shí)鐘資源。全局時(shí)鐘是一個(gè)專用的互連網(wǎng)絡(luò),專門設(shè)計(jì)用于到達(dá)FPGA中各種資源的所有時(shí)鐘輸入。這些網(wǎng)絡(luò)被設(shè)計(jì)成具有低偏移和低占空比...
Xilinx 7系列FPGA架構(gòu)的區(qū)域時(shí)鐘資源介紹
引言:本文我們介紹區(qū)域時(shí)鐘資源。區(qū)域時(shí)鐘網(wǎng)絡(luò)是獨(dú)立于全局時(shí)鐘的時(shí)鐘網(wǎng)絡(luò)。不像全局時(shí)鐘,一個(gè)區(qū)域時(shí)鐘信號(hào)(BUFR)的跨度被限制在一個(gè)時(shí)鐘區(qū)域,一個(gè)I/O...
軟件定義+硬件加速,賽靈思詮釋可組合式的數(shù)據(jù)中心
“數(shù)據(jù)中心并不存在模板,因?yàn)槠涔ぷ髫?fù)載是持續(xù)動(dòng)態(tài)變化的,并不存在單一應(yīng)用主導(dǎo)數(shù)據(jù)中心,因此現(xiàn)在數(shù)據(jù)中心在需求和應(yīng)用上面臨著持續(xù)的變化,在保持可擴(kuò)展性的同...
ACU2CG MPSOC核心板發(fā)布 Xilinx Zynq UltraScale+MPSoC再添一員
Zynq? UltraScale+? MPSoC 器件不僅提供 64 位處理器可擴(kuò)展性,同時(shí)還將實(shí)時(shí)控制與軟硬件引擎相結(jié)合,支持圖形、視頻、波形與數(shù)據(jù)包...
Xilinx 7系列FPGA SelectIO信號(hào)設(shè)計(jì)
引言:本文我們介紹FPGA SelectIO信號(hào)設(shè)計(jì)。本章提供了選擇I/O標(biāo)準(zhǔn)、拓?fù)浣Y(jié)構(gòu)和終端的一些策略,并為更詳細(xì)的決策和驗(yàn)證提供了仿真和測(cè)量方面的指...
Xilinx 7系列FPGA由四類FPGA系列組成,解決了從低成本、小尺寸、成本敏感、高容量應(yīng)用到最苛刻的高性能應(yīng)用的超高端連接帶寬、邏輯容量和信號(hào)處理...
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