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現(xiàn)場可編程門陣列FPGA（Field Programmable Gate Array）是美國Xilinx公司于1984年首先開發(fā)的一種通用型用戶可編程器件。FPGA內(nèi)部由可綰程邏輯單元陣列、布線資源和可編程的I／O單元陣列構(gòu)成，包含豐富的邏輯門、寄存器和I／O資源。目前，面向大規(guī)?？删幊唐骷降膹V泛...
目前FPGA通過USB接口獲取USB設(shè)備中數(shù)據(jù)的方案大致分為兩大類，一類為在FPGA內(nèi)部實現(xiàn)USB設(shè)備控制，另一類為在FPGA外部實現(xiàn)USB設(shè)備控制。在FPGA內(nèi)部實現(xiàn)的方案需要在FPGA內(nèi)部實現(xiàn)USB控制器，在內(nèi)部實現(xiàn)或者外接USB收發(fā)器。該方案的實現(xiàn)具有較大難度，同時由于USB協(xié)議和文件系統(tǒng)都相...
心率計是常用的醫(yī)學檢查設(shè)備，實時準確的心率測量在病人監(jiān)控、臨床治療及體育競賽等方面都有著廣泛的應(yīng)用。心率測量包括瞬時心率測量和平均心率測量。瞬時心率不僅能夠反映心率的快慢。同時能反映心率是否勻齊；...
Petri網(wǎng)是異步并發(fā)現(xiàn)象建模的重要工具，Petri網(wǎng)的硬件實現(xiàn)將為并行控制器的設(shè)計提供一種有效的途徑.本文在通用的EDA軟件Max+PlusII中，研究了基本Petri網(wǎng)和時延Petrii網(wǎng)的硬件實現(xiàn)，用VHDL語言分別建立了庫所和變遷元件。最后給出了一個時延Petri網(wǎng)系統(tǒng)實例，通過調(diào)用元件庫中...
在電子工程，資源勘探，儀器儀表等相關(guān)應(yīng)用中，頻率計是工程技術(shù)人員必不可少的測量工具。頻率測量也是電子測量技術(shù)中最基本最常見的測量之一。不少物理量的測量，如轉(zhuǎn)速、振動頻率等的測量都涉及到或可以轉(zhuǎn)化為頻率的測量。目前，市場上有各種多功能、高精度、高頻率的數(shù)字頻率計，但價格不菲。為適應(yīng)實際工作的需要，本文...
隨著現(xiàn)代通信技術(shù)的迅速發(fā)展，信號的調(diào)制方式向多樣化發(fā)展，解淵技術(shù)也隨之不斷向前發(fā)展。為了對高速大帶寬的信號進行實時解調(diào)，現(xiàn)在很多的解調(diào)關(guān)鍵算法都是在高速硬件上用可編程邏輯器件（FPGA）實觀，利用FPGA強大的資源和實時處理能力來快速的實現(xiàn)信號的跟蹤、鎖定和解調(diào)但是，基于硬件的實現(xiàn)方案和基于軟件的方...
EnDat接口是HEIDENHAIN專為編碼器設(shè)計的數(shù)字式、全雙工同步串行的數(shù)據(jù)傳輸協(xié)議，具有傳輸速度快、功能強大、連線簡單、抗干擾能力強等優(yōu)點，是編碼器、光柵尺數(shù)據(jù)傳輸?shù)耐ㄓ媒涌?。本文闡述了EnDat接口的特點、功能、時序和數(shù)據(jù)傳輸、OEM數(shù)據(jù)存儲，同時介紹了編碼器數(shù)據(jù)采集后續(xù)電路設(shè)計方案、基于F...
復雜度日益增加的系統(tǒng)設(shè)計要求高性能FPGA的設(shè)計與PCB設(shè)計并行進行。通過整合FPGA和PCB設(shè)計工具以及采用高密度互連（HDI）等先進的制造工藝，這種設(shè)計方法可以降低系統(tǒng)成本、優(yōu)化系統(tǒng)性能并縮短設(shè)計周期。...
電子系統(tǒng)功能實現(xiàn)的模式不外硬件和軟件兩種?；隈T。諾依曼或者哈佛體系結(jié)構(gòu)的通用微處理器（MPU、MCU、DSP等）系統(tǒng)是軟件實現(xiàn)模式，其硬件電路結(jié)構(gòu)固定，通過串行執(zhí)行指令實現(xiàn)功能。軟件設(shè)計靈活、易升級，但執(zhí)行速度慢、效率低;而專用集成電路（ASIC）采用硬件模式，通過固化的特定運算和單元電路完成功能...
開源硬件領(lǐng)域MCU板卡很火，著名的Arduino、樹莓派（Raspberry Pi）、Micro：bit，開源的MCU也是個熱門的話題，除了老牌的8051、OpenRisc等，這兩年的明星就是Risc V了，在中國集成電路大躍進的加持下，它幾乎成了中國處理器追趕世界的一劑***。...
如果輸入信號需要反相，則要盡可能的調(diào)用輸入帶反相功能的符號，而不是使用分離的反相器來進行反相...
在開發(fā)PL時一般都會用到分頻或倍頻，對晶振產(chǎn)生的時鐘進行分頻或倍頻處理，產(chǎn)生系統(tǒng)時鐘和復位信號，這是同步時序電路的關(guān)鍵，這時就需要使用到時鐘向?qū)P，下面就介紹一下在vivado中進行PL開發(fā)時調(diào)用IP的方法。...
在開發(fā)PL時一般都會用到分頻或倍頻，對晶振產(chǎn)生的時鐘進行分頻或倍頻處理，產(chǎn)生系統(tǒng)時鐘和復位信號，下面就介紹一下在vivado2017.3中進行PL開發(fā)時調(diào)用IP的方法。...
Xilinx每一個FPGA都有一個獨特的ID，也就是Device DNA，這個ID相當于我們的身份證，在FPGA芯片生產(chǎn)的時候就已經(jīng)寫死在芯片的eFuse寄存器中，具有不可修改的屬性，因為使用的是熔斷技術(shù)。...
在sdk中選擇lwip模板，編譯調(diào)試可輕松連接成功并進行通信，模板中代碼完成的任務(wù)是client給server發(fā)什么，server就會回復什么。...
“No PP，No WAY”這是個眼見為實的世界，這是個視覺構(gòu)成的信息洪流的世界。大腦處理視覺內(nèi)容的速度比文字內(nèi)容快6萬倍，而隨著智能手機的普及，圖片、視頻的產(chǎn)生和分享已經(jīng)是人們在社交平臺上的基本交流方式。用戶通過手機、平板、電腦上傳和分享自己的圖片，而且這個趨勢是每年都在增長（參見圖1）。...
基于FPGA芯片Stratix II EP2S60F672C4設(shè)計實現(xiàn)了數(shù)字基帶預(yù)失真系統(tǒng)中的環(huán)路延遲估計模塊。該模塊運用了一種環(huán)路延遲估計新方法，易于FPGA實現(xiàn)。同時，在信號失真的情況下也能給出正確的估計結(jié)果。Modelsim SE 6.5c的時序仿真結(jié)果和SignalTaps II的硬件調(diào)試結(jié)...
以單片機和可編程邏輯器件（FPGA）為控制核心，設(shè)計了一個程控濾波器，實現(xiàn)了小信號程控放大、程控調(diào)整濾波器截止頻率和幅頻特性測試的功能。其中放大模塊由可變增益放大器AD603實現(xiàn)，最大增益60dB，10dB步進可調(diào)，增益誤差小于1%。程控濾波模塊由MAX297低通濾波、TLC1068高通濾波及橢圓低...
過采樣技術(shù)是數(shù)字信號處理者用來提高模數(shù)轉(zhuǎn)換器（ADC）性能經(jīng)常使用的方法之一，它通過減小量化噪聲，提高ADC的信噪比，從而提高ADC的有效分辨率［1］。過采樣技術(shù)不但沒有增加額外的模擬電路，而且由于提高了有效分辨率還能簡化模擬電路，并且簡單易行，因而被數(shù)字信號處理實踐者廣泛應(yīng)用于測控領(lǐng)域...
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