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可編程邏輯

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PCI9054驅動

2017-05-22

cpld epm7032slc44-10n 燒錄時下載線十條線應該分別連接哪幾個管腳

2017-05-21

求助，quartus的tb調用modelsim，輸入的波形正常，但是輸出波形怎么都不變？

2017-05-21 標簽：VHDL modelsim QUARTUS

testbench設置的問題

2017-05-21 標簽：Verilog

新手

2017-05-21

哪位大神給個基于FPGA的IR接收器VHDL語言的程序

2017-05-20

《晶體管電路設計（上）》

2017-05-20 標簽：晶體管

【首發(fā)】貨真價實的時序圖繪制軟件timegen3.3.5

2017-05-20

詳細討論異步FIFO的具體實現(xiàn)？？？

2017-05-19 標簽：FIFO

求加奇校驗位的串口接收VHDL程序

2017-05-19

Altera FPGA的上電順序

2017-05-18

CPLD LPM_ROM or LPM_RAM 的使用

2017-05-18

DE2-115

2017-05-18 標簽：接收機

FPGA

2017-05-18 標簽：接收器

DDS芯片AD9832的控制字是應該怎么寫入？

2017-05-18 標簽：chirp DDS Verilog

modelsim is exiting with code 7???

2017-05-18

學FPGA到現(xiàn)在只能做一些簡單設計，不知道怎樣做大型工程，不知道什么方向

2017-05-18

Xilinx為什么注冊不了呢

2017-05-17

verilog IP核使用問題

2017-05-17 標簽：低通濾波器 Verilog IP核

【求助】VGA顯示字符怎樣修改顏色？

2017-05-17 標簽：VGA

AURORA_8b10b核中RX_SRC_RDY_N信號

2017-05-17

求一個用FPGA做的酒精濃度測試系統(tǒng)資料

2017-05-17

中肯的總結！月薪4萬的IC驗證工程師竟然每天做這些

2017-05-17

AD9467—fmc板數(shù)據采集

2017-05-17 標簽：數(shù)據采集

FPGA做DDS，Modelsim出現(xiàn)的毛刺

2017-05-17 標簽：chirp DDS Verilog

ASIC做這個的人真少

2017-05-16 標簽：ASIC

如何將ASCII碼轉成16進制數(shù)？

2017-05-16

PEX8311 DMA 沒反應？

2017-05-16

求各位大神知道，計數(shù)器為什么不能計數(shù)

2017-05-16 標簽：計數(shù)器

分頻器芯片替換問題

2017-05-16

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