連接器
電子發(fā)燒友網(wǎng)連接器技術(shù)專欄，內(nèi)容有連接器、光纖連接器、工業(yè)連接器、汽車連接器、電線電纜、接插件以及連接器技術(shù)的其它應(yīng)用方案等；是電子工程師學(xué)習(xí)連接器技術(shù)的好欄目。
Quartus II 15.0-溫婉簡(jiǎn)約編譯器
Quartus II 15.0是Altera公司帶來的專業(yè)的PLD/FPGA開發(fā)軟件，該版本不僅增加了Spectra-Q引擎，針對(duì)Arria10以及未來的器件進(jìn)行了優(yōu)化，F(xiàn)PGA 設(shè)計(jì)效能實(shí)現(xiàn)了突破。還帶了新的算法更新了TimeQuest時(shí)序分析器...
設(shè)計(jì)ROM項(xiàng)目的需求與操作步驟
ROM是只讀存儲(chǔ)器（Read-Only Memory）的簡(jiǎn)稱，是一種只能讀出事先所存數(shù)據(jù)的固態(tài)半導(dǎo)體存儲(chǔ)器。其特性是一旦儲(chǔ)存資料就無法再將之改變或刪除。通常用在不需經(jīng)常變更資料的電子或電腦系統(tǒng)中...
關(guān)系運(yùn)算符的種類與使用意義
“運(yùn)算符用于執(zhí)行程序代碼運(yùn)算,會(huì)針對(duì)一個(gè)以上操作數(shù)項(xiàng)目來進(jìn)行運(yùn)算。例如:2+3,其操作數(shù)是2和3,而運(yùn)算符則是“+”。...
學(xué)習(xí)FPGA的工程規(guī)范
FPGA 器件屬于專用集成電路中的一種半定制電路，是可編程的邏輯列陣，能夠有效的解決原有的器件門電路數(shù)較少的問題。...
移位運(yùn)算符的應(yīng)用實(shí)例講解
移位運(yùn)算符在程序設(shè)計(jì)中，是位操作運(yùn)算符的一種。移位運(yùn)算符可以在二進(jìn)制的基礎(chǔ)上對(duì)數(shù)字進(jìn)行平移。按照平移的方向和填充數(shù)字的規(guī)則分為三種：<<(左移)、>>(帶符號(hào)右移)和>>>(無符號(hào)右移...
2019-11-19 標(biāo)簽：設(shè)計(jì)程序運(yùn)算符 4177
串并轉(zhuǎn)換的需求分析與頂層框架設(shè)計(jì)
串并轉(zhuǎn)換是完成串行傳輸和并行傳輸這兩種傳輸方式之間轉(zhuǎn)換的技術(shù)。移位寄存器可以實(shí)現(xiàn)并行和串行輸入和輸出。 這些通常配置為“串行輸入，并行輸出”（SIPO）或“并行，串行輸出”（...
縮減運(yùn)算符的工程實(shí)例講解
縮減運(yùn)算符是單目運(yùn)算符，也有與或非運(yùn)算。其與或非運(yùn)算規(guī)則類似于位運(yùn)算符的與或非運(yùn)算規(guī)則，但其運(yùn)算過程不同?？s減運(yùn)算是對(duì)單個(gè)操作數(shù)進(jìn)行與或非遞推運(yùn)算，最后的運(yùn)算結(jié)果是一...
位拼運(yùn)算符的代碼實(shí)例與仿真波形講解
位拼運(yùn)算符是將多個(gè)小的表達(dá)式合并形成一個(gè)大的表達(dá)式，用符號(hào){}來實(shí)現(xiàn)多個(gè)表達(dá)式的連接運(yùn)算，各個(gè)表達(dá)式之間用“，”隔開。位拼運(yùn)算符不但可以進(jìn)行簡(jiǎn)單的數(shù)據(jù)拼接，更是可以用來執(zhí)行...
2019-11-19 標(biāo)簽：數(shù)據(jù)代碼運(yùn)算符 2378
層次化設(shè)計(jì)方法講解
層次化設(shè)計(jì)是指在一個(gè)大型設(shè)計(jì)任務(wù)中，將目標(biāo)層分解，在各個(gè)層次上進(jìn)行設(shè)計(jì)的方法。...
2019-11-19 標(biāo)簽：FPGA設(shè)計(jì) 6464
邊沿檢測(cè)的目的及電路原理分析
邊沿檢測(cè)電路(edge detection circuit)是個(gè)常用的基本電路。所謂邊沿檢測(cè)就是對(duì)前一個(gè)clock狀態(tài)和目前clock狀態(tài)的比較，如果是由0變?yōu)?，能夠檢測(cè)到上升沿，則稱為上升沿檢測(cè)電路(posedge edge detect...
FIFO項(xiàng)目設(shè)計(jì)需求與操作步驟
在計(jì)算機(jī)中，先入先出隊(duì)列是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令（指令就是計(jì)算機(jī)在響應(yīng)用戶操作的程序代碼，對(duì)用戶而言是透明的）。...
2019-11-19 標(biāo)簽：計(jì)算機(jī)fifo 2113
Verilog HDL語言中的分支語句
Verilog HDL是一種硬件描述語言，以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。...
2019-11-20 標(biāo)簽：電路圖硬件Verilog HDL 6516
RAM的項(xiàng)目設(shè)計(jì)需求與操作步驟
RAM也叫主存，是與CPU直接交換數(shù)據(jù)的內(nèi)部存儲(chǔ)器。它可以隨時(shí)讀寫（刷新時(shí)除外），而且速度很快，通常作為操作系統(tǒng)或其他正在運(yùn)行中的程序的臨時(shí)數(shù)據(jù)存儲(chǔ)介質(zhì)。RAM工作時(shí)可以隨時(shí)從任何一...
電平觸發(fā)與尖峰脈沖的模塊功能介紹
電平觸發(fā)是在高或低電平保持的時(shí)間內(nèi)觸發(fā)，而邊沿觸發(fā)是由高到低或由低到高這一瞬間觸發(fā)在數(shù)字電平變化的電壓上升沿或下降沿到一定閥值時(shí)就產(chǎn)生觸發(fā)，是謂邊沿觸發(fā)。當(dāng)電壓達(dá)到數(shù)字電...
如何進(jìn)行二進(jìn)制數(shù)轉(zhuǎn)BCD
二進(jìn)制（binary）在數(shù)學(xué)和數(shù)字電路中指以2為基數(shù)的記數(shù)系統(tǒng)，以2為基數(shù)代表系統(tǒng)是二進(jìn)位制的。這一系統(tǒng)中，通常用兩個(gè)不同的符號(hào)0（代表零）和1（代表一）來表示。...
實(shí)現(xiàn)任意整數(shù)分頻的原理與方法講解
分頻器是一種基本電路，通常用來對(duì)某個(gè)給定頻率進(jìn)行分頻，得到所需的頻率。整數(shù)分頻器的實(shí)現(xiàn)非常簡(jiǎn)單，可采用標(biāo)準(zhǔn)的計(jì)數(shù)器，也可以采用可編邏輯器件設(shè)計(jì)實(shí)現(xiàn)。但在某些場(chǎng)合下，時(shí)鐘源...
2019-11-20 標(biāo)簽：分頻器計(jì)數(shù)器時(shí)鐘 8230
異步復(fù)位同步釋放的基本原理與代碼舉例
異步復(fù)位同步釋放是指復(fù)位信號(hào)是異步有效的，即復(fù)位的發(fā)生與clk無關(guān)。后半句“同步釋放”是指復(fù)位信號(hào)的撤除也與clk無關(guān)，但是復(fù)位信號(hào)是在下一個(gè)clk來到后起的作用（釋放）。...
適用于模塊運(yùn)算的移位寄存器IP核的用法
在數(shù)字電路中，移位寄存器是一種在若干相同時(shí)間脈沖下工作的以觸發(fā)器為基礎(chǔ)的器件，數(shù)據(jù)以并行或串行的方式輸入到該器件中，然后每個(gè)時(shí)間脈沖依次向左或右移動(dòng)一個(gè)比特，在輸出端進(jìn)行...
鎖相環(huán)的應(yīng)用優(yōu)勢(shì)與項(xiàng)目設(shè)計(jì)需求
鎖相環(huán)的工作原理是檢測(cè)輸入信號(hào)和輸出信號(hào)的相位差，并將檢測(cè)出的相位差信號(hào)通過鑒相器轉(zhuǎn)換成電壓信號(hào)輸出，經(jīng)低通濾波器濾波后形成壓控振蕩器的控制電壓，對(duì)振蕩器輸出信號(hào)的頻率實(shí)...
基于尖峰脈沖的按鍵消抖
按鍵消抖通常的按鍵所用開關(guān)為機(jī)械彈性開關(guān)，當(dāng)機(jī)械觸點(diǎn)斷開、閉合時(shí)，由于機(jī)械觸點(diǎn)的彈性作用，一個(gè)按鍵開關(guān)在閉合時(shí)不會(huì)馬上穩(wěn)定地接通，在斷開時(shí)也不會(huì)一下子斷開。因而在閉合及斷...
二選一數(shù)據(jù)選擇器的系統(tǒng)設(shè)計(jì)框架圖分析
數(shù)據(jù)選擇器是指經(jīng)過選擇，把多個(gè)通道的數(shù)據(jù)傳送到唯一的公共數(shù)據(jù)通道上去，實(shí)現(xiàn)數(shù)據(jù)選擇功能的邏輯電路稱為數(shù)據(jù)選擇器。在多路數(shù)據(jù)傳送過程中，能夠根據(jù)需要將其中任意一路選出來的電...
2019-11-20 標(biāo)簽：開關(guān)邏輯電路數(shù)據(jù)選擇器 14190
DDS波形發(fā)生器的原理和代碼驅(qū)動(dòng)方式
DDS是直接數(shù)字式頻率合成器（Direct Digital Synthesizer）的英文縮寫，是一項(xiàng)關(guān)鍵的數(shù)字化技術(shù)。與傳統(tǒng)的頻率合成器相比，DDS具有低成本、低功耗、高分辨率和快速轉(zhuǎn)換時(shí)間等優(yōu)點(diǎn)，廣泛使用在電...
靜態(tài)時(shí)序分析：如何編寫有效地時(shí)序約束（一）
靜態(tài)時(shí)序分析是一種驗(yàn)證方法，其基本前提是同步邏輯設(shè)計(jì)（異步邏輯設(shè)計(jì)需要制定時(shí)鐘相對(duì)關(guān)系和最大路徑延時(shí)等，這個(gè)后面會(huì)說）。靜態(tài)時(shí)序分析僅關(guān)注時(shí)序間的相對(duì)關(guān)系，而不是評(píng)估邏輯...
什么是蜂鳴器，如何實(shí)現(xiàn)無源蜂鳴器的設(shè)計(jì)
蜂鳴器是一種一體化結(jié)構(gòu)的電子訊響器，采用直流電壓供電，廣泛應(yīng)用于計(jì)算機(jī)、打印機(jī)、復(fù)印機(jī)、報(bào)警器、電子玩具、汽車電子設(shè)備、電話機(jī)、定時(shí)器等電子產(chǎn)品中作發(fā)聲器件。...
2019-11-21 標(biāo)簽：計(jì)算機(jī)打印機(jī)蜂鳴器 3432
靜態(tài)時(shí)序分析：如何編寫有效地時(shí)序約束（二）
靜態(tài)時(shí)序或稱靜態(tài)時(shí)序驗(yàn)證，是電子工程中，對(duì)數(shù)字電路的時(shí)序進(jìn)行計(jì)算、預(yù)計(jì)的工作流程，該流程不需要通過輸入激勵(lì)的方式進(jìn)行仿真。...
altera時(shí)序分析基礎(chǔ)項(xiàng)目講解
時(shí)序分析的主要對(duì)象是：在REG2中，時(shí)鐘信號(hào)CLK經(jīng)過路徑③的有效沿，與從REG1寄存器輸出的數(shù)據(jù)經(jīng)過路徑①到達(dá)REG2的D端時(shí)的關(guān)系。...
靜態(tài)時(shí)序分析：如何編寫有效地時(shí)序約束（三）
靜態(tài)時(shí)序分析中的“靜態(tài)”一詞，暗示了這種時(shí)序分析是一種與輸入激勵(lì)無關(guān)的方式進(jìn)行的，并且其目的是通過遍歷所有傳輸路徑，尋找所有輸入組合下電路的最壞延遲情況。這種方法的計(jì)算效...
快速入門FPGA硬件邏輯設(shè)計(jì)
FPGA 的基本結(jié)構(gòu)包括可編程輸入輸出單元，可配置邏輯塊，數(shù)字時(shí)鐘管理模塊，嵌入式塊RAM，布線資源，內(nèi)嵌專用硬核，底層內(nèi)嵌功能單元。由于FPGA具有布線資源豐富，可重復(fù)編程和集成度高，...
雷達(dá)信號(hào)處理類型與定義
雷達(dá)是利用電磁波探測(cè)目標(biāo)的電子設(shè)備。雷達(dá)發(fā)射電磁波對(duì)目標(biāo)進(jìn)行照射并接收其回波，由此獲得目標(biāo)至電磁波發(fā)射點(diǎn)的距離、距離變化率（徑向速度）、方位、高度等信息。...
基于FPGA的頻率分集信號(hào)處理的實(shí)現(xiàn)
本課程前期是基礎(chǔ)理論的講解，后期是結(jié)合經(jīng)驗(yàn)和項(xiàng)目實(shí)踐提煉的主要內(nèi)容，圍繞抗干擾和工程實(shí)現(xiàn)進(jìn)行原理闡述，省去了復(fù)雜的公式推導(dǎo)過程，和大家分享硬件學(xué)習(xí)經(jīng)驗(yàn)。...
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