三星BSPDN技術引領芯片創(chuàng)新：尺寸縮減17%，能效提升15%
在近日舉行的西門子EDA論壇2024首爾站上，三星電子晶圓代工PDK開發(fā)團隊的高級副總裁Lee Sun-Jae向業(yè)界展示了其革命性的背面供電網(wǎng)絡（BSPDN）技術所帶來的顯著優(yōu)勢。據(jù)Lee介紹，BSPDN技術在2nm工藝節(jié)點上的SF2Z設計中展現(xiàn)出卓越性能，相較于傳統(tǒng)的正面供電網(wǎng)絡（FSPDN）方式，實現(xiàn)了前所未有的突破。
該技術通過優(yōu)化電路布局與供電機制，成功解決了長期困擾業(yè)界的電路壓降問題，不僅將芯片面積減少了約17%，還實現(xiàn)了能效約15%的顯著提升。更令人矚目的是，BSPDN技術還帶來了約8%的性能增強，為高性能芯片設計開辟了全新的可能性。
Lee Sun-Jae的分享無疑為半導體行業(yè)注入了一針強心劑，展示了三星電子在先進制程技術領域的深厚積累與創(chuàng)新能力。隨著BSPDN技術的逐步應用與推廣，預計將為全球芯片設計領域帶來更加高效、緊湊的解決方案，推動電子產品向更小、更快、更節(jié)能的方向發(fā)展。
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