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編程語言及工具
電子發(fā)燒友網(wǎng)編程語言及工具欄目提供嵌入式設(shè)計所需的嵌入式編程語言技術(shù)和開發(fā)工具以及最新設(shè)計相關(guān)內(nèi)容，是嵌入式工程師喜歡的網(wǎng)站。
C語言string.h中的庫函數(shù)有哪些？
在C語言中，字符數(shù)組和字符串?dāng)?shù)組實際上是同一種類型。字符串是由字符組成的字符數(shù)組，通常以空字符 '\0' 結(jié)尾。...
什么是三相電不平衡？如何用c語言三目運(yùn)算符判斷三相電不平衡？
我們用三目運(yùn)算符寫了個限幅濾波的函數(shù)，其實在開發(fā)中三目運(yùn)算符還是非常常見的，今天就開寫一下我曾經(jīng)用三目運(yùn)算符計算三相電壓不平衡的案例。...
2023-07-08 標(biāo)簽：濾波器電力系統(tǒng)C語言三相電壓 2033
c語言數(shù)據(jù)類型之枚舉體類型
將一類有關(guān)聯(lián)的標(biāo)識組合起來，形成一個特殊的集合。...
結(jié)構(gòu)體成員變量的引用方法123
這里采用的是常用的typedef關(guān)鍵字進(jìn)行定義結(jié)構(gòu)體類型，可以看到student_t這種數(shù)據(jù)類型里面有4個成員變量，分別是學(xué)號、姓名、分?jǐn)?shù)、年齡，這些成員變量既然是變量就應(yīng)該滿足變量的基本特征...
verilog語法基礎(chǔ)知識
判定循環(huán)執(zhí)行條件，若為假則跳出循環(huán)；若為真，則執(zhí)行指定語句后，轉(zhuǎn)到第三步...
如何在32位MCU平臺間移植
過去數(shù)年，關(guān)于單內(nèi)核平臺標(biāo)準(zhǔn)化的討論不計其數(shù)，目的是讓設(shè)計從一家MCU供貨商的產(chǎn)品移植到另一家的產(chǎn)品變得容易。有趣的是，所有討論均從未涉及外設(shè)。然而，外設(shè)恰恰就是將應(yīng)用從一家...
JSON將替代XML？絕對不可能！
雖然 JSON 格式很香，在當(dāng)今應(yīng)用也很普及，但是說能替代 XML 格式，我覺得有點不太現(xiàn)實。...
2023-07-07 標(biāo)簽：XMLWeb服務(wù)器javascriptJSON 974
調(diào)用HLS的FFT庫實現(xiàn)N點FFT（hls:fft）
在HLS中用C語言實現(xiàn)8192點FFT，經(jīng)過測試，實驗結(jié)果正確，但是時序約束不到100M的時鐘，應(yīng)該是設(shè)計上的延時之類的比較大，暫時放棄這個方案...
3個經(jīng)典的Traceroute排障案例解析
Traceroute是為了探測源節(jié)點到目的節(jié)點之間數(shù)據(jù)報文所經(jīng)過的路徑。 利用IP報文的TTL域在每經(jīng)過一個路由器的轉(zhuǎn)發(fā)后減一，當(dāng)TTL=0時則向源節(jié)點報告TTL超時這個的特性。...
PCIe—Bar空間是怎么生效的？
最近在研究cocotbext-pcie的實現(xiàn)，對于學(xué)習(xí)PCIe還是挺有幫助的，陸陸續(xù)續(xù)做個總結(jié)，有時間也會在SpinalHDL下實現(xiàn)類似的方針功能。...
C語言參數(shù)管理代碼框架更新
初版的代碼在序列化時沒有考慮到MCU小容量內(nèi)存設(shè)備，需要一次性完成序列化，內(nèi)存開銷較大等等其他問題。...
Linux內(nèi)存泄漏檢測實現(xiàn)原理與實現(xiàn)
在使用沒有垃圾回收的語言時（如 C/C++），可能由于忘記釋放內(nèi)存而導(dǎo)致內(nèi)存被耗盡，這叫 內(nèi)存泄漏。...
2023-07-03 標(biāo)簽：Linux系統(tǒng)C++語言 1032
isolation cell的低功耗設(shè)計
isolation cell（隔離單元），通常用于電源關(guān)斷技術(shù)（PSO）和多電源多電壓技術(shù)（MSMV）。起到不同電壓域之間的電壓鉗制和隔離作用。...
2023-06-30 標(biāo)簽：低功耗設(shè)計ISOCELL低功耗設(shè)計 1379
微服務(wù)架構(gòu)必讀篇-網(wǎng)關(guān)
由于互聯(lián)網(wǎng)的高速發(fā)展，網(wǎng)絡(luò)數(shù)據(jù)請求數(shù)激增，使得服務(wù)器承受的壓力越來越大。...
2023-06-30 標(biāo)簽：DDoSLinux系統(tǒng)URLJAVA語言AMQP 1069
值得一看的嵌入式編程規(guī)范
編寫代碼時最重要的一條規(guī)則是：檢查周圍的代碼并嘗試模仿它。...
2023-06-30 標(biāo)簽：嵌入式系統(tǒng)計數(shù)器C語言 1164
西門子PLC編程語言介紹
PLC目前有5種標(biāo)準(zhǔn)的編程語言，包括圖形化編程語言和文本化編程語言。...
testbench是什么? testbench測試的機(jī)制是什么?
廢話不多說直接上干貨，testbench就是對寫的FPGA文件進(jìn)行測試的文件，可以是verilog也可以是VHDL。...
2023-06-28 標(biāo)簽：FPGA設(shè)計交換機(jī)VHDL語言FPGA設(shè)計PWM模塊VHDL語言交換機(jī) 6330
verilog實現(xiàn)簡單分頻器的方案
偶數(shù)分頻最為簡單，很容易用模為N的計數(shù)器實現(xiàn)50%占空比的時鐘信號，即每次計數(shù)滿N（計到N-1）時輸出時鐘信號翻轉(zhuǎn)。...
2023-06-28 標(biāo)簽：FPGA設(shè)計分頻器計數(shù)器UART接口Verilog語言 2979
Verilog實現(xiàn)邊沿檢測的原理
邊沿檢測大致分為：上升沿檢測，下降沿檢測和，雙沿檢測。原理都是通過比輸入信號快很多的時鐘去采集信號，當(dāng)出現(xiàn)兩個連續(xù)的采集值不等的時候就是邊沿產(chǎn)生處。...
2023-06-28 標(biāo)簽：仿真器狀態(tài)機(jī)CLKVerilog語言 4170
時鐘是電路的實際控制者？
時鐘是整個FPGA設(shè)計里面無法回避的事物，不能認(rèn)識時鐘也就沒法做FPGA設(shè)計。...
2023-06-28 標(biāo)簽：FPGA設(shè)計計數(shù)器RTL觸發(fā)器C++語言 674
LUT是什么構(gòu)成的？FPGA里的LUT有什么作用？
首先開門見山的回答這個問題——LUT的作用是 **實現(xiàn)所有的邏輯函數(shù)** ，也就是類似于計算Y=A&B+C+D之類的算式結(jié)果！...
2023-06-28 標(biāo)簽：RAM觸發(fā)器LUTVerilog語言FPGA系統(tǒng)LUTRAMVerilog語言觸發(fā)器 4590
verilog語言面向硬件設(shè)計的思維
讀者如果學(xué)習(xí)了verilog，并且有了一定的實踐經(jīng)驗的話應(yīng)該強(qiáng)烈的感受到，verilog和軟件（諸如C/C++）有著本質(zhì)且明顯的差別，是一條不可跨越的鴻溝。...
2023-06-28 標(biāo)簽：計數(shù)器觸發(fā)器狀態(tài)機(jī)C++語言Verilog語言 1010
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