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FPGA/ASIC技術(shù)
電子發(fā)燒友本欄目為FPGA/ASIC技術(shù)專欄，內(nèi)容有fpga培圳資料、FPGA開(kāi)發(fā)板、FPGA CPLD知識(shí)以及FPGA/ASIC技術(shù)的其它應(yīng)用等；是您學(xué)習(xí)FPGA/ASIC技術(shù)的好欄目。
FPGA時(shí)序Bug分析
Bug的現(xiàn)象是這樣的，假設(shè)我們跑一次test，結(jié)果正確為T(mén)，結(jié)果不正確為F。...
2023-07-30 標(biāo)簽：FPGAFPGA設(shè)計(jì)fpga時(shí)序TCP通信 848
FPGA時(shí)序分析-建立時(shí)間和保持時(shí)間裕量都是inf怎么解決呢？
今天有個(gè)小伙伴遇到一個(gè)問(wèn)題，就是在vivado里面綜合后看到的建立時(shí)間和保持時(shí)間裕量都是inf，我們來(lái)看看怎么解決這個(gè)問(wèn)題。...
2023-07-30 標(biāo)簽：FPGAFPGA設(shè)計(jì)寄存器時(shí)序分析CLKVivado 2389
如何實(shí)現(xiàn)基于FPGA Vivado的74系列IP封裝呢？
雙擊桌面圖標(biāo)打開(kāi)Vivado 2017.2，或者選擇開(kāi)始>所有程序>Xilinx Design Tools> Vivado 2017.2>Vivado 2017.2；...
2023-07-30 標(biāo)簽：FPGAFPGA設(shè)計(jì)TCLNAND閃存RTLIP封裝 1496
Meta：正在多款自研芯片上使用RISC-V
在DAC 2023上，Meta 的 ASIC 工程經(jīng)理 Himanshu Sanghavi 談到了 Meta 正在使用 RISC-V 開(kāi)展的各種項(xiàng)目。...
2023-07-27 標(biāo)簽：處理器ASIC設(shè)計(jì)機(jī)器學(xué)習(xí)硬件加速器RISC-V 1633
復(fù)位信號(hào)是什么意思？復(fù)位信號(hào)的作用？詳解Xilinx FPGA復(fù)位信號(hào)那些事
復(fù)位信號(hào)幾乎是除了時(shí)鐘信號(hào)外最常用的信號(hào)了，幾乎所有數(shù)字系統(tǒng)在上電的時(shí)候都會(huì)進(jìn)行復(fù)位，這樣才能保持設(shè)計(jì)者確定該系統(tǒng)的系統(tǒng)模式的狀態(tài)，以便于更好的進(jìn)行電子設(shè)計(jì)，并且在任意時(shí)...
2023-07-27 標(biāo)簽：FPGA驅(qū)動(dòng)器反相器Xilinx時(shí)鐘RTL觸發(fā)器FPGA芯片復(fù)位信號(hào) 12663
FPGA Vivado-TLC549驅(qū)動(dòng)設(shè)計(jì)介紹
在生活中，數(shù)模轉(zhuǎn)換的例子到處可見(jiàn)。但是在我們做FPGA設(shè)計(jì)時(shí)，需要對(duì)數(shù)字信號(hào)進(jìn)行處理，但是，不是所有的信號(hào)都是以數(shù)字信號(hào)的形式體現(xiàn)的，比如光信號(hào)、聲信號(hào)、電信號(hào)等等。...
2023-07-27 標(biāo)簽：FPGAFPGA設(shè)計(jì)寄存器數(shù)模轉(zhuǎn)換器AD芯片TLC549 1866
基于HLS之任務(wù)級(jí)并行編程
? HLS任務(wù)級(jí)編程第一篇文章可看這里： HLS之任務(wù)級(jí)并行編程 HLS的任務(wù)級(jí)并行性（Task-level Parallelism）分為兩種：一種是控制驅(qū)動(dòng)型；一種是數(shù)據(jù)驅(qū)動(dòng)型。對(duì)于控制驅(qū)動(dòng)型，用戶要手工添加DATAF...
如何使用FPGA來(lái)設(shè)計(jì)智能網(wǎng)卡（SmartNIC）？
智能服務(wù)器適配器或智能網(wǎng)卡（SmartNIC）通過(guò)從服務(wù)器的CPU上卸載網(wǎng)絡(luò)處理工作負(fù)載和任務(wù)，提高云端和私有數(shù)據(jù)中心中的服務(wù)器性能。...
2023-07-27 標(biāo)簽：處理器FPGAFPGA設(shè)計(jì)適配器ARM處理器SmartNIC 2641
到底誰(shuí)能提升Calibre的效率？
Siemens的Calibre是業(yè)內(nèi)權(quán)威的版圖驗(yàn)證軟件，被各大Foundry廠廣泛認(rèn)可。用戶可以直接在Virtuoso界面集成Calibre接口，調(diào)用版圖驗(yàn)證結(jié)果數(shù)據(jù)，使用起來(lái)極為方便。...
2023-07-25 標(biāo)簽：芯片設(shè)計(jì)仿真器SWAPDRCFPGA開(kāi)發(fā)板 2045
如何實(shí)現(xiàn)一種基于FPGA的橫向FIR濾波器設(shè)計(jì)？
設(shè)經(jīng)過(guò)AD采集得到的輸入序列為x(n)，其通過(guò)單位沖激響應(yīng)為h(n)的因果FIR濾波器后，輸出y(n)在時(shí)域可表示為線性卷積和的形式...
2023-07-25 標(biāo)簽：FPGA設(shè)計(jì)寄存器fir濾波器AD采樣Verilog語(yǔ)言 1209
FPGA的程序固化步驟簡(jiǎn)析
FPGA程序的固化，即掉電后再上電，程序仍能正常運(yùn)行。...
2023-07-19 標(biāo)簽：FPGAled燈Flash存儲(chǔ) 3568
Signal tap邏輯分析儀使用教程
在之前的設(shè)計(jì)開(kāi)發(fā)時(shí)，利用modelsim得出中間某單元的數(shù)據(jù)，并且輸入也是設(shè)計(jì)者在testbench中自己給出的。...
2023-07-18 標(biāo)簽：FPGA設(shè)計(jì)存儲(chǔ)器RTL邏輯分析儀jtag接口 1521
什么是硬件卸載？什么是軟件定義網(wǎng)絡(luò)？硬件卸載如何提供幫助？
CPU作為計(jì)算機(jī)的“大腦”扮演著重要的作用，網(wǎng)絡(luò)、存儲(chǔ)、計(jì)算……各種處理都需要CPU“親歷親為”，導(dǎo)致其負(fù)荷過(guò)重，極大地影響了效率。為了解決這個(gè)問(wèn)題，人們先后嘗試了多種方法：擴(kuò)充...
2023-07-17 標(biāo)簽：處理器FPGA設(shè)計(jì)路由器虛擬機(jī)VLAN技術(shù) 3045
SPI協(xié)議驅(qū)動(dòng)設(shè)計(jì)
I2C 即 Inter-Integrated Circuit（集成電路總線），這種總線類(lèi)型是由飛利浦半導(dǎo)體公司在八十年代初設(shè)計(jì)出來(lái)的一種簡(jiǎn)單、雙向、二線制、同步串行總線，主要是用來(lái)連接整體電路（ICS） ，I2C是一...
2023-07-17 標(biāo)簽：FPGA設(shè)計(jì)EEPROMSPI協(xié)議SDASCL 1559
FPGA狀態(tài)機(jī)設(shè)計(jì)思想
硬件電路設(shè)計(jì)通常以并行方式實(shí)現(xiàn)，但是在實(shí)際工程中經(jīng)常會(huì)存在系統(tǒng)按照順序邏輯執(zhí)行的需求。...
2023-07-17 標(biāo)簽：FPGA設(shè)計(jì)RTL狀態(tài)機(jī)fsmNand flash 1608
IIC協(xié)議驅(qū)動(dòng)設(shè)計(jì)
I2C 即 Inter-Integrated Circuit（集成電路總線），這種總線類(lèi)型是由飛利浦半導(dǎo)體公司在八十年代初設(shè)計(jì)出來(lái)的一種簡(jiǎn)單、雙向、二線制、同步串行總線，主要是用來(lái)連接整體電路（ICS） ，I2C是一...
2023-07-17 標(biāo)簽：FPGA設(shè)計(jì)EEPROMSDASCLIIC協(xié)議 1119
什么是時(shí)序分析？教你掌握FPGA時(shí)序約束
時(shí)序分析本質(zhì)上就是一種時(shí)序檢查，目的是檢查設(shè)計(jì)中所有的D觸發(fā)器是否能夠正常工作，也就是檢查D觸發(fā)器的同步端口（數(shù)據(jù)輸入端口）的變化是否滿足建立時(shí)間要求（Setup）和保持時(shí)間要求...
2023-07-14 標(biāo)簽：RAMD觸發(fā)器時(shí)序分析STAFPGA開(kāi)發(fā)板 6171
AMD Versal系列FPGA NoC介紹及實(shí)戰(zhàn)
NoC是相對(duì)于SoC的新一代片上互連技術(shù)，從計(jì)算機(jī)發(fā)展的歷史可以看到NoC 必將是SoC 之后的下一代主流技術(shù)...
2023-07-13 標(biāo)簽：微控制器FPGA存儲(chǔ)器微處理器SoC技術(shù) 1647
ASIC設(shè)計(jì)約束與SDC命令介紹
在數(shù)字IC設(shè)計(jì)中，重要的ASIC設(shè)計(jì)約束分為兩類(lèi)...
2023-07-12 標(biāo)簽：處理器IC設(shè)計(jì)ASIC設(shè)計(jì)DRC同步器 2221
FPGA設(shè)計(jì)中動(dòng)態(tài)時(shí)鐘的使用方法
時(shí)鐘是每個(gè) FPGA 設(shè)計(jì)的核心。如果我們正確地設(shè)計(jì)時(shí)鐘架構(gòu)、沒(méi)有 CDC 問(wèn)題并正確進(jìn)行約束設(shè)計(jì)，就可以減少與工具斗爭(zhēng)的時(shí)間。...
2023-07-12 標(biāo)簽：FPGA設(shè)計(jì)寄存器CDC動(dòng)態(tài)時(shí)鐘Vivado 2000
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