FPGA/ASIC技術
電子發(fā)燒友本欄目為FPGA/ASIC技術專欄，內容有fpga培圳資料、FPGA開發(fā)板、FPGA CPLD知識以及FPGA/ASIC技術的其它應用等；是您學習FPGA/ASIC技術的好欄目。
HLS系列 – High LevelSynthesis(HLS) 的端口綜合1
在之前HLS的基本概念1里有提及，HLS會把c的參數映射成rtl的端口實現。本章開始總結下HLS端口綜合的一些知識。 1.HLS綜合后的rtl端口大體可以分成2類： Clock Reset端口： 每個設計只能有一個Cloc...
2017-02-08 標簽： 1212
美啟動大腦阿波羅計劃:繪制10萬神經元活動地圖
30年前，美國政府啟動人類基因組計劃—— 一個長達13年的測序及繪制所有人類基因的研究項目。盡管項目一開始遭到了懷疑乃至反對，但是該計劃卻讓遺傳學研究領域從此煥然一新，并被認為...
2017-02-08 標簽： 340
HLS系列–High Level Synthesis(HLS)的端口綜合2
在上一章HLS的端口綜合里有提及，HLS綜合后的端口分為2中類型：BlockLevel和Port Level Interface。其中Port level是我們需要重點關注的，它又可以細分為4中類型： A. AXI4-Interface：支持Stream，Lite，Full共...
2017-02-08 標簽： 895
基于DirectShow的多攝像頭視頻采集
1.為什么使用DirectShow 筆者使用的是兩個USB攝像頭，單攝像頭視頻采集使用OpenCV的VideoCapture類沒有問題，但是雙攝像頭就有問題，一個正常，另外一個采集不到信息，顯示一片灰色。網上有種解...
2017-02-08 標簽： 3960
HLS系列 – High Level Synthesis(HLS) 的一些基本概念4
繼續(xù)HLS的基本概念。 1、DataFlow的概念，以及Dataflow和Pipeline的區(qū)別 如下所示的圖像處理過程，數據處理由2個濾波器構成： 默認情況下，HLS會遵循c邏輯中的先后順序，依次調度2個函數。所以整...
2017-02-08 標簽： 1414
借助NOR Flash實現UltraScale FPGA后配置解決方案
作者：kenshin NOR Flash是一種非易失性存儲器件，與其相似的還有NAND Flash，但是NOR Flash具有類似SRAM的并行接口，有足夠的地址引腳來尋址，讀數據的速度更快，因此多用于微控制器啟動配置外部...
2017-02-08 標簽： 1699
Xilinx 專家教你如何將系統級的單位功耗性能提升2
您的系統是否有不容妥協的功耗預算和熱要求？大多數情況下答案是肯定的！ 一般而言您無法隨意提升性能，因為這樣會導致功耗的不受控制。單位功耗性能是設計系統時最關鍵的指標之一，...
2017-02-08 標簽： 523
百度采用 Xilinx FPGA 加速機器學習應用
全可編程技術和器件的全球領先企業(yè)賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX))今天宣布，全球領先的中文互聯網搜索引擎提供商百度正在采用賽靈思 FPGA 加速其中國數據中心的機器學習應用。兩家公司...
2017-02-08 標簽： 418
MicroZed開發(fā)板筆記，第72部分：多周期約束
By Adam Taylor 在最近的幾篇博客中，我們研究了基本的時序約束。那么在設計中我們現在應該能定義時鐘了，并且可以創(chuàng)建和聲明它們的關系，還應該能在時鐘和系統中聲明任何缺陷。作為系統設...
2017-02-08 標簽： 510
如何通過SerDes獲得32Gbps的板級傳輸速度
作者：Steve Leibson, 賽靈思戰(zhàn)略營銷與業(yè)務規(guī)劃總監(jiān) 我設計PCB已經多久了，但很不好意思的說，一直都沒聽說過PCB可以有超過1Gbps的信號傳輸。我正在寫的東西是關于最新的Xilinx 16nmVirtex UltraSca...
2017-02-08 標簽： 928
一個DSP怪物的演化：具有大量DSP的UltraScale+ 和UItraScale全可編程器件
作者：Steve Leibson, 賽靈思戰(zhàn)略營銷與業(yè)務規(guī)劃總監(jiān) 采用16nm工藝的Virtex UltraScale+全可編程器件的最多DSP數量是11904DSP48E2 slices。那是一個很大很大的數目。它已經大到足以讓我好好地回顧賽靈思全...
2017-02-08 標簽： 770
7000器件在測量類紅外圖像系統中的應用
備注：主圖是從Fluke TiX1000宣傳冊中截取 作者：Hello，Panda 基于非制冷探測器的紅外測量系統可在各領域廣泛應用。如海關、機場等公共場所民眾體溫監(jiān)測，芯片、焊點、激光光纖等微米級目標...
2017-02-08 標簽： 516
模塊間連接及輸入輸出端口設置
1、點擊XPS的Ports選項卡，包括個模塊，ExternalPorts是所有PS的對外輸出管腳，也就是PS部分與外部相連的管腳；axi_interconnect_1是總線連接器模塊；processing_system7_0是嵌入式處理器內核模塊；my_gpio...
2017-02-08 標簽： 1751
Xilinx FPGA I/O電平標準簡介（三）
作者：Player? FPGA那點事兒 一、GTLP（GunningTransceiver Logic Plus） GTL+電平標準即岡寧收發(fā)器邏輯電平標準加，是在Pentium Pro處理器中首先使用的一種高速總線電平標準，該標準需要差分放大輸入bu...
2017-02-08 標簽： 3412
淺談Xilinx Microblaze Bootloader實現
作者：Hello，Panda 一般而言，Xilinx Microblaze會被用來在系統中做一些控制類和簡單接口的輔助性工作，比如運行IIC、SPI、UART之類的低速接口驅動，對FPGA邏輯功能模塊初始化配置及做些輔助計算等...
2017-02-08 標簽： 2146
Xilinx FPGA I/O電平標準簡介（二）
三、PCI（PeripheralComponent Interconnect） PCI電平標準即外設器件互聯電平標準，該標準支持33MHz和66MHz的總線應用，包括PCI-X、PCI-33、PCI-66等各類電平標準，該標準的輸入輸出供電電壓（VCCO）為3.3V，...
2017-02-08 標簽： 2911
HLS系列– HLS中的數據類型1
數據類型優(yōu)化的意義 C語言中所提供的數據類型，其長度都是8bit的整數倍（8,16,32,64bits）。但是rtl所描述的硬件，卻可以支持任意長度的數據寬度。所以，在很多情況下，使用標準C所提供的數據...
2017-02-08 標簽： 1317
HLS系列–HighLevel Synthesis(HLS)的端口綜合8
本章介紹PortLevel Interface中的最后一個IO Protocol：ap_bus 。 ap_bus可以用來和外部的總線進行互聯，它不遵循任何標準的總線協議，但是它也有自己的總線接口時序，雖然并不復雜。從接口特性上，...
2017-02-08 標簽： 702
HLS系列 – High Level Synthesis(HLS) 的端口綜合7
在前幾章里，已經分別介紹了BlockLevel Interface，Port Level Interface中的NoI/O Protocol和AXI4。本章里著重介紹下Port Level Interface的另一個子類別：MemoryInterface： Memory Interface中分為3個子類別，分別是：...
2017-02-08 標簽： 1371
FPGA配置– 使用JTAG是如何燒寫SPI/BPI Flash的？
Xilinx的JTAG電纜可以通過FPGA“直接”燒寫SPI/BPI。很多對xilinx開發(fā)環(huán)境不熟悉的用戶，如果第一次接觸這種燒寫模式可能會有疑惑，FPGA是如何做到JTAG和Flash之間的橋接的，難道FPGA內部有專用的電...
2017-02-08 標簽： 10601
深度學習：基于FPGA的解決方案更具優(yōu)勢
近幾年來人工智能相關信息登上了各大媒體頭條，自動駕駛，無人車也不再顯得那么陌生，其實這一切都源于機器學習，深度學習和人工神經網絡等相關學科的興起。機器學習（Machine Learning,...
2017-02-08 標簽： 454
HLS系列–實例分享，用HLS實現Goertzel算法（快速頻點檢測）
HLS非常適合一些信號處理模塊的快速實現。下面是一個實際的例子，由于使用了HLS，非常高效的就完成了模塊的rtl的實現，比用手工coding節(jié)約了大量的時間！ 需求描述： 在一個項目里面，需要...
2017-02-08 標簽： 1189
基于vivado的fir ip核的重采樣設計與實現
本文基于xilinx 的IP核設計，源于音頻下采樣這一需求。 創(chuàng)建vivado工程 1. 首先打開vivado，創(chuàng)建一個新的project（勾選create project subdirectory選項），并將工程命填為firfilter。 2.選擇工程創(chuàng)建的類型為...
2017-02-08 標簽：FIR 6079
雙通道方法讓Zynq SoC資源利用最大化
By Adam P. Taylor 本篇的摘錄和改編來自于Xcell雜志的最近一期 許多裸機應用和簡單的操作系統只使用ZYNQ SoC PS( processing system)中的兩個ARM內核中的一個，一種設計上的選擇會潛在地限制了系統的性...
2017-02-08 標簽： 417
Adam Taylor玩轉MicroZed系列，第75部分：放置約束
By Adam Taylor 在先前的博客中我們研究過I/O約束，下一個合乎邏輯的步驟就是研究如何在我們的設計中用FPGA進行放置和布線約束。使用放置約束的原因如下：為了幫助實現時序，或者為了在設計...
2017-02-08 標簽： 451
Adam Taylor玩轉MicroZed系列74：物理約束
研究了相關的時序約束后，在設計中我們也不能忽視所能運用到的物理約束。一個工程師最常用的物理約束是I/O管腳的放置和與每個I/O腳相關的參數定義（標準、驅動能力等）。然而，還有其它...
2017-02-08 標簽： 519
采用高速串行端口的I/O bit傳輸比FPGA仿真有更廣的適用性
作者：Steve Leibson, 賽靈思戰(zhàn)略營銷與業(yè)務規(guī)劃總監(jiān) Luis Bielich所撰寫的名為Zero Latency Multiplexing I/O for ASIC Emulation的Xilinx應用手冊XAPP1217介紹了一種技術。這種技術使用一個高速的串行接口，將許多...
2017-02-08 標簽： 579
如何把PetaLinux移植到Xilinx FPGA上
作者：作者：Sweta（印度班加羅爾PES理工學院），Srikanth Chintala（印度班加羅爾遠程信息處理開發(fā)中心），以及Manikandan?教授（印度班加羅爾PES大學） （賽靈思中國通訊雜志的最新一期（55期）...
2017-02-08 標簽： 642
Adam Taylor玩轉MicroZed系列73：用其他的Zynq
By Adam Taylor 在過去一周中，我接到了很多不同人的來信，他們正在使用以Zynq為基礎的開發(fā)工具。他們非常想知道怎么樣去把MicroZed系列博客教程應用到他們所選擇的硬件平臺上。加上Avnet Micro...
2017-02-08 標簽： 801
關于XDC約束文件，你需要知道的幾點
作者：?圓宵?FPGA那點事兒 在ISE時代，使用的是UCF約束文件。從Vivado開始，XDC成了唯一支持的約束標準。XDC除了遵循工業(yè)界的通行標準SDC（Synopsys Design Constraints）之外，還加入了XILINX FPGA特有的...
2017-02-08 標簽： 5942
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