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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。
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關(guān)于Xilinx FPGA如何獲取FPGA的Device DNA
作者:Evening Xilinx每一個FPGA都有一個獨特的ID,也就是Device DNA,這個ID相當(dāng)于我們的身份證,在FPGA芯片生產(chǎn)的時候就已...
基于VIVADO搭建ARM+FPGA系統(tǒng)架構(gòu)實現(xiàn)軟硬件聯(lián)合開發(fā)
上一期,我們重點學(xué)習(xí)了ZYNQ的PL開發(fā),本期我們側(cè)重于進(jìn)行PS開發(fā)的學(xué)習(xí)。我們將在 VIVADO 開發(fā)環(huán)境下搭建 ARM+FPGA 的系統(tǒng)架構(gòu),并在 ...
ZYNQ系列開發(fā)板:PS控制PL產(chǎn)生需要的PWM波
創(chuàng)建一個IP核,tools-->Create and Package ,這里需要16個寄存器,創(chuàng)建方法見系列(六)、系列(七),這里命名為...
如何在不改變RTL代碼的情況下,優(yōu)化FPGA HLS設(shè)計
用軟件從 C 轉(zhuǎn)化來的 RTL 代碼其實并不好理解。今天我們就來談?wù)劊绾卧诓桓淖?RTL 代碼的情況下,提升設(shè)計性能。 本項目所需應(yīng)用與工具:賽靈思H...
2020-12-20 標(biāo)簽:fpga 2.6k 0
如何使用 InTime 軟件優(yōu)化 FPGA 設(shè)計
教程介紹 本教程旨在指導(dǎo)用戶通過 Plunify Cloud 的云服務(wù)器,來使用 InTime 軟件優(yōu)化 FPGA 設(shè)計。如果您首次使用 InTime,...
2020-12-21 標(biāo)簽:fpga 2.1k 0
基于有限狀態(tài)機(jī)[8]的DSR路由表項設(shè)計實現(xiàn)方法
本文為在FPGA中支持DSR協(xié)議的路由表項管理功能,設(shè)計一種基于有限狀態(tài)機(jī)[8]的實現(xiàn)方法。
2020-12-22 標(biāo)簽:fpga狀態(tài)機(jī)DSR 3.1k 0
Pentek 開展的FPGA設(shè)計,縮短設(shè)計周期同時最小化風(fēng)險
作者:Robert Sgandurra,Pnetek公司產(chǎn)品總監(jiān) 當(dāng)面對一個項目計劃時,你最后一次聽到“需要多長時間就花多長時間”或者“如果第一次不成功...
FPGA的幾種典型應(yīng)用 基于FPGA的小Tips設(shè)計
作者: Hello,Panda 一、寫在前面 FPGA 是可編程芯片,因此FPGA 的設(shè)計方法包括硬件設(shè)計和軟件設(shè)計兩部分。硬件包括 FPGA 芯片電路...
Xilinx 7系列FPGA全系內(nèi)置了一個ADC,稱呼為XADC。 這個XADC,內(nèi)部是兩個1mbps的ADC,可以采集模擬信號轉(zhuǎn)為數(shù)字信號送給FPGA...
基于Arty Artix-35T FPGA開發(fā)板的DDR3和mig介紹
講解xilinx FPGA 使用mig IP對DDR3的讀寫控制,旨在讓大家更快的學(xué)習(xí)和應(yīng)用DDR3。 本實驗和工程基于Digilent的Arty Ar...
多用途軟件無線電系統(tǒng)的5G設(shè)計解決方案
本文旨在讓無線電工程師熟悉一種現(xiàn)成的多用途軟件無線電(COTS SDR)平臺,該平臺可以縮短5G的開發(fā)時間。 COTS SDR傳統(tǒng)上一直用于軍用雷達(dá)和通...
通過Arty Artix-35T FPGA開發(fā)板創(chuàng)建mig IP
講解xilinx FPGA 使用mig IP對DDR3的讀寫控制,旨在讓大家更快的學(xué)習(xí)和應(yīng)用DDR3。 本實驗和工程基于Digilent的Arty Ar...
基于Digilent的Arty Artix-35T FPGA開發(fā)板的DDR3讀寫控制
將通過五篇文章來給大家講解xilinx FPGA 使用mig IP對DDR3的讀寫控制,旨在讓大家更快的學(xué)習(xí)和應(yīng)用DDR3。 本實驗和工程基于Digil...
音頻總線I2S協(xié)議:I2S收發(fā)模塊FPGA的仿真設(shè)計
1 概述 I2S(Inter—IC Sound)總線, 又稱 集成電路內(nèi)置音頻總線,是飛利浦公司為數(shù)字音頻設(shè)備之間的音頻數(shù)據(jù)傳輸而制定的一種總線標(biāo)準(zhǔn),該...
基于ECE-CV K7-75T FPGA開發(fā)板的HDMI視頻流輸入輸出實現(xiàn)方案
本實驗基于ECE-CV K7-75T FPGA開發(fā)板實現(xiàn)。 軟件使用Vivado 2018.1。 基于HDMI的視頻流輸入輸出實驗 1 HDMI概述 H...
一種彈速補(bǔ)償?shù)腇PGA實現(xiàn)方案解析
來源:電子技術(shù)應(yīng)用ChinaAET 針對高速運動平臺彈速補(bǔ)償?shù)膶崟r性要求,在基于距離徙動校正(Range Cell Migration Compensa...
2020-12-14 標(biāo)簽:fpga 2.8k 0
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