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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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采用FPGA與ADF4111實(shí)現(xiàn)數(shù)字鎖相式頻率源的設(shè)計
在短波數(shù)字接收系統(tǒng)中,從天線端接收到的短波信號與本振信號混頻得到70 MHz中頻,之后對中頻信號進(jìn)行帶通采樣。本振信號的穩(wěn)定性和準(zhǔn)確度對系統(tǒng)性能有著重要...
隨著現(xiàn)在AI的快速發(fā)展,使用FPGA和ASIC進(jìn)行推理加速的研究也越來越多,從目前的市場來說,有些公司已經(jīng)有了專門做推理的ASIC,像Groq的LPU,...
采用FPGA來實(shí)現(xiàn)系統(tǒng)定制流量管理
隨著通信協(xié)議的發(fā)展及多樣化,協(xié)議處理部分PE在硬件轉(zhuǎn)發(fā)實(shí)現(xiàn)方面,普遍采用現(xiàn)有的商用芯片NP(Network Processor,網(wǎng)絡(luò)處理器)來完成,流量...
在 FPGA(Zynq? UltraScale+? MPSoC) 上的 Ubuntu 22.04 桌面映像上安裝了各種 EE 設(shè)計應(yīng)用程序(包括 KiC...
2024-02-26 標(biāo)簽:fpgaSD卡PCB設(shè)計 3.3k 0
基于FPGA器件實(shí)現(xiàn)大容量高速存儲系統(tǒng)的方案設(shè)計
本文介紹了一種以FPGA作為控制器,F(xiàn)LASH MEMORY作為主存儲器的大容量高速存儲系統(tǒng)方案,并對關(guān)鍵技術(shù)及實(shí)現(xiàn)途徑進(jìn)行了論述,在存儲容量及存儲速度...
2020-07-30 標(biāo)簽:fpga存儲器數(shù)據(jù)采集 3.3k 0
如何為汽車ADAS和信息娛樂系統(tǒng)實(shí)現(xiàn)移動接口橋接的方法分析
在信息娛樂應(yīng)用領(lǐng)域,CrossLink可提供低功耗、低成本、傳感器和攝像頭接口橋接。它能夠聚合來自多個圖像傳感器的數(shù)據(jù),通過單個CSI-2接口將數(shù)據(jù)傳輸...
2019-08-22 標(biāo)簽:傳感器fpgaADAS系統(tǒng) 3.3k 0
采用NIOSII處理器實(shí)現(xiàn)IEEE-1394b雙向通信數(shù)據(jù)傳輸設(shè)計
現(xiàn)在符合1394b標(biāo)準(zhǔn)的鏈路層和物理層控制芯片都遵循1394 OHCI(開放式主機(jī)控制接口協(xié)議),它的主要功能是實(shí)現(xiàn)總線的鏈路層協(xié)議。本系統(tǒng)通過NIOS...
在特定條件下采用更智能的技術(shù)來隔離特定錯誤,找到問題電路的源頭并漸進(jìn)式修復(fù)錯誤,這很重要。Synopsys 公司的Synplify Premier 和S...
采用RAM分區(qū)循環(huán)移位法來實(shí)現(xiàn)DVB-C解交織器的設(shè)計
在DVB-C系統(tǒng)當(dāng)中,實(shí)際信道中的突發(fā)錯誤往往是由脈沖干擾、多徑衰落引起的,在統(tǒng)計上是相關(guān)的,所以一旦出現(xiàn)不能糾正的錯誤時,這種錯誤將連續(xù)存在。因此在D...
基于FPGA的軟核處理器設(shè)計實(shí)現(xiàn)
本課程從數(shù)字IC設(shè)計工程師應(yīng)具備的基本技能講起。首先介紹數(shù)字芯片設(shè)計流程,主流EDA工具的使用,包括Design Compiler、Prime Time...
基于FPGA技術(shù)的紅外實(shí)時采集系統(tǒng)設(shè)計
介紹了一種基于FPGA技術(shù)的紅外視頻采集系統(tǒng)組成架構(gòu),給出了各功能模塊的實(shí)現(xiàn)方法,包括主要的HDL代碼、SignaltapII波形以及QuartusII...
基于FPGA的神經(jīng)網(wǎng)絡(luò)加速硬件和網(wǎng)絡(luò)設(shè)計的協(xié)同
作者對shuffleNetV2網(wǎng)絡(luò)結(jié)構(gòu)進(jìn)行了更有利于FPGA部署的微調(diào)。
2020-11-21 標(biāo)簽:fpga神經(jīng)網(wǎng)絡(luò) 3.3k 0
Debug Core UUID mismatch案例總結(jié)
Efinity在Debug時會出現(xiàn)UUID mismatch錯誤。很多剛開始使用的人經(jīng)常遇到。下面我們做一個總結(jié)。歡迎遇到案例時共同分享。
HZ-CORE-RK3588J_K7 FPGA技術(shù)架構(gòu)及應(yīng)用分析
HZ-CORE-RK3588J_K7是合眾恒躍推出的一款A(yù)RM+FPGA異構(gòu)融合的工業(yè)級核心板,集成了瑞芯微RK3588J處理器和XilinxKinte...
基于FPGA器件實(shí)現(xiàn)AMI編碼器和譯碼器的設(shè)計
實(shí)際的基帶傳輸系統(tǒng),含有豐富直流和低頻成分的基帶信號不適宜在信道中傳輸。而對具有易獲取定時信息、無直流成分和只有很小的低頻成分、以及具有內(nèi)在糾錯能力的信...
基于FPGA硬件實(shí)現(xiàn)H.264變換量化整體結(jié)構(gòu)的設(shè)計方案
H.264高效的編碼效率是以其高復(fù)雜性為代價的,因此制約了它在高分辨率、實(shí)時處理等方面的應(yīng)用。而FPGA器件采用流水控制策略和并行處理方式,可為H.26...
1 引言 數(shù)據(jù)采集系統(tǒng)常需要進(jìn)行異步串行數(shù)據(jù)傳輸。目前廣泛使用的RS232異步串行接口,如
2011-01-09 標(biāo)簽:fpga數(shù)據(jù)采集系統(tǒng) 3.3k 0
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