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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門(mén)陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。
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FPGA之狀態(tài)機(jī)練習(xí):設(shè)計(jì)思路(5)
狀態(tài)機(jī)可歸納為4個(gè)要素,即現(xiàn)態(tài)、條件、動(dòng)作、次態(tài)。這樣的歸納,主要是出于對(duì)狀態(tài)機(jī)的內(nèi)在因果關(guān)系的考慮?!艾F(xiàn)態(tài)”和“條件”是因,“動(dòng)作”和“次態(tài)”是果。
2019-10-09 標(biāo)簽:fpga狀態(tài)機(jī) 2.9k 0
如何用FPGA技術(shù)實(shí)現(xiàn)深度卷積網(wǎng)絡(luò)(7)
卷積神經(jīng)網(wǎng)絡(luò)仿造生物的視知覺(jué)(visual perception)機(jī)制構(gòu)建,可以進(jìn)行監(jiān)督學(xué)習(xí)和非監(jiān)督學(xué)習(xí),其隱含層內(nèi)的卷積核參數(shù)共享和層間連接的稀疏性使...
2019-11-14 標(biāo)簽:fpga音頻神經(jīng)網(wǎng)絡(luò) 2.3k 0
FPGA之硬件語(yǔ)法篇:用Verilog代碼仿真與驗(yàn)證數(shù)字硬件電路
大家都知道軟件設(shè)計(jì)使用軟件編程語(yǔ)言,例如我們熟知的C、Java等等,而FPGA設(shè)計(jì)使用的是HDL語(yǔ)言,例如VHDL和Verilog HDL。說(shuō)的直白點(diǎn),...
正點(diǎn)原子開(kāi)拓者FPGA:開(kāi)拓者GUI介紹
圖形用戶(hù)界面(Graphical User Interface,簡(jiǎn)稱(chēng) GUI,又稱(chēng)圖形用戶(hù)接口)是指采用圖形方式顯示的計(jì)算機(jī)操作用戶(hù)界面。圖形用戶(hù)界面是...
2019-09-12 標(biāo)簽:fpga計(jì)算機(jī)gui 4.9k 0
FPGA 的基本結(jié)構(gòu)包括可編程輸入輸出單元,可配置邏輯塊,數(shù)字時(shí)鐘管理模塊,嵌入式塊RAM,布線資源,內(nèi)嵌專(zhuān)用硬核,底層內(nèi)嵌功能單元。由于FPGA具有布...
FPGA之狀態(tài)機(jī)設(shè)計(jì)原則
狀態(tài)機(jī)由狀態(tài)寄存器和組合邏輯電路構(gòu)成,能夠根據(jù)控制信號(hào)按照預(yù)先設(shè)定的狀態(tài)進(jìn)行狀態(tài)轉(zhuǎn)移,是協(xié)調(diào)相關(guān)信號(hào)動(dòng)作、完成特定操作的控制中心。
2019-10-09 標(biāo)簽:fpga寄存器狀態(tài)機(jī) 3k 0
FPGA之項(xiàng)目實(shí)戰(zhàn)篇:三人表決器的設(shè)計(jì)與分析
我們例舉三人表決器、數(shù)字時(shí)鐘、多終端點(diǎn)歌系統(tǒng)、數(shù)字示波器這四個(gè)實(shí)際的工程項(xiàng)目,手把手帶領(lǐng)大家從分析工程、分解工程、到最終實(shí)現(xiàn)工程。通過(guò)逐個(gè)解決工程中的實(shí)...
2019-12-06 標(biāo)簽:fpga數(shù)字示波器三人表決器 8.7k 0
如何借助Xilinx FPGA和MATLAB技術(shù)加速機(jī)器學(xué)習(xí)應(yīng)用
本演講將結(jié)合FPGA在機(jī)器學(xué)習(xí)的發(fā)展趨勢(shì)、應(yīng)用和需求,特別介紹在基于MATLAB?完成深度學(xué)習(xí)算法設(shè)計(jì)后,F(xiàn)PGA在機(jī)器學(xué)習(xí)方面的技術(shù)優(yōu)勢(shì)和特點(diǎn),并將介...
2019-12-25 標(biāo)簽:fpgaxilinx機(jī)器學(xué)習(xí) 3.2k 0
FPGA設(shè)計(jì)的主要難點(diǎn)是熟悉硬件系統(tǒng)以及內(nèi)部資源,保證設(shè)計(jì)的語(yǔ)言能夠?qū)崿F(xiàn)元器件之間的有效配合,提高程序的可讀性以及利用率。這也對(duì)設(shè)計(jì)人員提出了比較高的要...
FPGA進(jìn)階教程:DDS的設(shè)計(jì)與實(shí)現(xiàn)
小梅哥:FPGA進(jìn)階教程
2019-08-30 標(biāo)簽:fpgadds信號(hào)發(fā)生器 3.6k 0
正點(diǎn)原子FPGA實(shí)戰(zhàn)篇:基于FFT-IP核的音頻頻譜儀實(shí)驗(yàn)
正點(diǎn)原子FPGA開(kāi)發(fā)板配套視頻
2019-09-05 標(biāo)簽:fpga音頻計(jì)算機(jī) 5.3k 0
FPGA的組成結(jié)構(gòu)及優(yōu)缺點(diǎn)介紹
EEVBlog是一個(gè)講解電子設(shè)計(jì)相關(guān)知識(shí)的視頻博客,主播Dave Jones居住在澳大利亞的悉尼。這期視頻Dave Jones講解了FPGA的大致組成結(jié)...
2019-12-25 標(biāo)簽:fpga電子設(shè)計(jì) 3k 0
正點(diǎn)原子FPGA之SDRAM:SDRAM操作時(shí)序
正點(diǎn)原子FPGA開(kāi)發(fā)板配套視頻
2019-09-05 標(biāo)簽:fpgasdram計(jì)算機(jī) 4.6k 0
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