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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。
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測量領(lǐng)域以及儀表儀器領(lǐng)域中,對數(shù)字信號的測量主要便是對其信號脈沖寬度進行測量。目前使用最多的方式便是脈沖計數(shù)的方式,即通過高頻時鐘脈沖在待測信號的低電平...
2018-11-03 標(biāo)簽:FPGA 5.5k 0
如何針對FPGA或微處理器配置各種電壓輸出跟蹤和時序控制選項
為給DSP、ASIC、FPGA和微處理器的負(fù)載點供電而引起的電壓輸入軌數(shù)目的增多使得電源設(shè)計更加具有挑戰(zhàn)性。特別是由于系統(tǒng)功率和工作頻率要求的增加,造成...
許多數(shù)字處理系統(tǒng)都會使用FPGA,原因是FPGA有大量的專用DSP以及block RAM資源,可以用于實現(xiàn)并行和流水線算法。因此,通常情況下,F(xiàn)PGA都...
盡管工程師們很清楚已有 FPGA 工具的參數(shù)設(shè)置,但是很多時候并沒有完全把這些設(shè)置的功能發(fā)揮出來。一般而言,這些設(shè)置只有在設(shè)計無法達到時序要求的時候才會...
數(shù)字圖像是怎么通過模擬轉(zhuǎn)為數(shù)字的?
還記得數(shù)字電路上對應(yīng)的實驗都是VHDL的實驗嗎?數(shù)字電路告訴我們各種數(shù)字邏輯:非或與異。這些邏輯讓我們能夠通過底層的邏輯來實現(xiàn)各種復(fù)雜的處理邏輯。還記得...
相信你一定還記得擊敗了李世石和柯潔的谷歌阿爾法狗(AlphaGo),那你知道驅(qū)動AlphaGo的是什么嗎? 如果你覺得AlphaGo和人相似,只不過是把...
基于Cyclone IV GX系列的FPGA的PCIe接口設(shè)計詳解
PCI Express(PCIe)是一種高性能互連協(xié)議,可應(yīng)用于網(wǎng)絡(luò)適配、圖形加速、服務(wù)器、大數(shù)據(jù)傳輸、嵌入式系統(tǒng)等領(lǐng)域。PCIe協(xié)議在軟件層上可兼容于...
本采集系統(tǒng)框圖如圖1所示,該系統(tǒng)由心音傳感器、信號預(yù)處理電路、A/D轉(zhuǎn)換電路以及PC等構(gòu)成。其中,信號預(yù)處理電路首先對心音信號進行前級放大,然后經(jīng)過帶通...
賽靈思推出能提供FPGA設(shè)計工具和IP的ISE設(shè)計套件
賽靈思公司推出ISE設(shè)計套件11.1版本(ISE Design Suite 11.1)。這一FPGA設(shè)計解決方案在業(yè)界率先為邏輯、數(shù)字信號處理、嵌入式處...
由圖1可以看出,ADS8341完成一次轉(zhuǎn)換需要24個DCLK時鐘,其中在前8個時鐘的上升沿,DIN控制字輸入,控制字輸入完成后,在DCLK的上升沿時刻,...
2018-10-26 標(biāo)簽:電源FPGA轉(zhuǎn)換器 6k 0
LUT如何如何構(gòu)成邏輯函數(shù);2個LUT通過互連可以構(gòu)成7bit輸入,單bit輸出的邏輯。實現(xiàn)方式為兩個LUT的輸入信號A1,A2,A3,A4,A5,A6...
ARM是應(yīng)用,F(xiàn)PGA是芯片設(shè)計,前者是軟件,后面是硬件,ARM就像單片機,但是它本身的資源是生產(chǎn)廠家固定了的,可以把它看成一個比較優(yōu)秀的單片機來使用。
FPGA學(xué)習(xí)算法系列:彩色轉(zhuǎn)灰度
大家好,又到了每日學(xué)習(xí)的時間了,今天我們來聊一聊FPGA學(xué)習(xí)中可以遇到的一些算法,今天就聊一聊彩色轉(zhuǎn)灰度的算法。 一、基礎(chǔ) 對于彩色轉(zhuǎn)灰度,有一個很著名...
2018-10-26 標(biāo)簽:FPGA 6.3k 0
以FPGA+DSP為基礎(chǔ)的RCM遠(yuǎn)控器研究詳解
為了遠(yuǎn)程對現(xiàn)場進行設(shè)備管理和環(huán)境監(jiān)控,并簡化現(xiàn)場監(jiān)控設(shè)備,有效地提高整個系統(tǒng)的穩(wěn)定性和安全性。擬開發(fā)一款遠(yuǎn)程控制器,簡稱RCM遠(yuǎn)控器。該遠(yuǎn)控器將集現(xiàn)場...
面向FPGA的電子系統(tǒng)級 (ESL) 的新一代設(shè)計工具
邏輯設(shè)計領(lǐng)域正發(fā)生著根本變化,新一代設(shè)計工具能夠幫助軟件開發(fā)者將其算法表達直接轉(zhuǎn)換成硬件,而無需學(xué)習(xí)傳統(tǒng)的硬件設(shè)計技術(shù)。這些工具及相關(guān)設(shè)計方法學(xué)一起被歸...
通過LPM_ROM模塊和VHDL語言為核心設(shè)計多功能信號發(fā)生器
以FPGA芯片為載體, 通過QuartusII 的LPM_ROM 模塊和VHDL 語言為核心設(shè)計一個多功 能信號發(fā)生器,根據(jù)輸入信號的選擇可以輸出遞增鋸...
在Vivado中新建IO Planning工程來初步引腳分配
在Vivado中新建IO Planning工程來初步引腳分配,這樣會大大提高開發(fā)效率 在這里,你可以選擇最右側(cè)的開發(fā)板型號,也可以選擇Part,具體的...
基于循環(huán)前綴的非數(shù)據(jù)輔助估計算法研究與FPGA實現(xiàn)
提出了一種基于循環(huán)前綴的符號同步算法。此算法在最大似然估計的基礎(chǔ)上加以改進,簡化了符號同步中相關(guān)運算的判決方法,在保持同步效率的同時,極大地節(jié)約了硬件資...
現(xiàn)在的FPGA里面有很多存儲資源,DSP(數(shù)字信號處理)資源,布線通道,I/O資源,當(dāng)然最根本的還是CLB(Configurable Logic Blo...
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