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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門(mén)陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。
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京微齊力HME-P2系列FPGA的pSRAM讀寫(xiě)例程分析
最近有客戶(hù)反映國(guó)產(chǎn)FPGA京微齊力P2器件內(nèi)部合封的pSRAM控制器讀寫(xiě)效率很高,能達(dá)80%以上,而且合封了4片8bit位寬pSRAM芯片,按250MH...
如何理解嵌入式系統(tǒng)中的FPGA設(shè)計(jì)
與ASIC一樣,供應(yīng)商在FPGA設(shè)計(jì)中也需要應(yīng)對(duì)面積和速度的挑戰(zhàn)。隨著門(mén)數(shù)不斷增加,F(xiàn)PGA需要更大的面積和尺寸來(lái)適應(yīng)更多的應(yīng)用,設(shè)計(jì)工具需要采用更好的...
許多 FPGA 設(shè)計(jì)使用嵌入式處理器進(jìn)行控制。一個(gè)典型的解決方案涉及使用 Nios 等軟處理器,盡管帶有內(nèi)置硬處理器的 FPGA SoC 也變得很流行。...
FPGA在數(shù)字化時(shí)代的主要發(fā)展趨勢(shì)
隨著數(shù)字化時(shí)代的飛速發(fā)展,人工智能(AI)、大數(shù)據(jù)分析、自動(dòng)駕駛等新興領(lǐng)域的需求不斷攀升。FPGA作為靈活可編程的硬件平臺(tái),正成為AI與高性能計(jì)算等領(lǐng)域...
為什么FPGA成為數(shù)據(jù)中心尖端技術(shù)
我們知道,F(xiàn)PGA的頻率一般只有幾百M(fèi)Hz,而CPU的頻率卻高達(dá)數(shù)GHz。那么,有不少網(wǎng)友心中就有一個(gè)疑問(wèn):“為什么FPGA主頻比CPU慢,但卻可以用來(lái)...
FPGA圖像處理基礎(chǔ)----實(shí)現(xiàn)緩存卷積窗口
像素行與像素窗口 一幅圖像是由一個(gè)個(gè)像素點(diǎn)構(gòu)成的,對(duì)于一幅480*272大小的圖片來(lái)說(shuō),其寬度是480,高度是272。在使用FPGA進(jìn)行圖像處理時(shí),最關(guān)...
FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì)
隨著可編程邏輯器件的不斷進(jìn)步和發(fā)展,F(xiàn)PGA在嵌入式系統(tǒng)中發(fā)揮著越來(lái)越重要的作用。本文介紹的在電能質(zhì)量監(jiān)測(cè)系統(tǒng)中信號(hào)采集模塊控制器的 IP核,是采用硬...
2012-05-22 標(biāo)簽:FPGA控制器數(shù)據(jù)采集 1.9k 0
-越來(lái)越多的消費(fèi)應(yīng)用開(kāi)始在設(shè)計(jì)中集成流式視頻,結(jié)果引入了許多標(biāo)準(zhǔn)和專(zhuān)有的加密算法。但是加密方案以及實(shí)現(xiàn)方法不統(tǒng)一導(dǎo)致視頻接收設(shè)備在設(shè)計(jì)和支持方面存在巨大...
2019-01-08 標(biāo)簽:fpga視頻計(jì)算機(jī) 1.9k 0
FPGA視頻教程:BJ-EPM240學(xué)習(xí)板-Johnson計(jì)算器實(shí)驗(yàn)
Johnson算法主要用于求稀疏圖上的全源最短路徑,其主體思想是利用重賦權(quán)值的方法把一個(gè)愿問(wèn)題帶負(fù)權(quán)的圖轉(zhuǎn)化為權(quán)值非負(fù)的圖,然后再利用NN次Dijkst...
HTG-703 開(kāi)發(fā)板由 Xilinx Virtex-7 X415T、X485T、X550T 或 X690T 驅(qū)動(dòng),其非常適合那些要求訪問(wèn) 10G/40...
2017-02-08 標(biāo)簽:FPGA大密度內(nèi)存 1.9k 0
基于新型Virtex FPGA實(shí)現(xiàn)小型軟件無(wú)線(xiàn)電平臺(tái)SFF SDR設(shè)計(jì)
SFF SDR(小型軟件定義無(wú)線(xiàn)電)開(kāi)發(fā)平臺(tái)是一種模塊化的 RF/IF/基帶平臺(tái)(圖 1 和圖 2)。該平臺(tái)展示了 Xilinx 和德州儀器 (Texa...
2019-06-22 標(biāo)簽:fpgasdr無(wú)線(xiàn)電 1.9k 0
? 交流問(wèn)題 ? Q :FPGA打磚塊小游戲,如何基于FPGA用verilog語(yǔ)言在Vivado平臺(tái)上寫(xiě)打磚塊小游戲,最好能用到PS2與VGA。 A :...
2024-12-09 標(biāo)簽:FPGAVerilog HDLVivado 1.9k 0
FPGA學(xué)習(xí)之vivado邏輯分析儀的使用
其中待測(cè)設(shè)計(jì)就是我們整個(gè)的邏輯設(shè)計(jì)模塊,在線(xiàn)邏輯分析儀也同樣是在FPGA設(shè)計(jì)中。通過(guò)一個(gè)或多個(gè)探針來(lái)采集希望觀察的信號(hào)。然后通過(guò)JTAG接口,將捕獲到的...
2023-07-25 標(biāo)簽:fpga邏輯分析儀邏輯設(shè)計(jì) 1.9k 0
基于TMS320C6414 DSP處理器實(shí)現(xiàn)通用FPGA測(cè)試平臺(tái)的搭建
1)器件存儲(chǔ)器容量很有限,無(wú)法滿(mǎn)足通信系統(tǒng)數(shù)據(jù)量大這一要求。以802.16e MIMO 2x2無(wú)線(xiàn)通信系統(tǒng)的信道估計(jì)算法為例,存儲(chǔ)一個(gè)下行數(shù)據(jù)幀的信道值...
如何對(duì)SoC進(jìn)行手動(dòng)FPGA分區(qū)
對(duì)SoC芯片要進(jìn)行FPGA原型驗(yàn)證,假如設(shè)計(jì)較大,要將SoC中不同功能模塊或者邏輯模塊分別分配到特定的FPGA,那么對(duì)SoC的分割策略尤為重要
基于EZ-USB系列芯片和FPGA器件實(shí)現(xiàn)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
通用串行總線(xiàn)(USB)支持熱插撥,真正的即插即用。USB1.1在全速傳輸時(shí)可以達(dá)到12Mbps的傳輸速率;低速傳輸時(shí)傳輸速率可達(dá)1.5Mbps。USB電...
2020-04-11 標(biāo)簽:fpga芯片數(shù)據(jù)采集 1.9k 0
深入淺出玩轉(zhuǎn)FPGA視頻:VGA接口實(shí)驗(yàn)
VGA接口共有15針,分成3排,每排5個(gè)孔,顯卡上應(yīng)用最為廣泛的接口類(lèi)型,絕大多數(shù)顯卡都帶有此種接口。它傳輸紅、綠、藍(lán)模擬信號(hào)以及同步信號(hào)(水平和垂直信號(hào))。
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