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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門(mén)陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。
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AMD-Xilinx 的 Vivado 開(kāi)發(fā)工具具有很多方便FPGA開(kāi)發(fā)功能,我最喜歡的功能之一是block design的設(shè)計(jì)流程。Vivado 中的...
鋯石FPGA A4_Nano開(kāi)發(fā)板視頻:RAM IP的使用講解
隨機(jī)存取存儲(chǔ)器(RAM)既可向指定單元存入信息又可從指定單元讀出信息。任何RAM中存儲(chǔ)的信息在斷電后均會(huì)丟失,所以RAM是易失性存儲(chǔ)器。
開(kāi)發(fā)板上使用的機(jī)械按鍵在閉合及斷開(kāi)的瞬間均伴隨有一連串的抖動(dòng),按鍵抖動(dòng)會(huì)引起一次按鍵被誤讀多次,需要進(jìn)行消抖處理:在按鍵閉合穩(wěn)定時(shí)讀取按鍵的狀態(tài),并且必...
2023-06-23 標(biāo)簽:fpga計(jì)數(shù)器時(shí)鐘 1.9k 0
利用PSC和ARM Cortex-M1處理器實(shí)現(xiàn)智能功率控制產(chǎn)品的設(shè)計(jì)
構(gòu)建和維護(hù)合適的功率環(huán)境對(duì)系統(tǒng)的正確運(yùn)行非常關(guān)鍵。對(duì)功率的控制和管理越來(lái)越受到重視,無(wú)論是簡(jiǎn)單的手持式便攜設(shè)備,還是多服務(wù)器機(jī)架系統(tǒng),都希望能夠節(jié)省能耗...
基于可編程邏輯器件實(shí)現(xiàn)TDICCD驅(qū)動(dòng)時(shí)序發(fā)生器的設(shè)計(jì)
時(shí)間延時(shí)積分電荷耦合器件 (Time Delay and Integration Charge Coupled Devices) (TDICCD)是近幾...
鋯石FPGA A4_Nano開(kāi)發(fā)板視頻:NiOS II軟件框架結(jié)構(gòu)深入剖析
Nios Ⅱ處理器核 Nios Ⅱ處理器系列由三個(gè)不同的內(nèi)核組成,可以靈活地控制成本和性能,從而擁有廣泛的應(yīng)用空間。
2019-09-30 標(biāo)簽:處理器fpga開(kāi)發(fā)板 1.9k 0
一種以FPGA為核心的分布式動(dòng)力電池管理系統(tǒng)研究流程概述
車(chē)用動(dòng)力電池的安全性、使用成本以及續(xù)航里程一直是影響電動(dòng)汽車(chē)推廣應(yīng)用的主要因素。在現(xiàn)有電池技術(shù)的基礎(chǔ)上,一個(gè)有效的電池管理系統(tǒng)能對(duì)車(chē)用動(dòng)力電池進(jìn)行保護(hù)、...
2020-01-30 標(biāo)簽:動(dòng)力電池fpga 1.9k 0
Altera Agilex FPGA產(chǎn)品組合介紹
數(shù)據(jù)爆炸式增長(zhǎng)正推動(dòng)新產(chǎn)品需求激增,這些新產(chǎn)品需具備數(shù)據(jù)傳輸、處理和存儲(chǔ)能力,并方便開(kāi)發(fā)人員從中獲得可執(zhí)行的深度分析,助力他們基于硬件靈活性來(lái)應(yīng)對(duì)市場(chǎng)需...
大唐電信FPGA/CPLD數(shù)字電路設(shè)計(jì)經(jīng)驗(yàn)分享(1)
在數(shù)字電路的設(shè)計(jì)中,時(shí)序設(shè)計(jì)是一個(gè)系統(tǒng)性能的主要標(biāo)志,在高層次設(shè)計(jì)方法中,對(duì)時(shí)序控制的抽象度也相應(yīng)提高,因此在設(shè)計(jì)中較難把握,但在理解RTL電路時(shí)序模型...
基于FPGA原型設(shè)計(jì)的SoC開(kāi)發(fā)
所有形式的原型都為驗(yàn)證硬件設(shè)計(jì)和驗(yàn)證軟件提供了強(qiáng)大的方法,模型或多或少地模仿了目標(biāo)環(huán)境?;贔PGA的原型設(shè)計(jì)在項(xiàng)目的關(guān)鍵后期階段尤其有益。用戶有幾個(gè)原...
AMP或SMP: Zynq SoC操作系統(tǒng)在無(wú)線應(yīng)用中應(yīng)考慮的因素
使用Zynq SoC器件可以有效地實(shí)現(xiàn)包括無(wú)線電和無(wú)線回程在內(nèi)的比較主要的無(wú)線應(yīng)用,而廣播無(wú)線電的應(yīng)用尤為如此。在該應(yīng)用中,Zynq SoC器件的片上處...
SoC的功能有多少可以通過(guò)FPGA原型驗(yàn)證平臺(tái)來(lái)驗(yàn)證?
我們當(dāng)然希望在項(xiàng)目中盡快準(zhǔn)備好基于FPGA原型驗(yàn)證的代碼,以便最大限度地為軟件團(tuán)隊(duì)和RTL驗(yàn)證人員帶來(lái)更客觀的收益。
基于FPGA的無(wú)線視頻技術(shù)應(yīng)用解決方案詳解
數(shù)字視頻技術(shù)是當(dāng)今消費(fèi)市場(chǎng)上最令人激動(dòng)的一個(gè)亮點(diǎn),而無(wú)線技術(shù)能夠確保數(shù)據(jù)的加密并逐漸支持更高的數(shù)據(jù)率,因而成為不同設(shè)備之間傳輸視頻信息的理想媒介。然而...
使用PYNQ訓(xùn)練和實(shí)現(xiàn)BNN
使用 PYNQ 可以輕松在 FPGA 上實(shí)現(xiàn)加速 AI/ML,而無(wú)需編寫(xiě)一行 HDL!讓我們看看如何做到這一點(diǎn)。
2024-08-05 標(biāo)簽:FPGA機(jī)器學(xué)習(xí)BNN 1.9k 0
基于FPGA器件EPF10K20RC240-3實(shí)現(xiàn)HDLC協(xié)議控制器的應(yīng)用方案
HDLC(High Level Data Link Control)協(xié)議是通信領(lǐng)域中應(yīng)用最廣泛的協(xié)議之一,它是面向比特的高級(jí)數(shù)據(jù)鏈路控制規(guī)程,具有差錯(cuò)檢...
上一篇文章已經(jīng)講過(guò)了單bit跨時(shí)鐘域的處理方法,這次解說(shuō)一下多bit的跨時(shí)鐘域方法。
2023-05-25 標(biāo)簽:fpga信號(hào)計(jì)數(shù)器 1.9k 0
采用Spartan3系列可編程邏輯器件實(shí)現(xiàn)智能變送器的設(shè)計(jì)
在工業(yè)自動(dòng)化控制系統(tǒng)中,過(guò)程參數(shù)壓力、差壓、絕對(duì)壓力、流量等工藝參數(shù)均要嚴(yán)格控制,而這類(lèi)參數(shù)的測(cè)量與監(jiān)控大多使用變送器。變送器是玉業(yè)過(guò)程重要的基礎(chǔ)自動(dòng)化...
基于可編程邏輯器件和VHDL語(yǔ)言實(shí)現(xiàn)信號(hào)源的方案設(shè)計(jì)
在高速數(shù)據(jù)采集系統(tǒng)中,信號(hào)源作為一種校驗(yàn)設(shè)備,需要及時(shí)、有效地向采集設(shè)備提供高頻信號(hào),用于檢驗(yàn)數(shù)據(jù)采集器的工作情況;同時(shí)信號(hào)源還應(yīng)該能夠提供一些必要的控...
視覺(jué)SLAM開(kāi)源方案匯總 視覺(jué)SLAM設(shè)備選型
SLAM至今已歷經(jīng)三十多年的研究,這里給出經(jīng)典視覺(jué)SLAM框架,這個(gè)框架本身及其包含的算法已經(jīng)基本定型,并且已經(jīng)在許多視覺(jué)程序庫(kù)和機(jī)器人程序庫(kù)中提供。
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