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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發(fā)展的產物。它是作為專用集成電路（ASIC）領域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。

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賽靈思推出Versal ACAP第三大產品系列，吞吐量比當前FPGA高達三倍

3月11日，自適應和智能計算的全球領先企業(yè)賽靈思公司（Xilinx， Inc.，（NASDAQ： XLNX））今天宣布推出Versal ACAP產品組合...

2020-03-12 標簽：fpga 臺積電賽靈思 4k 0

賽靈思正式推出Versal Premium 可提供比當前FPGA高達三倍的吞吐量

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2020-03-12 標簽：fpga 賽靈思 5.3k 0

FPGA初學者的入門之道

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2020-03-15 標簽：fpga 3.5k 0

FPGA構建環(huán)境的自動化怎么實現(xiàn)

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FPGA芯片內部資源非常重要設計時需要特別關注Serdes的供電

先說說我當年入門的經(jīng)歷吧。國內的大學有 FPGA 開發(fā)條件的實驗室并不太多，當年大學的那幫同學有的做 ARM，有的做 linux，很少有人做 FPGA，...

2020-03-11 標簽：fpga 3.7k 0

Xilinx推出業(yè)界帶寬最高、計算密度最高的自適應平臺——Versal Premium

全新 Versal Premium 系列提供了功耗優(yōu)化網(wǎng)絡硬核的突破性集成，實現(xiàn)最高速、最安全的網(wǎng)絡與靈活應變的云加速

2020-03-15 標簽：fpga Xilinx 5G網(wǎng)絡 1.3k 0

智能網(wǎng)卡勢在必行，可編程、平臺化加速行業(yè)部署

預計到 2024 年，SmartNIC 市場規(guī)模將超過6億美元，占據(jù)全球以太網(wǎng)適配器市場的23%。隨著云服務提供商的縱向擴容，他們正在不斷增加 Smar...

2020-03-11 標簽：FPGA 數(shù)據(jù)中心智能網(wǎng)卡 1.5萬 0

德州儀器推出業(yè)界首款可堆疊多至四個集成電路的新型DC/DC降壓轉換器

解決方案尺寸和熱性能是工程師為現(xiàn)代現(xiàn)場可編程門陣列（FPGA）設計電源的兩個關鍵考慮因素。TPS546D24A降壓轉換器憑借其獨特的可堆疊性解決了這兩個問題。

2020-03-16 標簽：處理器 fpga 德州儀器 1.5k 0

全新可編程SoC架構，ARM和FPGA的互補

目前，SoC芯片處在這樣一個結構布局中，對于智能手機、平板等對功耗要求較高的領域，主要是ARM核作支撐，運算速度一般在幾十MIPS左右。

2020-03-10 標簽：fpga arm 1.8k 0

紫光國產2核處理器加FPGA芯片助力口罩機生產大增

最近一段時間來，口罩成了全球的熱門話題，國內最緊缺的時刻已經(jīng)過去了，現(xiàn)在日產能超過1億只，反而是國外口罩10倍、20倍漲價。

2020-03-10 標簽：fpga 紫光 3.8k 0

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2020-03-09 標簽：fpga 互聯(lián)網(wǎng)網(wǎng)絡 2.4k 0

微軟最終選擇Xilinx為數(shù)據(jù)中心而提供FPGA

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2020-03-09 標簽：fpga 微軟 1k 0

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2020-03-09 標簽：處理器 fpga 控制器 3.4k 0

賽靈思打造FPGA自適應的平臺推出Vitis統(tǒng)一軟件平臺

之前最主流的是GoogLeNet，1年半到2年后是ResNet，現(xiàn)在ResNet是最尖端的技術，但是沒有辦法在原有的架構上運行。

2020-03-08 標簽：fpga 賽靈思人工智能 5.7k 0

MathWorks將加快支持FPGA和ASIC的驗證速度

MathWorks宣布，HDLVerifier從現(xiàn)已上市的Release2019b開始提供對UniversalVerificationMethodolo...

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以下五個FPGA布局布線算法領域的重要工作幾乎奠定了現(xiàn)代算法的基礎

FPGA 是芯片的其中一種，從上世紀八十年代誕生起，F(xiàn)PGA 已經(jīng)從簡單的可編程門陣列，發(fā)展成為了有著大量可編程邏輯的復雜片上系統(tǒng)。除了硬件結構之外，F(xiàn)...

2020-03-08 標簽：fpga 3.4k 0

Vivado調試ILA debug結果也許不對

FPGA的調試是個很蛋疼的事，即便Vivado已經(jīng)比ISE好用了很多，但調試起來依舊蛋疼。即便是同一個程序，F(xiàn)PGA每次重新綜合、實現(xiàn)后結果都多多少少會...

2020-03-08 標簽：fpga vivado 1.3萬 0

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時鐘樹的使用方法簡介

時鐘樹不僅可以做到高扇出，還可以做到讓時鐘信號到達各個觸發(fā)器的時刻盡可能一致，也即保證時鐘信號到達時鐘域內不同觸發(fā)器的時間差最小。

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