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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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1、什么是Setup 和Holdup時(shí)間? 答:Setup/hold time 是測(cè)試芯片對(duì)輸入信號(hào)和時(shí)鐘信號(hào)之間的時(shí)間要求。 建立時(shí)間是指觸發(fā)器的時(shí)鐘...
FPGA和USB3.0通信-USB3.0 PHY簡(jiǎn)介
可以和FPGA搭配使用的USB3.0 PHY芯片 通過(guò)之前的介紹FPGA和USB3.0通信-USB3.0協(xié)議介紹,我們大致了解到USB3.0整個(gè)協(xié)議異常...
2021-11-09 標(biāo)簽:fpgausb數(shù)據(jù)手冊(cè) 1.1萬(wàn) 0
用FPGA搭配3個(gè)電阻、1個(gè)電容制作的1bit SDR接收機(jī)
電賽在即,再給大家提供一個(gè)小技能,并一些有用的Verilog代碼,對(duì)于做高頻電路題目的同學(xué)有一定的參考。 以前介紹過(guò)我們用小腳丫FPGA的一根GPIO管...
DIY出一個(gè)高性能的掌中信號(hào)發(fā)生器
過(guò)去幾年我最大的遺憾就是不會(huì)軟件編程,作為一個(gè)資深板農(nóng),無(wú)法親手讓自己設(shè)計(jì)的硬件跑起來(lái),那種心情是非常難受的。 自去年底樹(shù)莓派基金會(huì)發(fā)布第一顆自己設(shè)計(jì)的...
FPGA相對(duì)于MCU的主要優(yōu)勢(shì)在哪
在開(kāi)發(fā)新的電子系統(tǒng)時(shí),設(shè)計(jì)人員需要做出各種決定。最關(guān)鍵的一個(gè)決定是選擇系統(tǒng)架構(gòu)和實(shí)現(xiàn)的芯片。這些組件發(fā)揮著關(guān)鍵功能,當(dāng)前的選擇也十分寬范,因此錯(cuò)誤的決定...
電子發(fā)燒友網(wǎng)報(bào)道(文/李寧遠(yuǎn))機(jī)器人,一個(gè)總能引發(fā)人們討論的熱門話題。工業(yè)機(jī)器人伴隨工業(yè)革新的進(jìn)程,一直是工業(yè)自動(dòng)化浪潮中備受關(guān)注的設(shè)備之一,就現(xiàn)狀來(lái)看...
以己之長(zhǎng)攻彼之短!FPGA在機(jī)器人市場(chǎng)如何突圍?
復(fù)雜的多軸運(yùn)算需求將FPGA的擴(kuò)展性及運(yùn)作效能優(yōu)勢(shì)凸顯,在單一節(jié)點(diǎn)運(yùn)作的MCU在應(yīng)對(duì)這種高效能需求時(shí)會(huì)顯得乏力。而DSP雖然有更高的處理效能,但在拓展性...
2021-11-08 標(biāo)簽:FPGA機(jī)器視覺(jué)工業(yè)機(jī)器人 3.1k 0
Kria KV260超長(zhǎng)干貨之開(kāi)箱指南
本篇文章來(lái)自 王偉博士, 北京中際賽威文化發(fā)展有限公司 FPGA技術(shù)專家 中國(guó)高科技產(chǎn)業(yè)化研究會(huì)智能信息處理產(chǎn)業(yè)化分會(huì) 理事 Kria KV260 開(kāi)發(fā)...
優(yōu)秀的 Verilog/FPGA開(kāi)源項(xiàng)目之 USB通信
優(yōu)秀的 Verilog/FPGA開(kāi)源項(xiàng)目介紹(五)- USB通信 USB是我們生活中非常非常常見(jiàn)的接口,鼠標(biāo)、鍵盤以及常見(jiàn)的U 盤等,可以說(shuō)現(xiàn)在的USB...
什么是 HIL 測(cè)試 硬件在環(huán) (HIL) 測(cè)試是一種實(shí)時(shí)仿真,讓您無(wú)需使用系統(tǒng)硬件即可開(kāi)始測(cè)試嵌入式代碼。如果正在開(kāi)發(fā)的代碼未按照規(guī)范運(yùn)行,您可以通過(guò)...
第一部分 設(shè)計(jì)概述 1.1 設(shè)計(jì)目的 在多媒體技術(shù)高度發(fā)展的今天,視頻信息安全愈發(fā)受到人們的關(guān)注。傳統(tǒng)的視頻加密方法主要應(yīng)用在軟件層面上,其算法設(shè)計(jì)復(fù)雜...
這是來(lái)自Element14網(wǎng)站的一個(gè)項(xiàng)目分享,使用FPGA + 電阻就可以實(shí)現(xiàn)非常有趣的效果,故分享出來(lái),尤其是對(duì)即將參加電賽的同學(xué),如何將自己掌握的技...
開(kāi)源工具SkiDL - 用Python來(lái)描述電路
我們用Verilog、VHDL這種硬件描述語(yǔ)言來(lái)設(shè)計(jì)FPGA,是否有一種方式來(lái)描述電路?如果采用了這種方式,也會(huì)像HDL在FPGA、ASIC領(lǐng)域一樣成為...
1.高斯濾波算法的實(shí)現(xiàn) 前面講的均值/中值濾波,對(duì)于濾波窗口內(nèi)每個(gè)像素的權(quán)重都是一樣的。但是噪聲在圖像當(dāng)中常表現(xiàn)為異常視覺(jué)效果的孤立像素點(diǎn)或像素塊,那么...
凈利潤(rùn)預(yù)增266% MCU占電表市場(chǎng)六成
電子發(fā)燒友網(wǎng)報(bào)道(文/莫婷婷)今年8月,復(fù)旦微電發(fā)布上市后首份財(cái)報(bào)顯示,公司2021年上半年財(cái)報(bào)營(yíng)業(yè)收入約11.29億元,同比增加56.05%;歸屬于上...
淺析Xilinx系列FPGA Select IO簡(jiǎn)介
在SelectIO簡(jiǎn)介連載一中介紹了其架構(gòu),本章會(huì)繼續(xù)介紹如何使用其gearbox功能來(lái)實(shí)現(xiàn)不同的比率的串并轉(zhuǎn)換功能。 7 Series FPGA中LV...
2021-10-28 標(biāo)簽:fpga數(shù)據(jù)Xilinx 1.2萬(wàn) 0
Xilinx攜手領(lǐng)先廣播、音視頻系統(tǒng)及IP集成商,提供完整、可量產(chǎn)化的多媒體流式處理端節(jié)點(diǎn)解決方案
在賽靈思自適應(yīng)SoC的支持下,高度集成的流式處理解決方案可隨時(shí)交付或由客戶定制,以實(shí)現(xiàn)更加簡(jiǎn)便、快速的上市與部署。
兩個(gè)網(wǎng)絡(luò)相關(guān)的開(kāi)源項(xiàng)目詳解
今天介紹兩個(gè)(only two)網(wǎng)絡(luò)相關(guān)的開(kāi)源項(xiàng)目。 Alex的verilog-ethernet之前在介紹PCIe項(xiàng)目時(shí)有介紹過(guò)Alex的項(xiàng)目,當(dāng)時(shí)重點(diǎn)...
1.扇出太多引起的時(shí)序問(wèn)題。 信號(hào)驅(qū)動(dòng)非常大,扇出很大,需要增加驅(qū)動(dòng)能力,如果單純考慮驅(qū)動(dòng)能力可以嘗試增加buffer來(lái)解決驅(qū)動(dòng)能力,但在插入buffe...
2021-10-25 標(biāo)簽:fpga驅(qū)動(dòng)時(shí)鐘 1.1萬(wàn) 0
支持?jǐn)?shù)據(jù)轉(zhuǎn)發(fā)和基于FPGA的圖像處理卸載的圖像采集卡
單輸入至四輸入的CoaXPress 2.0圖像采集卡,支持?jǐn)?shù)據(jù)轉(zhuǎn)發(fā)和基于FPGA的圖像處理卸載 用于高速成像的接口卡 HK Matrox Rapixo ...
2021-10-22 標(biāo)簽:fpga數(shù)據(jù)虹科電子 4.2k 0
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