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復(fù)旦大學(xué)科研團隊發(fā)明出新的單晶體管邏輯結(jié)構(gòu) 使晶體管面積縮小50%

半導(dǎo)體動態(tài) ? 來源:工程師吳畏 ? 2019-05-30 16:27 ? 次閱讀
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目前的晶圓都是由硅元素生產(chǎn)制成,已知硅原子的直徑大約是0.22nm,再考慮到原子之間的距離,理論極限至少是0.5nm,但肯定沒有任何公司可以做到。普遍認為3nm將是芯片制程工藝的極限。

事實上自從晶體管制造工藝進入10nm時代之后,繼續(xù)提升制程工藝變得原來越困難,特別是Intel在14nm工藝上足足停留了5年之久,因此想要繼續(xù)提升芯片性能最好的辦法就是另辟蹊徑。

日前,復(fù)旦大學(xué)科研團隊近日在集成電路基礎(chǔ)研究領(lǐng)域取得一項突破。他們發(fā)明了讓單晶體管“一個人干兩個人的活”的新邏輯結(jié)構(gòu),使晶體管面積縮小50%,存儲計算的同步性也進一步提升。

復(fù)旦大學(xué)微電子學(xué)院教授周鵬指出:“這項研究工作的核心內(nèi)容是利用原子晶體硫化鉬做出了新結(jié)構(gòu)晶體管。在此基礎(chǔ)上,團隊發(fā)明了新的單晶體管邏輯結(jié)構(gòu),在單晶體管上實現(xiàn)了邏輯運算的‘與’和‘或’?!币虼嗽刃枰?個獨立晶體管才能實現(xiàn)邏輯功能,現(xiàn)在只要1個晶體管即可。

如果該發(fā)明成果成功產(chǎn)業(yè)化,將推動集成電路向更輕、更快、更小、功耗更低方向發(fā)展。相關(guān)研究成果已在線發(fā)表于《自然?納米技術(shù)》。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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