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FPGA/ASIC技術(shù)
電子發(fā)燒友本欄目為FPGA/ASIC技術(shù)專欄，內(nèi)容有fpga培圳資料、FPGA開發(fā)板、FPGA CPLD知識以及FPGA/ASIC技術(shù)的其它應(yīng)用等；是您學(xué)習(xí)FPGA/ASIC技術(shù)的好欄目。
FPGA主要功能模塊介紹(1)
可編程輸入/ 輸出單元簡稱I/O 單元，是芯片與外界電路的接口部分，完成不同電氣特性下對輸入/ 輸出信號的驅(qū)動與匹配要求，其示意結(jié)構(gòu)如圖2-4 所示。FPGA 內(nèi)的I/O 按組分類，每組都能夠獨立地...
Verilog HDL簡明教程(2)
模塊是Verilog 的基本描述單位，用于描述某個設(shè)計的功能或結(jié)構(gòu)及其與其他模塊通信的外部端口。...
沒有算法功力，是不可能成為高手的
算法是計算機科學(xué)領(lǐng)域最重要的基石之一，但卻受到了國內(nèi)一些程序員的冷落。許多學(xué)生看到一些公司在招聘時要求的編程語言五花八門就產(chǎn)生了一種誤解，認為學(xué)計算機就是學(xué)各種編程語言，...
Verilog HDL簡明教程(part1)
Verilog HDL是一種硬件描述語言，用于從算法級、門級到開關(guān)級的多種抽象設(shè)計層次的數(shù)字系統(tǒng)建模。被建模的數(shù)字系統(tǒng)對象的復(fù)雜性可以介于簡單的門和完整的電子數(shù)字系統(tǒng)之間。數(shù)字系統(tǒng)能夠...
2017-02-11 標(biāo)簽：FPGAVerilog HDL 1563
FPGA基本知識與發(fā)展趨勢（part2）
由于基于LUT 的FPGA 具有很高的集成度，其器件密度從數(shù)萬門到數(shù)千萬門不等，可以完成極其復(fù)雜的時序與邏輯組合邏輯電路功能，所以適用于高速、高密度的高端數(shù)字邏輯電路設(shè)計領(lǐng)域。...
針對2K/4K超高清視頻驗證的原型驗證開發(fā)平臺
北京亞科鴻禹電子有限公司在北京發(fā)布一款針對2K/4K超高清視頻驗證的原型驗證開發(fā)平臺-VeriTiger-M2000T。此平臺作為亞科鴻禹”All-In-One”家族的最新成員，主要為廣大的視音頻SOC/IP的硬件/軟件驗...
FPGA實戰(zhàn)開發(fā)技巧（10）
串行Flash的特點是占用管腳比較少，作為系統(tǒng)的數(shù)據(jù)存貯非常合適，一般都是采用串行外設(shè)接口(SPI 總線接口)。Flash 存貯器與EEPROM根本不同的特征就是EEPROM可以按字節(jié)進行數(shù)據(jù)的改寫，而Flash只...
Xlinx FPGA的DSP設(shè)計工具和設(shè)計流程
因為手上有一塊Xilinx的Spartan--3E開發(fā)板，前些日子陸陸續(xù)續(xù)學(xué)習(xí)了ISE的一般工程開發(fā)，熟悉了Xilinx ISE 10.x的軟件操作和開發(fā)板的使用。近來沒有事情，于是乎，又把那開發(fā)板拿出來把弄把弄，開...
FPGA實戰(zhàn)開發(fā)技巧（9）
FPGA配置方式靈活多樣，根據(jù)芯片是否能夠自己主動加載配置數(shù)據(jù)分為主模式、從模式以及JTAG模式。典型的主模式都是加載片外非易失( 斷電不丟數(shù)據(jù)) 性存儲器中的配置比特流，配置所需的時鐘...
FPGA實戰(zhàn)開發(fā)技巧（8）
FPGA 設(shè)計的時序性能是由物理器件、用戶代碼設(shè)計以及EDA 軟件共同決定的，忽略了任何一方面的因素，都會對時序性能有很大的影響。本節(jié)主要給出大規(guī)模設(shè)計中，賽靈思物理器件和EDA 軟件的...
談?wù)勝愳`思的局部重配置技術(shù)
這里提到的局部重配置技術(shù)（Partial Reconfiguration） 是現(xiàn)場可編程門陣列（呵呵，就是FPGA了） 器件中的一部分。指的是在FPGA其他部分還在正常運行的情況下對其局部進行的重新配置。...
FPGA實戰(zhàn)開發(fā)技巧（6）
時序性能是FPGA 設(shè)計最重要的指標(biāo)之一。造成時序性能差的根本原因有很多，但其直接原因可分為三類：布局較差、邏輯級數(shù)過多以及信號扇出過高。...
FPGA實戰(zhàn)開發(fā)技巧（7）
通常我們會為工程添加UCF 約束指定時序要求和管腳約束。但是UCF 約束是給MAP，PAR 等實現(xiàn)使用的，綜合工具XST 并不能感知系統(tǒng)的時序要求。而為XST 添加XCF 約束卻是使實現(xiàn)結(jié)果擁有最高頻率的關(guān)...
利用FPGA的自身特性實現(xiàn)隨機數(shù)發(fā)生器
本文主要介紹利用FPGA的自身的特性實現(xiàn)隨機數(shù)發(fā)生器，在Virtex-II Pro開發(fā)板上用ChipScope觀察隨機數(shù)序列，以及在PCIe4Base（基于Virtex-4 FPGA）上實現(xiàn)。...
2017-02-11 標(biāo)簽：FPGA 14336
談?wù)勅绾卫肍PGA開發(fā)板進行ASIC原型開發(fā)
ASIC設(shè)計在尺寸和復(fù)雜性上不斷增加，現(xiàn)代FPGA的容量和性能的新進展意味著這些設(shè)計中的2/3能夠使用單個FPGA進行建模。...
FPGA實戰(zhàn)開發(fā)技巧（5）
一般來講，添加約束的原則為先附加全局約束，再補充局部約束，而且局部約束比較寬松。其目的是在可能的地方盡量放松約束，提高布線成功概率，減少ISE 布局布線時間。典型的全局約束包...
FPGA實戰(zhàn)開發(fā)技巧（4）
在代碼編寫完畢后，需要借助于測試平臺來驗證所設(shè)計的模塊是否滿足要求。ISE 提供了兩種測試平臺的建立方法，一種是使用HDL Bencher 的圖形化波形編輯功能編寫，另一種就是利用HDL 語言，相...
FPGA實戰(zhàn)開發(fā)技巧（3）
所謂綜合，就是將HDL語言、原理圖等設(shè)計輸入翻譯成由與、或、非門和RAM、觸發(fā)器等基本邏輯單元的邏輯連接( 網(wǎng)表)，并根據(jù)目標(biāo)和要求( 約束條件) 優(yōu)化所生成的邏輯連接，生成EDF 文件。XST...
FPGA電路必須遵循的原則和技巧
在調(diào)試FPGA電路時要遵循必須的原則和技巧，才能降低調(diào)試時間，防止誤操作損壞電路。通常情況下，能夠參考以下步驟執(zhí)行 FPGA硬件系統(tǒng)的調(diào)試。...
2017-02-11 標(biāo)簽：FPGA 1040
寫verilog代碼要有硬件的概念
因為Verilog是一種硬件描述語言，所以在寫Verilog語言時，首先要有所要寫的module在硬件上如何實現(xiàn)的概念，而不是去想編譯器如何去解釋這個module...
學(xué)好FPGA應(yīng)該要具備的知識
閱讀本文的人群：熟悉數(shù)字電路基本知識（如加法器、計數(shù)器、RAM等），熟悉基本的同步電路設(shè)計方法，熟悉HDL語言，對FPGA的結(jié)構(gòu)有所了解，對FPGA設(shè)計流程比較了解。...
解密業(yè)界首款16nm產(chǎn)品核心技術(shù)
以賽靈思 20nm UltraScale 系列的成功為基礎(chǔ)，賽靈思現(xiàn)又推出了全新的 16nm UltraScale+ 系列 FPGA、3D IC 和 MPSoC，憑借新型存儲器、3D-on-3D 和多處理SoC（MPSoC）技術(shù)，再次領(lǐng)先一代提供了遙遙領(lǐng)先的價值...
LX110T的板子上跑demo的時候遇到的一些錯誤的解決辦法總結(jié)
.前一段時間在玩xilinx送我在跑XUPV5-LX110T，首先跑xilinx給出的XUPV5-LX110T的demo設(shè)計，結(jié)果發(fā)現(xiàn)遇到了一些錯誤但是自己在網(wǎng)上發(fā)現(xiàn)很少有答案，就把自己的一些總結(jié)貼出來：...
Xilinx ISE是如何調(diào)用ModelSim進行仿真的
在我們用ModelSim仿真的時候經(jīng)常是修改一點一點修改代碼，這樣會造成一個無奈的操作循環(huán)：修改代碼--->編譯代碼--->仿真設(shè)置--->進入仿真頁面--->添加需要觀察的波形--->運行仿真...
記利用compxlibgui工具編譯Xilinx庫
當(dāng)ISE調(diào)用ModelSim進行仿真的時候，如果在FPGA設(shè)計中使用了Xilinx提供的的IP core或者其他的原語語句，ModelSim不添加Xilinx相應(yīng)的庫文件的話，是無法仿真的。...
FPGA實戰(zhàn)開發(fā)技巧（13）
基于IP的設(shè)計已成為目前FPGA設(shè)計的主流方法之一，本章首先給出IP的定義，然后以FFT IP核為例，介紹賽靈思IP核的應(yīng)用。...
FPGA實戰(zhàn)開發(fā)技巧（12）
在大規(guī)模設(shè)計的調(diào)試應(yīng)該按照和設(shè)計理念相反的順序，從底層測試，主要依靠ChipScope Pro 工具。下面主要介紹ChipScope Pro、FPGA Editor 組件的使用方法。...
ISE11.4對XC6SLX150進行開發(fā)時遇到的困難和挑戰(zhàn)
目前，使用ISE11.4對XC6SLX150進行開發(fā)，在時序上遇到一些困難和挑戰(zhàn)。痛定思痛，立即進行問題記錄，希望能與各位共同進行探討和分析。...
FPGA實戰(zhàn)開發(fā)技巧（11）
在串行模式下，需要微處理器或微控制器等外部主機通過同步串行接口將配置數(shù)據(jù)串行寫入FPGA芯片，其模式選擇信號M[2:0]=3’b111...
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