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電子發(fā)燒友網(wǎng)>可編程邏輯>

可編程邏輯

提供權威的PLD及可編程邏輯器件設計應用、Altera公司、Xilinx公司資訊和解決方案,包括HDL語言與源代碼、FPGA開發(fā)板、EDA工具、FPGA、FPGA軟件等領域。
基于FPGA的原型設計對系統(tǒng)級驗證的適用性

基于FPGA的原型設計對系統(tǒng)級驗證的適用性

驗證SoC困難的部分原因是它的狀態(tài)依賴于許多變量,包括它以前的狀態(tài)、輸入序列和SoC輸出的更廣泛的系統(tǒng)效應(和可能的反饋)。 以實時連接到系統(tǒng)其他部分的速度運行SoC設計,可以讓我們...

2023-09-25 標簽:FPGA顯示器HDMI接口soc 1469

基于FPGA做的開源示波器/邏輯分析儀/頻譜儀/波形發(fā)生器設計

ScopeFun是一款經(jīng)濟實惠、開源、一體化的儀器平臺。...

2023-09-25 標簽:示波器USB接口MSPSFFT任意波形發(fā)生器 3124

集成邏輯分析儀(ILA)的使用方法

集成邏輯分析儀(ILA)的使用方法

在日常FPGA開發(fā)過程中,邏輯代碼設計完成后,為了驗證代碼邏輯的正確性,優(yōu)先使用邏輯仿真(modesim)進行驗證。仿真驗證通過后進行板級驗證時,使用邏輯分析儀進行分析和驗證邏輯是否正確...

2023-10-01 標簽:FPGAXilinx邏輯分析儀VivadoILA 8125

求一種基于FPGA時間數(shù)字轉(zhuǎn)換(TDC)設計方案

求一種基于FPGA時間數(shù)字轉(zhuǎn)換(TDC)設計方案

時間數(shù)字轉(zhuǎn)換(Time-to-Digital Converter,TDC)是一種用來測量時間的電路,它將連續(xù)的時間信號轉(zhuǎn)換為數(shù)字信號,從而實現(xiàn)時間測量的數(shù)字化。...

2023-09-22 標簽:FPGAFPGA設計寄存器時鐘時鐘信號FPGAFPGA設計TDC寄存器時鐘時鐘信號時鐘相移 6895

BGA如何快速在4個Ball之間均勻布孔扇出呢?

BGA如何快速在4個Ball之間均勻布孔扇出呢?

BGA扇出是EDA工程師的一項基本功,在布局完成后,先將BGA的Ball進行打孔扇出,然后分層和4個方向?qū)GA內(nèi)部信號線引出到外部空間...

2023-09-22 標簽:PCB板FPGA設計DRCBGA封裝DRCEDA設計FPGA設計PCB板 8684

如何實現(xiàn)一種基于FPGA全數(shù)字高碼率QPSK調(diào)制設計?

如何實現(xiàn)一種基于FPGA全數(shù)字高碼率QPSK調(diào)制設計?

調(diào)制信號的符號速率達到500Mbps,根據(jù)奈奎斯特采樣定理,DA的采樣頻率采用2Gbps。...

2023-09-22 標簽:濾波器FPGA設計調(diào)制解調(diào)器MATLAB仿真FPGA設計MATLAB仿真QPSK濾波器調(diào)制解調(diào)器 3800

基于單光子探測的時間相關計數(shù)TCSPC設計實現(xiàn)

基于單光子探測的時間相關計數(shù)TCSPC設計實現(xiàn)

TCSPC時間相關單光子計數(shù)技術是一種成熟且通用的單光子計數(shù)技術,是一種功能強大的分析方法,目前廣泛應用于熒光壽命測量、時間分辨光譜、熒光壽命成像、飛行時間測量等眾多領域,尤其...

2023-09-22 標簽:FPGA設計存儲器數(shù)字轉(zhuǎn)換器上位機FPGA設計上位機上位機單光子探測器存儲器數(shù)字轉(zhuǎn)換器 9847

信號完整性的信號帶寬對上升邊的影響

信號完整性的信號帶寬對上升邊的影響

帶寬用于表示頻譜中最高的有效正弦波頻率分量值。為了充分近似刻畫時域波形的特征, 這是需要包含的最高正弦波頻率。所有高于帶寬的頻率分量都可忽略不計。...

2023-09-21 標簽:微處理器信號完整性ASIC芯片ASIC芯片信號完整性傅里葉變換微處理器頻譜儀 3313

為什么rs觸發(fā)器可以消除機械抖動

RS觸發(fā)器是一種基本的數(shù)字邏輯電路,它由兩個輸入(R和S)和兩個輸出(Q和Q‘)組成。R和S分別代表復位(Reset)和置位(Set)信號。當R和S都是邏輯低電平時,RS觸發(fā)器會保持上一個狀態(tài)不變...

2023-09-21 標簽:邏輯電路二進制RS觸發(fā)器觸發(fā)器數(shù)字邏輯電路 4665

如何辨別假冒的FPGA?

FPGA 并不新鮮,但它們很重要。它們的標志性特征是可以在制造后重新配置,這使得它們非常靈活。這種靈活性意味著它們經(jīng)常出現(xiàn)在對國家安全有直接影響的技術中,包括衛(wèi)星、軍事工具和航...

2023-09-21 標簽:FPGA芯片微處理器人工智能 1650

可定制RISC-V ISA的優(yōu)勢

多樣性與兼容性的統(tǒng)一 處理器供應商一直試圖在其產(chǎn)品周圍創(chuàng)建一個龐大的軟件生態(tài)系統(tǒng),因為這可以產(chǎn)生黏性,自然而然地 "鎖定 "大量投資于創(chuàng)建專用軟件的客戶。隨著時間的推移,這種效...

2023-09-21 標簽:處理器軟件代碼編譯器RISC-V 2026

什么是DFX技術?DFX設計一定要執(zhí)行設計規(guī)則檢查嗎?

什么是DFX技術?DFX設計一定要執(zhí)行設計規(guī)則檢查嗎?

DFX(Dynamic Function eXchange)的前身是PR(部分可重配置,Partial Reconfiguration)。...

2023-09-21 標簽:FPGAVHDL語言RTLDCPdfx設計FPGARTLVHDL語言 10331

用Verilog在FPGA上實現(xiàn)低通濾波器

用Verilog在FPGA上實現(xiàn)低通濾波器

在本文中,我們將簡要介紹不同類型的濾波器,然后學習如何實現(xiàn)移動平均濾波器并使用CIC架構對其進行優(yōu)化。...

2023-10-02 標簽:FPGA設計低通濾波器加法器fir濾波器FIFO存儲 4513

數(shù)字IC設計中的異步FIFO簡介

數(shù)字IC設計中的異步FIFO簡介

在大規(guī)模ASIC設計中,**多時鐘系統(tǒng)**通常是不可避免的,這會導致不同時鐘域中的數(shù)據(jù)傳輸問題。...

2023-09-20 標簽:寄存器IC設計ASIC設計同步器FIFO存儲 2323

Mojo v3 FPGA板與16x2 LCD模塊是如何進行連接的呢?

Mojo v3 FPGA板與16x2 LCD模塊是如何進行連接的呢?

在本教程中,我們將使用Verilog HDL設計一個數(shù)字電路,該電路與基于HD44780 LCD控制器/驅(qū)動芯片的通用LCD模塊連接。Mojo V3 FPGA板將用于實現(xiàn)設計。本文中使用的LCD模塊是1602A顯示器。...

2023-09-20 標簽:FPGA設計LCD控制器多路復用器觸發(fā)器HDL語言 1819

易靈思與商顯客戶合作推出完整的商業(yè)顯示動態(tài)背光方案

易靈思與商顯客戶合作推出完整的商業(yè)顯示動態(tài)背光方案

在當今的數(shù)字化時代,顯示技術是一種無處不在的信息傳播和交互的工具,它不僅影響著我們的生活方式,也推動著各行各業(yè)的發(fā)展和變革。...

2023-09-20 標簽:FPGALED顯示屏lvds接口FPGALED控制LED顯示屏lvds接口PAM 2025

怎樣使用Verilator進行Verilog Lint呢?

FPGA設計是無情的,所以我們需要利用能獲得的任何軟件進行檢查...

2023-09-20 標簽:FPGA設計仿真器FPGA設計macOS系統(tǒng)SDL仿真器靜態(tài)分析 4122

python函數(shù)與函數(shù)之間的調(diào)用

函數(shù)與函數(shù)之間的調(diào)用 3.1 第一種情況 程序代碼如下: def x ( f ): def y (): print ( 1 ) return y def f (): print ( 2 )x(f) 運行結(jié)果: 無結(jié)果 分析:因為第9行中的x(f)中的f沒有帶括號,f只是一個普通的參數(shù)...

2023-10-04 標簽:程序函數(shù)pythonpython函數(shù)變量程序 1606

python定義函數(shù)與調(diào)用函數(shù)的順序

定義函數(shù)與調(diào)用函數(shù)的順序 函數(shù)被定義后,本身是不會自動執(zhí)行的,只有在被調(diào)用后,函數(shù)才會被執(zhí)行,得到相應的結(jié)果。但是在 Python 中我們要注意一個關鍵點,就是Python不允許前向引用,即...

2023-10-04 標簽:字符串函數(shù)python 2837

什么是庫 安裝拓展庫的兩種方式

什么是庫 安裝拓展庫的兩種方式

什么是庫模塊和包側(cè)重于代碼組織,有明確的定義。 庫強調(diào)的是功能性,而不是代碼組織。 Python中庫是借用其他編程語言的概念,沒有特別具體的定義。我們通常將某個功能的“模塊的集合”...

2023-10-04 標簽:模塊代碼python 1640

如何在Rust中使用Memcached

Memcached是一種高性能、分布式的內(nèi)存對象緩存系統(tǒng),可用于加速動態(tài)Web應用程序。Rust是一種系統(tǒng)級編程語言,具有內(nèi)存安全、高性能和并發(fā)性等特點。Rust語言的Memcached庫提供了Memcached協(xié)議的實...

2023-09-19 標簽:編程語言應用程序MemcachedRust應用程序緩存編程語言 2136

FPGA芯片設計及關鍵技術

FPGA芯片設計及關鍵技術

本文來自“FPGA專題:萬能芯片點燃新動力,國產(chǎn)替代未來可期(2023)”,F(xiàn)PGA又稱現(xiàn)場可編程門陣列,是在硅片上預先設計實現(xiàn)的具有可編程特性的集成電路,用戶在使用過程中可以通過軟件重新...

2023-09-19 標簽:FPGA集成電路Xilinx芯片設計 4618

什么是Tokio模塊 Channel?

Rust 語言是一種系統(tǒng)級編程語言,它具有強類型和內(nèi)存安全性。Rust 語言中的 Tokio 模塊是一個異步編程庫,它提供了一種高效的方式來處理異步任務。其中,channel 是 Tokio 模塊中的一個重要組成...

2023-09-19 標簽:模塊數(shù)據(jù)內(nèi)存編程語言ChannelTokio內(nèi)存數(shù)據(jù)模塊編程語言 2165

世界最大FPGA芯片Versal Premium VP1902技術詳解

世界最大FPGA芯片Versal Premium VP1902技術詳解

通過FPGA,芯片設計者能在芯片送交制造(Tape Out)前,先為即將完成的ASIC或系統(tǒng)單芯片(SoC)創(chuàng)建數(shù)位雙胞胎版本,有助于產(chǎn)品驗證,并提高開發(fā)軟件。...

2023-09-19 標簽:處理器FPGA英特爾asic人工智能 6386

如何在Rust中高效地操作文件

Rust語言是一種系統(tǒng)級、高性能的編程語言,其設計目標是確保安全和并發(fā)性。 Rust語言以C和C++為基礎,但是對于安全性和并發(fā)性做出了很大的改進。 在Rust語言中,操作文件是非常重要的一個功...

2023-09-19 標簽:編程語言函數(shù)C++RustC++Rustrust語言函數(shù)編程語言 3845

基于FPGA的SPWM調(diào)制實現(xiàn)過程

基于FPGA的SPWM調(diào)制實現(xiàn)過程

SPWM(Sinusoidal Pulse Width Modulation),即正弦脈寬調(diào)制,它以頻率與期望的輸出電壓波相同的正弦波作為調(diào)制波,以頻率比期望波高得多的等腰三角波作為載波,當調(diào)制波與載波相交時,由它們的...

2023-10-01 標簽:matlab正弦波PWM逆變器仿真matlabPWMSPWM仿真正弦波逆變器 3184

數(shù)碼管的顯示原理及其實現(xiàn)方式

數(shù)碼管的顯示原理及其實現(xiàn)方式

在數(shù)字FPGA電路中,作為入門級別的外設除LED燈外,數(shù)碼管算是使用頻率最多、應用范圍最廣的一個核心集成外設了,因此學習數(shù)碼管的使用非常有必要,下面一起來看看數(shù)碼管的顯示原理及其...

2023-10-01 標簽:FPGAledVerilog數(shù)碼管數(shù)字電路 13055

基于FPGA的USB3.0回環(huán)傳輸測試方案

基于FPGA的USB3.0回環(huán)傳輸測試方案

本文開源一個FPGA項目: USB3.0 LoopBack ?;贔PGA的USB3.0通信方案有很多,其中非常好用的一款USB3.0芯片是 FT600/601Q 。...

2023-10-01 標簽:FPGAUSB3.0cpu接口上位機 7884

基于FPGA的Aurora 8b10b光通信測試方案

基于FPGA的Aurora 8b10b光通信測試方案

本文開源一個FPGA高速串行通信項目:Aurora 8b10b光通信。7 Series FPGAs Transceivers Wizard IP是Xilinx官方7系列FPGA的高速串行收發(fā)器,本工程主要是圍繞該IP核采用Vivado提供的例程創(chuàng)建。...

2023-10-01 標簽:FPGAXilinx串行通信VivadoFPGAVivadoXilinx串行通信光通信 10816

基于FPGA的MDIO接口讀寫測試方案

基于FPGA的MDIO接口讀寫測試方案

本文開源一個FPGA項目:MDIO接口讀寫測試。以太網(wǎng)通信模塊主要由 MAC (Media Access Control)控制器和物理層接口 PHY (Physical Layer)兩部分構成。其中,MAC控制器和PHY可以整合到同一芯片內(nèi),也可...

2023-10-01 標簽:FPGA接口MacPHYFPGAMacMDIOPHY接口 4698

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